高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)和CPCI接口研究(碩士論文）
標(biāo)簽： CPCI 高速數(shù)據(jù) 采集 系統(tǒng)設(shè)計(jì)
上傳時間： 2013-12-18
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介紹一個基于USB2.0接口和DSP的高速數(shù)據(jù)采集處理系統(tǒng)的工作原理、設(shè)計(jì)及實(shí)現(xiàn)。該高速數(shù)據(jù)采集處理系統(tǒng)采用TI公司TMS320C6000數(shù)字信號處理器和CYPRESS公司的USB2.0接口芯片，可以實(shí)現(xiàn)高速采集和實(shí)時處理，有著廣泛的應(yīng)用前景。
標(biāo)簽： USB 2.0 CYPRESS C6000
上傳時間： 2016-03-13
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PDIUSBD12 是一款帶有并行總線和局部DMA傳輸能力的高速USB 接口器件固件設(shè)計(jì)的目標(biāo)就是 使PDIUSBD12 在USB 上達(dá)到最大的傳輸速率外圍設(shè)備例如打印機(jī)掃描儀外部的海量存儲器和數(shù)碼 相機(jī)都可使用PDIUSBD12 在USB 上傳輸數(shù)據(jù)這些設(shè)備的CPU 要忙于處理許多設(shè)備控制和數(shù)據(jù)以及圖像 處理等任務(wù)PDIUSBD12 的固件設(shè)計(jì)成完全的中斷驅(qū)動當(dāng)CPU 處理前臺任務(wù)時USB 的傳輸可在后臺 進(jìn)行這就確保了最佳的傳輸速率和更好的軟件結(jié)構(gòu)同時簡化了編程和調(diào)試 后臺ISR 中斷服務(wù)程序和前臺主程序循環(huán)之間的數(shù)據(jù)交換通過事件標(biāo)志和數(shù)據(jù)緩沖區(qū)來實(shí)現(xiàn)例 如PDIUSBD12 的批量輸出端點(diǎn)可使用循環(huán)的數(shù)據(jù)緩沖區(qū)當(dāng)PDIUSBD12 從USB 收到一個數(shù)據(jù)包那 么就對CPU 產(chǎn)生一個中斷請求CPU 立即響應(yīng)中斷在ISR中固件將數(shù)據(jù)包從PDIUSBD12 內(nèi)部緩沖區(qū) 移到循環(huán)數(shù)據(jù)緩沖區(qū)并在隨后清零PDIUSBD12 的內(nèi)部緩沖區(qū)以使能接收新的數(shù)據(jù)包CPU 可以繼續(xù)它當(dāng) 前的前臺任務(wù)直到完成例如打印當(dāng)前頁然后返回到主循環(huán)檢查循環(huán)緩沖區(qū)內(nèi)是否有新的數(shù)據(jù)并開始其 它的前臺任務(wù)
標(biāo)簽： PDIUSBD USB 12 DMA
上傳時間： 2016-04-10
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《ALTERA FPGA/CPLD高級篇》高速DDR存儲器數(shù)據(jù)接口設(shè)計(jì)實(shí)例
標(biāo)簽： ALTERA FPGA CPLD DDR
上傳時間： 2014-01-08
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《ALTERA FPGACPLD高級篇》高速串行差分接口（HSDI）設(shè)計(jì)實(shí)例
標(biāo)簽： FPGACPLD ALTERA HSDI 高速串行
上傳時間： 2014-12-08
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高速DSP與外圍器件的接口配置主要是速度匹配與接口形式
標(biāo)簽： DSP 外圍器件 接口配置 接口
上傳時間： 2013-12-31
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基于USB2．0接口的高速數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)
標(biāo)簽： USB2 接口 高速數(shù)據(jù)傳輸 系統(tǒng)設(shè)計(jì)
上傳時間： 2013-12-17
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USB2.0接口和DSP構(gòu)成的高速數(shù)據(jù)采集系統(tǒng)的分析和設(shè)計(jì)
標(biāo)簽： USB 2.0 DSP 接口
上傳時間： 2016-07-10
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基于USB接口的高速數(shù)據(jù)采集系統(tǒng),基于USB接口的高速數(shù)據(jù)采集系統(tǒng)
標(biāo)簽： USB 接口 高速數(shù)據(jù) 采集系統(tǒng)
上傳時間： 2016-07-28
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高速掃描采樣單片機(jī)與PC機(jī)接口板的設(shè)計(jì).PDF
標(biāo)簽： 采樣 單片機(jī) PC機(jī)
上傳時間： 2014-08-18
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