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高速數(shù)(shù)字設(shè)(shè)計(jì)(jì)

  • AN-835高速ADC測試和評估

    本應(yīng)用筆記將介紹ADI公司高速轉(zhuǎn)換器部門用來評估高速ADC的特征測試和生產(chǎn)測試方法。本應(yīng)用筆記僅供參考，不能替代產(chǎn)品數(shù)據(jù)手冊

    標(biāo)簽： 835 ADC AN 測試

    上傳時(shí)間： 2014-12-23

    上傳用戶：zhaiye

  • 高速數(shù)字電路測試技術(shù)

    高速數(shù)字電路測試技術(shù)

    標(biāo)簽： 高速數(shù)字電路 測試技術(shù)

    上傳時(shí)間： 2013-11-17

    上傳用戶：hakim

  • 基于CORDIC算法的高速ODDFS電路設(shè)計(jì)

    為了滿足現(xiàn)代高速通信中頻率快速轉(zhuǎn)換的需求，基于坐標(biāo)旋轉(zhuǎn)數(shù)字計(jì)算（CORDIC，Coordinate Rotation Digital Computer）算法完成正交直接數(shù)字頻率合成（ODDFS，Orthogonal Direct Digital Frequency Synthesizer）電路設(shè)計(jì)方案。采用MATLAB和Xilinx System Generator開發(fā)工具搭建電路的系統(tǒng)模型，通過現(xiàn)場可編程門陣列（FPGA，F(xiàn)ield Programmable Gate Array）完成電路的寄存器傳輸級（RTL，Register Transfer Level）驗(yàn)證，仿真結(jié)果表明電路設(shè)計(jì)具有很高的有效性和可行性。

    標(biāo)簽： CORDIC ODDFS 算法 電路設(shè)計(jì)

    上傳時(shí)間： 2013-11-09

    上傳用戶：hfnishi

  • 高速數(shù)字電路設(shè)計(jì)-華為

    高速數(shù)字電路設(shè)計(jì)，實(shí)用

    標(biāo)簽： 高速數(shù)字 電路設(shè)計(jì) 華為

    上傳時(shí)間： 2013-10-10

    上傳用戶：kelimu

  • 一種新型高速電磁閥驅(qū)動(dòng)電路

    一種新型高速電磁閥驅(qū)動(dòng)電路

    標(biāo)簽： 高速電磁閥 驅(qū)動(dòng)電路

    上傳時(shí)間： 2013-10-30

    上傳用戶：zoudejile

  • 華為《高速數(shù)字電路設(shè)計(jì)教材》

    華為《高速數(shù)字電路設(shè)計(jì)教材》

    標(biāo)簽： 華為 高速數(shù)字電路 設(shè)計(jì)教材

    上傳時(shí)間： 2014-12-23

    上傳用戶：frank1234

  • ADI處理器實(shí)用叢書-高速設(shè)計(jì)技術(shù)

    本書內(nèi)容包括三大部分：第1 部分從運(yùn)算放大器的基本概念和理論出發(fā)，重點(diǎn)介紹了運(yùn)算放大器的原理與設(shè)計(jì)，以及在各種電子系統(tǒng)中的應(yīng)用，包括視頻應(yīng)用、RF/IF 子系統(tǒng)(乘法器、調(diào)制器和混頻器)等;第2 部分主要介紹了高速采樣和高速ADC 及其應(yīng)用、高速DAC 及其應(yīng)用、以及DDS 系統(tǒng)與接收機(jī)子系統(tǒng)等;第3 部分介紹了有關(guān)高速硬件設(shè)計(jì)技術(shù)，如仿真、建模、原型、布局、去藕與接地，以及EMI 與RFI設(shè)計(jì)考慮等。 　　書中內(nèi)容既有完整的理論分析，又有具體的實(shí)際應(yīng)用電路，還包括許多應(yīng)用技巧。特別適合電子電路與系統(tǒng)設(shè)計(jì)工程師、高等院校相關(guān)專業(yè)師生閱讀。

    標(biāo)簽： ADI 處理器 高速設(shè)計(jì)

    上傳時(shí)間： 2013-11-16

    上傳用戶：qitiand

  • 帶有增益提高技術(shù)的高速CMOS運(yùn)算放大器設(shè)計(jì)

    設(shè)計(jì)了一種用于高速ADC中的高速高增益的全差分CMOS運(yùn)算放大器。主運(yùn)放采用帶開關(guān)電容共模反饋的折疊式共源共柵結(jié)構(gòu)，利用增益提高和三支路電流基準(zhǔn)技術(shù)實(shí)現(xiàn)一個(gè)可用于12~14 bit精度，100 MS/s采樣頻率的高速流水線（Pipelined）ADC的運(yùn)放。設(shè)計(jì)基于SMIC 0.25 μm CMOS工藝，在Cadence環(huán)境下對電路進(jìn)行Spectre仿真。仿真結(jié)果表明，在2.5 V單電源電壓下驅(qū)動(dòng)2 pF負(fù)載時(shí)，運(yùn)放的直流增益可達(dá)到124 dB，單位增益帶寬720 MHz，轉(zhuǎn)換速率高達(dá)885 V/μs，達(dá)到0.1%的穩(wěn)定精度的建立時(shí)間只需4 ns，共模抑制比153 dB。

    標(biāo)簽： CMOS 增益提高 運(yùn)算 放大器設(shè)計(jì)

    上傳時(shí)間： 2014-12-23

    上傳用戶：jiiszha

  • 高速電路設(shè)計(jì)與實(shí)現(xiàn)

    通常認(rèn)為如果數(shù)字邏輯電路的頻率達(dá)到或者超過45MHZ~50MHZ，而且工作在這個(gè)頻率之上的電路已經(jīng)占到了整個(gè)電子系統(tǒng)一定的份量（比如說1/3），就稱為高速電路。

    標(biāo)簽： 高速電路

    上傳時(shí)間： 2014-12-23

    上傳用戶：baby25825

  • 16位高速模數(shù)轉(zhuǎn)換模塊的設(shè)計(jì)及其動(dòng)態(tài)性能測試

    本文結(jié)合研究所科研項(xiàng)目需要，基于16 位高速ADC 芯片LTC2204，設(shè)計(jì)了一種滿足課題要求的高速度高性能的16 位模數(shù)轉(zhuǎn)換板卡方案。該方案中的輸入電路和時(shí)鐘電路采用差分結(jié)構(gòu)，輸出電路采用鎖存器隔離結(jié)構(gòu)，電源電路采用了較好的去耦措施，并且注重了板卡接地設(shè)計(jì)，使其具有抗噪聲干擾能力強(qiáng)、動(dòng)態(tài)性能好、易實(shí)現(xiàn)的特點(diǎn)。

    標(biāo)簽： 模數(shù)轉(zhuǎn)換 模塊 動(dòng)態(tài) 性能測試

    上傳時(shí)間： 2013-11-10

    上傳用戶：cc1

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