DPLL由 鑒相器 模K加減計數器 脈沖加減電路 同步建立偵察電路 模N分頻器 構成. 整個系統的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K加減計數器的K值決定DPLL的精度和同步建立時間,K越大,則同步建立時間長,同步精度高.反之則短,低.
標簽： signal_out signal_in DPLL 模
上傳時間： 2013-12-26
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(1) 315、433、868、915Mh的ISM 和SRD頻段 (2) 最高工作速率500kbps，支持2-FSK、GFSK和MSK調制方式 (3) 高靈敏度（1.2kbps下-110dDm，1％數據包誤碼率） (4) 內置硬件CRC 檢錯和點對多點通信地址控制 (5) 較低的電流消耗（RX中，15.6mA，2.4kbps,433MHz） (6) 可編程控制的輸出功率，對所有的支持頻率可達+10dBm (7) 支持低功率電磁波激活功能 (8) 支持傳輸前自動清理信道訪問（CCA），即載波偵聽系統 (9) 快速頻率變動合成器帶來的合適的頻率跳躍系統 (10) 模塊可軟件設地址，軟件編程非常方便 (11) 標準DIP間距接口，便于嵌入式應用 (12) 單獨的64字節RX和TX數據FIFO
標簽： kbps 315 433 868
上傳時間： 2016-06-21
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外圍組件接口技術（Peripheral Component Interconnect PCI）是一種新型的高帶寬、處理器無關的總線系統。它既可以作為中間層的總線也可以作為周邊總線系統使用。與其他普通總線規范想對照，PCI 總線為高速I/O設備提供了更好的支持（比如圖形適配器、網絡接口控制器、磁盤控制器，等等）。現行的標準允許在33Mhz下使用64根數據線，純傳輸速率可達2.11Gbps。但是PCI吸引人的地方不在于它的高速度，它適應了現代I/O設備對系統的要求，并且只需要很少的芯片就可以實現并支持其他總線系統。
標簽： Interconnect Peripheral Component PCI
上傳時間： 2017-01-17
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AD779x 系列產品常見問題解答AD7798/AD7799均為適合高精度測量應用的低功耗、低噪聲、完整模擬前端，內置一個低噪聲16位/24位Σ-Δ型ADC，其中含有3個差分模擬輸入，還集成了片內低噪聲儀表放大器，因而可直接輸入小信號。當增益設置為64、更新速率為4.17Hz時，AD7799的均方根（RMS）噪聲為27nV，AD7798的均方根（RMS）噪聲為40nV.
標簽： AD 779x 7798 7799
上傳時間： 2017-02-17
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標簽： 軟件無線電 濾波器
上傳時間： 2021-11-16
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標簽： lte
上傳時間： 2021-11-19
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上傳時間： 2021-11-25
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上傳時間： 2022-01-26
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