高速串并轉(zhuǎn)換器的設(shè)計是FPGA 設(shè)計的一個重要方面,傳統(tǒng)設(shè)計方法由于采用FPGA 的內(nèi)部邏輯資源來實現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗證平臺中多路高速串并轉(zhuǎn)換器的設(shè)計為例,詳細闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計方法和16 路1 :8 串并轉(zhuǎn)換器的實現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計的多路串并轉(zhuǎn)換器可以實現(xiàn)800 Mbit/ s 輸入信號的串并轉(zhuǎn)換,并且減少了設(shè)計復(fù)雜度,縮短了開發(fā)周期,能滿足設(shè)計要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場可編程邏輯陣列;Xilinx ; ISERDES
標簽: FPGA 多路 串并轉(zhuǎn)換
上傳時間: 2013-11-03
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文章分析了雷達高速寬帶數(shù)字接收與恢復(fù)的現(xiàn)狀,以及制約其發(fā)展的關(guān)鍵因素,提出基于高速串行器/解串器、FPGA和正交數(shù)字上變頻器的高速寬帶數(shù)字接收與恢復(fù)系統(tǒng)方案。系統(tǒng)以光纖為傳輸媒介,以FPGA為控制核心,正交調(diào)試器為信號調(diào)制平臺,完成高速數(shù)字接收、基帶信號預(yù)處理與基帶信號的上變頻等功能。該系統(tǒng)具有誤碼率低、可靠性高的優(yōu)點。
標簽: 光纖技術(shù) 雷達 技術(shù)研究 高速通信
上傳時間: 2014-12-28
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針對實時型相機對系統(tǒng)小型化、通用化及數(shù)據(jù)高速率可靠傳輸?shù)男枨螅闹性谘芯扛咚俅衅?解串器(SerDes)器件TLK2711工作原理的基礎(chǔ)上,提出了高速串行全雙工通信協(xié)議總體設(shè)計方案。文章以TLK2711為物理層、FPGA為鏈路層設(shè)計了高速串行全雙工通信協(xié)議,對協(xié)議的實現(xiàn)進行了詳細的描述。協(xié)議的在定制中力求做到了最簡化,為上層用戶提供簡單的數(shù)據(jù)接口。試驗中通過兩塊電路板的聯(lián)調(diào),完成了數(shù)據(jù)率為2.5Gbps的點對點高速傳輸,采用發(fā)送偽隨機碼測試,系統(tǒng)工作2小時,所測誤碼率小于10-12。
上傳時間: 2014-12-28
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OFDM是無人機高速遙測信道中的主要傳輸技術(shù)之一,但是OFDM系統(tǒng)的主要缺陷之一是具有較高的峰均比。文中研究了一種信道糾錯編碼與迭代限幅濾波算法(Repeated Clipping and Filtering,RCF)相結(jié)合的峰均比抑制方案。仿真結(jié)果表明,RCF算法能夠?qū)崿F(xiàn)峰均比的有效抑制,卷積編碼和Turbo編碼能夠有效抑制RCF算法產(chǎn)生的限幅噪聲,降低系統(tǒng)誤碼率。
上傳時間: 2013-10-09
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為了提高CPU模塊之間的點對點通信速率,通過對以太網(wǎng)控制器MAC的研究,設(shè)計出一種點對點高速通信控制器。該控制器是基于媒體無關(guān)接口MII和以太網(wǎng)收發(fā)器的點對點高速通信控制器。利用VHDL語言編寫該控制器的相關(guān)代碼,使用MAXPLUSⅡ?qū)υ摽刂破鞯臄?shù)據(jù)發(fā)送和數(shù)據(jù)接收進行仿真,并在實驗室樣機上進行實現(xiàn)。仿真結(jié)果和實驗結(jié)果表明這種點對點高速通信控制器的設(shè)計方法是可行的。
上傳時間: 2013-11-09
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本書既可供學(xué)生使用也可供專業(yè)人員使用。對于高速聯(lián)網(wǎng)領(lǐng)域感興趣的專業(yè)人員可將本書作為基礎(chǔ)參考書用于自修。作為教材,本書適于高年級本科生和研究生使用。書中討論了許多高深的論題,同時也對需要涉及的基本論題進行了簡要討論。在第1部分、第2部分之后的各部分是相互獨立的。如果將本書作為一門較簡短課程的教材,可以少選幾個部分。而各部分之間的教學(xué)次序則可以隨意安排。
標簽: 高速網(wǎng)絡(luò) 互聯(lián)網(wǎng) 性能 服務(wù)質(zhì)量
上傳時間: 2013-11-23
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美信公司的高速互連 (第9版本) 資料,主要內(nèi)容有: 3mm x 3mm串行器支持微型安全攝像機設(shè)計 .2吉比特、多端口、LVDS交叉點開關(guān),有效降低系統(tǒng)成本 ...318位、智能型雙向LVDS SerDes,無需CAN或LIN接口 .....4帶有LVDS系統(tǒng)接口的GMSL SerDes,電路板尺寸縮減50% ....5GMSL SerDes提供完備的數(shù)字視頻、音頻和控制數(shù)據(jù)支持 6利用HDCP GMSL SerDes實現(xiàn)安全的數(shù)據(jù)傳輸 ....7降低汽車導(dǎo)航系統(tǒng)的EMI和成本 ....821位、直流平衡LVDS解串器,可編程擴頻 .....9選型指南 ....10
上傳時間: 2014-12-05
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采用Xilinx 公司Virtex- II Pro 系列FPGA 內(nèi)嵌得SERDES 模塊———RocketIO 作為高速串行協(xié)議的物理層, 利用其8B/10B的編解碼和串化、解串功能, 實現(xiàn)了兩板間基于數(shù)據(jù)幀的簡單高速串行傳輸, 并在ISE 環(huán)境中對整個協(xié)議進行了仿真, 當系統(tǒng)頻率為100MHz, 串行速率在2Gbps 時, 在驗證板上用chipscope 抓取的數(shù)據(jù)表明能夠?qū)崿F(xiàn)兩板間數(shù)據(jù)的高速無誤串行傳輸。關(guān)鍵詞: RocketIO;高速串行傳輸;SERDES;協(xié)議
標簽: RocketIO 高速串行 協(xié)議設(shè)計
上傳時間: 2013-10-21
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高速鐵路振動荷載的模擬研究
上傳時間: 2013-11-21
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特點 精確度0.1%滿刻度 ±1位數(shù) 可量測 交直流電流/交直流電壓/電位計/傳送器/Pt-100/荷重元/電阻 等信號 顯示范圍-1999-9999可任意規(guī)劃 具有異常值與異常次數(shù)記錄保留功能 異常信號過高或過低或范圍內(nèi)或范圍外檢測可任意設(shè)定 報警繼電器復(fù)歸方式可任意設(shè)定 尺寸小,穩(wěn)定性高 2.主要規(guī)格 精確度: 0.1% F.S. ±1 digit 0.2% F.S. ±1 digit(AC) 取樣時間: 16 cycles/sec. 顯示值范圍: -1999 - +9999 digit adjustable 啟動延遲動作時間: 0-99.9 second adjustable 繼電器延遲動作時間: 0-99.9 second adjustable 繼電器復(fù)歸方式: Manual (N) / latch(L) can be modified 繼電器動作方向: HI /LO/GO/HL can be modified 繼電器容量: AC 250V-5A, DC 30V-7A 過載顯示: "doFL" 溫度系數(shù): 50ppm/℃ (0-50℃) 顯示幕: Red high efficiency LEDs high 14.22mm(.56")(PV) Red high efficiency LEDs high 7.0mm(.276")(NO) 參數(shù)設(shè)定方式: Touch switches 記憶型式 : Non-volatile E2PROM memory 絕緣耐壓能力: 2KVac/1 min. (input/output/power) 1600Vdc(input/output 使用環(huán)境條件 : 0-50℃(20 to 90% RH non-condensed) 存放環(huán)境條件: 0-70℃(20 to 90% RH non-condensed) CE認證: EN 55022:1998/A1:2000 Class A EN 61000-3-2:2000 EN 61000-3-3:1995/A1:2001 EN 55024:1998/A1:2001
上傳時間: 2013-11-02
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