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高速通信

  • 用SPI總線實現DSP和MCU之間的高速通信.rar

    簡述了SPI總線協議工作時序和配置要求，通過一個成功的實例詳細介紹了使用SPI 總線實現DSP與MCU之間的高速通信方法，并參考實例給出了SPI接口的硬件連接、初始化、 以及傳輸測試程序的編寫方法。 關鍵詞：SPI接口；McBSP；總線；高速通信

    標簽： SPI DSP MCU

    上傳時間： 2013-04-24

    上傳用戶：jhksyghr

  • 一種點對點高速通信控制器的設計與實現

    為了提高CPU模塊之間的點對點通信速率，通過對以太網控制器MAC的研究，設計出一種點對點高速通信控制器。該控制器是基于媒體無關接口MII和以太網收發器的點對點高速通信控制器。利用VHDL語言編寫該控制器的相關代碼，使用MAXPLUSⅡ對該控制器的數據發送和數據接收進行仿真，并在實驗室樣機上進行實現。仿真結果和實驗結果表明這種點對點高速通信控制器的設計方法是可行的。

    標簽： 點對點 控制器 高速通信

    上傳時間： 2013-11-09

    上傳用戶：zhangxin

  • 高速通信系統中均衡器的幾種結構說明與比較

    高速通信系統中均衡器的幾種結構說明與比較，對設計SerDes的朋友有幫助

    標簽： 高速通信系統 均衡器 比較

    上傳時間： 2016-12-10

    上傳用戶：lacsx

  • wishbone總線的VHDL源代碼 wishbone適用于與FPGA中IP核的高速通信

    wishbone總線的VHDL源代碼 wishbone適用于與FPGA中IP核的高速通信，其接口簡單，速度快 成為ip通信的主流

    標簽： wishbone VHDL FPGA IP核

    上傳時間： 2014-01-09

    上傳用戶：maizezhen

  • 普通光耦高速通信TLP521用于115200bps

    普通光耦高速通信TLP521用于115200bps

    標簽： 光耦

    上傳時間： 2015-07-06

    上傳用戶：zts940611

  • 基于FPGA DSP架構的高速通信接口設計與實現

    本文采用 altera 公司cyclone 系列芯片ep1c12 實現了與ts101／ts201 兩種芯片的鏈路口的雙工通信，并給出了具體的設計實現方法。其中ts101 的設計已經成功應用于某

    標簽： FPGA DSP 架構 接口設計

    上傳時間： 2013-06-15

    上傳用戶：hmy2st

  • 基于CORDIC算法的高速ODDFS電路設計

    為了滿足現代高速通信中頻率快速轉換的需求，基于坐標旋轉數字計算（CORDIC，Coordinate Rotation Digital Computer）算法完成正交直接數字頻率合成（ODDFS，Orthogonal Direct Digital Frequency Synthesizer）電路設計方案。采用MATLAB和Xilinx System Generator開發工具搭建電路的系統模型，通過現場可編程門陣列（FPGA，Field Programmable Gate Array）完成電路的寄存器傳輸級（RTL，Register Transfer Level）驗證，仿真結果表明電路設計具有很高的有效性和可行性。

    標簽： CORDIC ODDFS 算法 電路設計

    上傳時間： 2013-11-09

    上傳用戶：hfnishi

  • 基于FPGA DSP架構的高速通信接口設計與實現

    本文采用 altera 公司cyclone 系列芯片ep1c12 實現了與ts101／ts201 兩種芯片的鏈路口的雙工通信，并給出了具體的設計實現方法。其中ts101 的設計已經成功應用于某信號處理機中。

    標簽： FPGA DSP 架構 接口設計

    上傳時間： 2014-01-12

    上傳用戶：ZJX5201314

  • 采用高速串行收發器Rocket I/O實現數據率為2.5 G

    摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

    標簽： Rocket 2.5 高速串行 收發器

    上傳時間： 2013-11-06

    上傳用戶：smallfish

  • 基于光纖技術的雷達高速通信技術研究

    文章分析了雷達高速寬帶數字接收與恢復的現狀，以及制約其發展的關鍵因素，提出基于高速串行器/解串器、FPGA和正交數字上變頻器的高速寬帶數字接收與恢復系統方案。系統以光纖為傳輸媒介，以FPGA為控制核心，正交調試器為信號調制平臺，完成高速數字接收、基帶信號預處理與基帶信號的上變頻等功能。該系統具有誤碼率低、可靠性高的優點。

    標簽： 光纖技術 雷達 技術研究 高速通信

    上傳時間： 2014-12-28

    上傳用戶：czl10052678

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