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高頻電路

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽： FPGA 多路 串并轉換

    上傳時間： 2013-11-03

    上傳用戶：王小奇

  • 毫米波低相噪捷變頻高分辨率雷達頻率源設計

    設計了一種由直接數字頻率合成(DDS)、倍頻鏈構成的三次變頻直接頻率合成方案，實現了低相噪捷變頻高分辨率毫米波雷達頻率合成器設計。利用直接頻率合成器的倍頻輸出取代傳統三次變頻毫米波頻率源的鎖相環(PLL),同時提供線性調頻(LFM)信號，優化DDS和變頻方案的頻率配置關系。利用FPGA電路進行高速控制，較好地解決了毫米波頻率合成器各技術指標之間的矛盾。實測結果表明，采用該方案的毫米波頻率合成器在本振跳頻帶寬為160 MHz時，線性調頻頻率分辨率可達0.931 Hz，最大頻率轉換時間小于2 ?滋s，最大雜散低于-60 dBc，相位噪聲優于-90 dBc/Hz。

    標簽： 毫米波 捷變 高分辨率 雷達

    上傳時間： 2014-01-06

    上傳用戶：brain kung

  • 帶解碼四路無線遙控接收模塊

    帶解碼四路無線遙控接收模塊

    標簽： 解碼 無線遙控 接收模塊

    上傳時間： 2013-11-13

    上傳用戶：小眼睛LSL

  • AR9331高功率CPE裸板

    納拓科技應用AR9331開發設計出一款高功率CPE，同時可以做高功率無線ap和網橋，在無線網絡通信中有廣泛應用

    標簽： 9331 CPE AR 高功率

    上傳時間： 2013-11-17

    上傳用戶：qiulin1010

  • 鏈路自適應技術在LTE中的應用

    參照3GPP LTE的E-UTRA物理層規范，提出了一種鏈路自適應方案。實時調整傳輸功率以補償信道的衰落，建立SNR-BLER曲線，在給定滿足一定業務的目標BLER的條件下，找到各個MCS的SNR切換門限值，從而實現鏈路自適應。仿真結果表明，在保證通信質量的前提下，自適應方案比固定MCS有著明顯的頻譜效率增益，使無線資源得到優化配置；同時刪減了頻譜效率沒有增益的MCS，降低系統復雜度。

    標簽： LTE 鏈路 自適應技術 中的應用

    上傳時間： 2013-12-22

    上傳用戶：xsnjzljj

  • 基于TLK2711的高速串行全雙工通信協議研究

    針對實時型相機對系統小型化、通用化及數據高速率可靠傳輸的需求，文中在研究高速串行器/解串器（SerDes）器件TLK2711工作原理的基礎上，提出了高速串行全雙工通信協議總體設計方案。文章以TLK2711為物理層、FPGA為鏈路層設計了高速串行全雙工通信協議，對協議的實現進行了詳細的描述。協議的在定制中力求做到了最簡化，為上層用戶提供簡單的數據接口。試驗中通過兩塊電路板的聯調，完成了數據率為2.5Gbps的點對點高速傳輸，采用發送偽隨機碼測試，系統工作2小時，所測誤碼率小于10-12。

    標簽： 2711 TLK 高速串行 全雙工

    上傳時間： 2014-12-28

    上傳用戶：wff

  • 路漫漫其修遠兮：Android必須改進的八個地方

    路漫漫其修遠兮：Android必須改進的八個地方

    標簽： Android

    上傳時間： 2013-11-22

    上傳用戶：asdfasdfd

  • 一種基于信號延遲的光網絡攻擊方式

    針對光網絡攻擊易被發現的問題，提出一種基于信號延遲插入的光網絡攻擊方式。該方法在不改變鏈路光學性能的基礎上，利用信號延遲在系統中引起較高的串擾，極大的降低了系統的性能。仿真和實驗結果表明攻擊后目標光鏈路的誤碼性能大幅劣化而其光域內參數幾乎沒有變化，具有較好的隱蔽性和良好的攻擊效果。

    標簽： 信號延遲 光網絡 攻擊 方式

    上傳時間： 2013-12-24

    上傳用戶：超凡大師

  • 基于加速度傳感器AIS226DS的制動性能測試儀的研制

    在分析國內外現有便攜式制動性能測試儀的特點和功能的基礎上，研制了一種基于數字加速度傳感器AIS226DS的制動性能測試儀。文中主要介紹了系統各部分硬件設計以及軟件總體結構設計。利用單片機完成加速度傳感器輸出值對時間的積分算法，實現了對被測車輛的制動性能測試。考慮到便攜儀器低功耗需求，選用C8051f585單片機和CAT6219電源芯片，降低了整機功耗。經靜態校準和實車路試測試，該測試儀的測量精度高、穩定性好。

    標簽： AIS 226 DS 加速度傳感器

    上傳時間： 2013-10-22

    上傳用戶：標點符號

  • 基于霍爾傳感器的高精度測速電路設計

    設計寬范圍高精度測速電路；通過對三種常用轉速測量方法的分析比較，確定采用M法與M/T法相結合的方法測速，從理論上保證測速的寬范圍和高精度；電路設計中為了簡單，快速，準確的測速，兩種測速方法之間采用硬件切換電路完成，克服了軟件切換因工作量大而導致的實時控制變差的缺陷；采用片外計數器8253彌補了8051硬件資源短缺的不足，利用霍爾元件完成轉速到旋轉脈沖的轉換，實現了低成本，高性能。

    標簽： 霍爾傳感器 測速 電路設計 高精度

    上傳時間： 2013-11-02

    上傳用戶：leehom61

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