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點(diǎn)位圖

  • 主機板電路圖 有需要 可以看看囉 有點舊 但是很實用唷~~

    主機板電路圖 有需要 可以看看囉 有點舊 但是很實用唷~~

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    上傳時間: 2017-06-30

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  •  多旅行商問題(Multiple Traveling Salesperson Problem ,簡稱MTSP) 討論的是如何安排m( > 1 ) 位旅行商訪問n( > m ) 座城市,要

     多旅行商問題(Multiple Traveling Salesperson Problem ,簡稱MTSP) 討論的是如何安排m( > 1 ) 位旅行商訪問n( > m ) 座城市,要求每個城市只允許被訪問一次時,求解所有旅行商花費的費用和是最小(或最大) 的問題。MTSP 問題其實與單 旅行商問題(Traveling Salesperson Problem ,簡稱TSP) 相似,但是由于添加了任何城市只要被某一旅行商訪問到即可這個附加條 件,因而增加了問題復雜度。在以前使用遺傳算法(GA) 研究解決MTSP 問題時,通常采用標準的TSP 染色體和處理方法。現 為解決MTSP 問題給出了一種新的染色體設計和相關的處理方法,并與以往的理論設計和計算性能進行比較。計算測試顯 示,新的方法能夠獲得較小的查找空間,在許多方面,新的方法產生的解空間更好。

    標簽: Salesperson Traveling Multiple Problem

    上傳時間: 2013-12-17

    上傳用戶:蟲蟲蟲蟲蟲蟲

  •   (1)設計一個4位十進制的頻率計其測量范圍1Hz~9.999KHz;6 N3 G8 k( U- @ n* A   (2)記數過程結束后

      (1)設計一個4位十進制的頻率計其測量范圍1Hz~9.999KHz;6 N3 G8 k( U- @ n* A   (2)記數過程結束后,保存并顯示結果;

    標簽: 9.999 KHz Hz G8

    上傳時間: 2017-08-21

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  • 一﹑指標要求:. A: f5 b G A( d8 n   (1)設計一個4位十進制的頻率計其測量范圍1Hz~9.999KHz;6 N3 G8 k( U- @ n* A   (2)記數過程結束

    一﹑指標要求:. A: f5 b G A( d8 n   (1)設計一個4位十進制的頻率計其測量范圍1Hz~9.999KHz;6 N3 G8 k( U- @ n* A   (2)記數過程結束后,保存并顯示結果;

    標簽: 9.999 KHz f5 d8

    上傳時間: 2014-01-07

    上傳用戶:妄想演繹師

  • 基于FPGA的8位增強型CPU設計與驗證

    隨著信息技術的發展,系統級芯片SoC(System on a Chip)成為集成電路發展的主流。SoC技術以其成本低、功耗小、集成度高的優勢正廣泛地應用于嵌入式系統中。通過對8位增強型CPU內核的研究及其在FPGA(Field Programmable Gate Arrav)上的實現,對SoC設計作了初步研究。 在對Intel MCS-8051的匯編指令集進行了深入地分析的基礎上,按照至頂向下的模塊化的高層次設計流程,對8位CPU進行了頂層功能和結構的定義與劃分,并逐步細化了各個層次的模塊設計,建立了具有CPU及定時器,中斷,串行等外部接口的模型。 利用5種尋址方式完成了8位CPU的數據通路的設計規劃。利用有限狀態機及微程序的思想完成了控制通路的各個層次模塊的設計規劃。利用組合電路與時序電路相結合的思想完成了定時器,中斷以及串行接口的規劃。采用邊沿觸發使得一個機器周期對應一個時鐘周期,執行效率提高。使用硬件描述語言實現了各個模塊的設計。借助EDA工具ISE集成開發環境完成了各個模塊的編程、調試和面向FPGA的布局布線;在Synplify pro綜合工具中完成了綜合;使用Modelsim SE仿真工具對其進行了完整的功能仿真和時序仿真。 設計了一個通用的擴展接口控制器對原有的8位處理器進行擴展,加入高速DI,DO以及SPI接口,增強了8位處理器的功能,可以用于現有單片機進行升級和擴展。 本設計的CPU全面兼容MCS-51匯編指令集全部的111條指令,在時鐘頻率和指令的執行效率指標上均優于傳統的MCS-51內核。本設計以硬件描述語言代碼形式存在可與任何綜合庫、工藝庫以及FPGA結合開發出用戶需要的固核和硬核,可讀性好,易于擴展使用,易于升級,比較有實用價值。本設計通過FPGA驗證。

    標簽: FPGA CPU 8位 增強型

    上傳時間: 2013-04-24

    上傳用戶:jlyaccounts

  • 用FPGA實現的8點32 位FFT 處理器方案

    :文章針對目前數字信號處理中大量采用的快速傅立葉變換[FFT] 算法采用軟件編程來處理的應用現狀,在對FFT 算法進行\\\\\\\\r\\\\\\\\n分析的基礎上,給出了用FPGA[Field Programmable Gate Array] 實現的8 點32 位FFT 處理器方案,并得到了系統的仿真結果。\\\\\\\\r\\\\\\\\n最后在Altera 公司FLEX10K系列FPGA 芯片上成功地實現了綜合。

    標簽: FPGA FFT 處理器 方案

    上傳時間: 2013-08-09

    上傳用戶:yangzhiwei

  • VHDL源程序:16位計數器的設計

    16位計數器的設計,這里是實現上述功能的VHDL源程序,供大家學習和討論。\r\n

    標簽: VHDL 源程序 計數器

    上傳時間: 2013-09-05

    上傳用戶:weiwolkt

  • AT89S/C52,11.0592MHz,DS18B20和6位數碼管

    通過AT89S/C52,11.0592MHz,DS18B20和6位數碼管,采集溫度并在數碼管上實時顯示。\r\n并有相應的不同顏色的led和蜂鳴器指示。\r\n下載后即可以運行。

    標簽: 11.0592 MHz AT 89

    上傳時間: 2013-09-30

    上傳用戶:changeboy

  • MT-003 了解SINAD、ENOB、SNR、THD、THD + N、SFDR,不在噪底中迷失

    用于定量表示ADC動態性能的常用指標有六個,分別是:SINAD(信納比)、ENOB(有效位 數)、SNR(信噪比)、THD(總諧波失真)、THD + N(總諧波失真加噪聲)和SFDR(無雜散動態 范圍)

    標簽: THD SINAD ENOB SFDR

    上傳時間: 2014-01-22

    上傳用戶:魚哥哥你好

  • 奇數N 階魔方陣問題: 奇數N 階魔方陣的構造規則如下: 1、在第一行的正中間填入1; 2、如果左上角能夠移動

    奇數N 階魔方陣問題: 奇數N 階魔方陣的構造規則如下: 1、在第一行的正中間填入1; 2、如果左上角能夠移動,則往左上角填入后繼的數;如果左上角不 能移動,則順移到該列最下方左邊的一列中最靠近該列的位置; 3、如果左上角不能移動,同時在該列位置的最下方左邊最靠近的位 置處也不能填入數,則往該位置的上一行的最右邊的位置處填入 后繼數; 4、每次盡可能地往左上角填數,如果發現左上角已經填滿了數,則 從當前填的數的位置下方填上后繼數。 要求: 無。 輸入: 用戶從鍵盤任意輸入一個正奇數。 輸出: 打印出該魔方陣。

    標簽: 魔方 移動

    上傳時間: 2015-02-14

    上傳用戶:lyy1234

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