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算法

  • 幾種用于FPGA的新型有效混合布線算法

    采用現(xiàn)場可編程門陣列(FPGA)可以快速實現(xiàn)數(shù)字電路,但是用于生成FPGA編程的比特流文件的CAD工具在編制大規(guī)模電路時常常需要數(shù)小時的時間,以至于許多設計者甚至通過在給定FPGA上采用更多的資源,或者以犧牲電路速度為代價來提高編制速度。電路編制過程中大部分時間花費在布線階段,因此有效的布線算法能極大地減少布線時間。 許多布線算法已經(jīng)被開發(fā)并獲得應用,其中布爾可滿足性(SAT)布線算法及幾何查找布線算法是當前最為流行的兩種。然而它們各有缺點:基于SAT的布線算法在可擴展性上有很大缺陷;幾何查找布線算法雖然具有廣泛的拆線重布線能力,但當實際問題具有嚴格的布線約束條件時,它在布線方案的收斂方面存在很大困難。基于此,本文致力于探索一種能有效解決以上問題的新型算法,具體研究工作和結(jié)果可歸納如下。 1、在全面調(diào)查FPGA結(jié)構(gòu)的最新研究動態(tài)的基礎(chǔ)上,確定了一種FPGA布線結(jié)構(gòu)模型,即一個基于SRAM的對稱陣列(島狀)FPGA結(jié)構(gòu)作為研究對象,該模型僅需3個適合的參數(shù)即能表示布線結(jié)構(gòu)。為使所有布線算法可在相同平臺上運行,選擇了美國北卡羅來納州微電子中心的20個大規(guī)模電路作為基準,并在布線前采用VPR399對每個電路都生成30個布局,從而使所有的布線算法都能夠直接在這些預制電路上運行。 2、詳細研究了四種幾何查找布線算法,即一種基本迷宮布線算法Lee,一種基于協(xié)商的性能驅(qū)動的布線算法PathFinder,一種快速的時延驅(qū)動的布線算法VPR430和一種協(xié)商A

    標簽: FPGA 布線算法

    上傳時間: 2013-05-18

    上傳用戶:ukuk

  • 紋理映射算法研究與FPGA實現(xiàn)

    紋理映射在計算機圖形計算中屬于光柵化階段,處理的是像素,主要的特點是數(shù)據(jù)的吞吐量大,對實時系統(tǒng)來說轉(zhuǎn)換的速度是一個關(guān)鍵的因素,人們尋求各種加速算法來提高運算速度。傳統(tǒng)的方法是用更快的處理器,并行算法或?qū)S糜布kS著數(shù)字技術(shù)的發(fā)展,尤其是可編程邏輯門陣列(FPGAs)的發(fā)展,提供了一種新的加速方法。FPGAs在密度和性能上都有突破性的發(fā)展,當前的FPGA芯片已經(jīng)能夠運算各種圖形算法,而在速度上與專用的圖形卡硬件相同。因此,F(xiàn)PGA芯片非常適合這項工作。 本文主要工作包括以下幾個方面: 1、本文提出了一種MIPmapping紋理映射優(yōu)化方法,改進了MIPmapping映射細化層次算法及紋理圖像的存儲方式,減少紋理尋址的計算量,提高紋理存儲的相關(guān)性。詳細內(nèi)容請閱讀第三章。 2、提出了一種MIPmapping紋理映射優(yōu)化方法的硬件實現(xiàn)方案,該方案針對移動設備對功耗和面積的要求,以及分辨率不高的特點,在參數(shù)空間到紋理地址的計算中用定點數(shù)來實現(xiàn)。詳細內(nèi)容請閱讀第四章。 3、實現(xiàn)了紋理映射流水線單元紋理地址產(chǎn)生電路,及紋理濾波電路的FPGA設計,并給出設計的綜合和仿真結(jié)果。詳細內(nèi)容請閱讀第五章4、實現(xiàn)了符合IEEE 754單精度標準的乘法、乘累加及除法運算器電路。乘法器采用改進型Booth編碼電路以減少部分積數(shù)量,用Wallace對部分積進行壓縮;乘累加器采用multiply-add fused算法,對關(guān)鍵路徑進行了優(yōu)化;除法器為基于改進型泰勒級數(shù)展開的查找表結(jié)構(gòu)實現(xiàn),查找表尺寸只有208字節(jié),電路為固定時延,在電路尺寸、延時及復雜度方面進行了較好的平衡。

    標簽: FPGA 映射 算法研究

    上傳時間: 2013-04-24

    上傳用戶:yxvideo

  • H.264編碼器幀內(nèi)預測算法的研究

    目前,H.264是圖像編碼研究領(lǐng)域的一個熱點。它在語言結(jié)構(gòu)、預測算法、數(shù)據(jù)變換等方面做了很大的改進,在低碼率傳輸、高清晰度顯示及網(wǎng)絡接入等性能上相比以往標準有了顯著提高,使得H.264在視頻會議、視頻點播、數(shù)字電視和手...

    標簽: 264 編碼器 幀內(nèi)預測 法的研究

    上傳時間: 2013-05-27

    上傳用戶:jjj0202

  • MUSIC算法的FPGA實現(xiàn)

    在軍事通信和民用通信的許多場合,都需要估計無線電信號的方向(DOA)。信號子空間方法是陣列測向方法中非常重要的一類。1979年Schmidt提出的 MUSIC算法是信號子空間方法的基礎(chǔ),具有高精度和高分辨的性能。但是由于算法的...

    標簽: MUSIC FPGA 算法

    上傳時間: 2013-07-17

    上傳用戶:王慶才

  • 經(jīng)典算法大全

    c語言經(jīng)典算法大全,讓您通過實例感受到編程的美妙境界

    標簽: 算法

    上傳時間: 2013-07-30

    上傳用戶:熊少鋒

  • 51單片機增量式PID控制算法

    當執(zhí)行機構(gòu)需要的不是控制量的絕對值,而是控制量的增量(例如去驅(qū)動 步進電動機)時,需要用PID的“增量算法”。 增量式PID控制算法可以通過(2-4)式推導出。

    標簽: PID 51單片機 增量式 控制算法

    上傳時間: 2013-04-24

    上傳用戶:haoxiyizhong

  • 一種求解單件車間調(diào)度問題的單親遺傳算法

    針對單件車間調(diào)度問題,設計一種基于整數(shù)編碼的單親遺傳算法。該算法既具有單親遺傳算法運算量小、不存在“早熟收斂”現(xiàn)象等優(yōu)點,在編碼中又體現(xiàn)了單件車間調(diào)度的“保序性”等工藝約束條件,增強了調(diào)度算法的整體性

    標簽: 車間調(diào)度 單親遺傳算法

    上傳時間: 2013-04-24

    上傳用戶:笨小孩

  • 可布性驅(qū)動的層次式FPGA布局算法研究

    在超深亞微米技術(shù)工藝下,布局成為超大規(guī)模集成電路物理設計中至關(guān)重要的一步。由于現(xiàn)場可編程門陣列(Field Programable Gate Array,F(xiàn)PGA)布線資源的預先確定性,使得FPGA的布局更為重要。本文以建立高性能、低擁擠的布局為目標,從FPGA芯片結(jié)構(gòu)和布局算法兩方面進行了深入研究。論文提出了一種通用的層次式FPGA(HFPGA)結(jié)構(gòu)模型及布局模型,并且給出了該模型的數(shù)學計算公式;提出將元件之間的層次距離轉(zhuǎn)化為線長的方法,實現(xiàn)了基于線網(wǎng)模型的高精度布局算法:提出利用矩形的對角線元件之間層次來代替線長,從而達到優(yōu)化線長的同時提高布通率的快速布局算法。實驗結(jié)果表明,兩種算法均在北卡羅來納微電子中心(MCNC)學術(shù)芯片測試案例上取得了較理想的布局實驗效果,為下一步的布線工作建立了良好的基礎(chǔ)接口,并且完成了初始布線的工作。本FPGA結(jié)構(gòu)模型的提出和布局算法的實現(xiàn)也都為工業(yè)界提供了借鑒價值。

    標簽: FPGA 驅(qū)動 布局 算法研究

    上傳時間: 2013-04-24

    上傳用戶:nbdedu

  • 全數(shù)字OQPSK解調(diào)算法的研究及FPGA實現(xiàn)

    隨著各種通信系統(tǒng)數(shù)量的日益增多,為了充分地利用有限的頻譜資源,高頻譜利用率的調(diào)制技術(shù)不斷被應用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡調(diào)制技術(shù),具有較高的頻譜利用率和功率利用率,廣泛應用于衛(wèi)星通信系統(tǒng)和地面移動通信系統(tǒng)。因此,對于OQPSK全數(shù)字解調(diào)技術(shù)的研究具有一定的理論價值。 本文以軟件無線電和全數(shù)字解調(diào)的相關(guān)理論為指導,成功設計并實現(xiàn)了基于FPGA的OQPSK全數(shù)字解調(diào)。論文介紹了OQPSK全數(shù)字接收解調(diào)原理和基于軟件無線電設計思想的全數(shù)字接收機的基本結(jié)構(gòu),詳細闡述了當今OQPSK數(shù)字解調(diào)中載波頻率同步、載波相位同步、時鐘同步和數(shù)據(jù)幀同步的一些常用算法,并選擇了相應算法構(gòu)建了三種系統(tǒng)級的實現(xiàn)方案。通過MATLAB對解調(diào)方案的仿真和性能分析,確定了FPGA中的系統(tǒng)實現(xiàn)方案。在此基礎(chǔ)上,本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發(fā)平臺上設計了同步解調(diào)系統(tǒng)中的各個模塊,還對各模塊和整個系統(tǒng)在ModelSim中進行了時序仿真驗證,并對設計中出現(xiàn)的問題進行了修正。最后,經(jīng)過FPGA調(diào)試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實際測試,本文對系統(tǒng)方案進行了最終的改進與調(diào)整。 實際測試結(jié)果表明,本文的設計最終能夠達到了預期的指標和要求。本課題設計經(jīng)過時序和資源優(yōu)化后還可以向ASIC和系統(tǒng)級SOC轉(zhuǎn)化,以進一步縮小系統(tǒng)體積、降低成本和提高電路的可靠性,因此具有良好的實際應用價值。

    標簽: OQPSK FPGA 全數(shù)字 解調(diào)

    上傳時間: 2013-07-14

    上傳用戶:aappkkee

  • GPS中頻信號捕獲算法及其采樣器實現(xiàn)

    基于FPGA的GPS中頻信號捕獲算法及其采樣器實現(xiàn)

    標簽: GPS 中頻信號 捕獲算法 采樣

    上傳時間: 2013-07-02

    上傳用戶:WsyzxxnSej

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