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24位

  • 采用低功耗精密24位Σ-Δ型ADC的全集成式熱電偶測量系統(tǒng)

    是一個集成的熱電偶測量系統(tǒng),基于AD7124-4/AD7124-8低功耗、低噪聲、24位-型模數(shù)轉(zhuǎn)換器(ADC),針對高精度測量應(yīng)用而優(yōu)化。使用該系統(tǒng)的熱電偶測量在?50°C至+200°C的測量溫度范圍內(nèi)具有±1°C的整體系統(tǒng)精度。系統(tǒng)的典型無噪聲碼分辨率約為15位。AD7124-4可配置為4個差分或7個偽差分輸入通道,而AD7124-8可配置為8個差分或15個偽差分輸入通道。片內(nèi)低噪聲可編程增益陣列(PGA)確保ADC中可直接輸入小信號。

    標(biāo)簽: adc

    上傳時間: 2022-05-25

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  • 24位ADC驅(qū)動代碼

    ADS1256 是TI(Texas I nstruments )公司推出的一款低噪聲高分辨率的24 位Si gma - Delta("- #)模數(shù)轉(zhuǎn)換器(ADC)。"- #ADC 與傳統(tǒng)的逐次逼近型和積分型ADC 相比有轉(zhuǎn)換誤差小而價格低廉的優(yōu)點(diǎn),但由于受帶寬和有效采樣率的限制,"- #ADC 不適用于高頻數(shù)據(jù)采集的場合。該款A(yù)DS1256 可適合于采集最高頻率只有幾千赫茲的模擬數(shù)據(jù)的系統(tǒng)中,數(shù)據(jù)輸出速率最高可為30K 采樣點(diǎn)/秒(SPS),有完善的自校正和系統(tǒng)校正系統(tǒng), SPI 串行數(shù)據(jù)傳輸接口。本文結(jié)合筆者自己的應(yīng)用經(jīng)驗(yàn),對該ADC 的基本原理以及應(yīng)用做簡要介紹。ADs1256 的總體電氣特性下面介紹在使用ADs1256 的過程中要注意的一些電氣方面的具體參數(shù):模擬電源(AVDD )輸入范圍+ 4 . 75V !+ 5 .25V,使用的典型值為+ 5 .00V;數(shù)字電源(DVDD )輸入范圍+ 1 . 8V !+ 3 .6V,使用的典型值+ 3 .3V;參考電壓值(VREF= VREFP- VREFN)的范圍+ 0 .5V!+ 2 .6V,使用的典型值為+ 2 .5V;耗散功率最大為57mW;每個模擬輸入端(AI N0 !7 和AI NC M)相對于模擬地(AGND)的絕對電壓值范圍在輸入緩沖器(BUFFER)關(guān)閉的時候?yàn)锳GND-0 .1 !AVDD+ 0 . 1 ,在輸入緩沖器打開的時候?yàn)锳GND !AVDD-2 .0 ;滿刻度差分模擬輸入電壓值(VI N = AI NP -AI NN)為+ /-(2VREF/PGA);數(shù)字輸入邏輯高電平范圍0 .8DVDD!5 .25V(除D0 !D3 的輸入點(diǎn)平不可超過DVDD 外),邏輯低點(diǎn)平范圍DGND!0 .2DVDD;數(shù)字輸出邏輯高電平下限為0 .8DVDD,邏輯低電平上限為0 .2DVDD,輸出電流典型值為5mA;主時鐘頻率由外部晶體振蕩器提供給XTAL1和XTAL2 時,要求范圍為2 M!10 MHz ,僅由CLKI N 輸入提供時,范圍為0 .1 M!10 MHz 。

    標(biāo)簽: ADC ADS1256

    上傳時間: 2022-06-10

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  • ADS1256中文資料 24位AD模塊高精度ADC采集卡說明書

    ADS1256 24位ADC AD模塊  高精度ADC 采集卡說明書

    標(biāo)簽: ads1256 ADC

    上傳時間: 2022-06-17

    上傳用戶:1208020161

  • (原創(chuàng))宏康24位sigma-delta ADC HY3102芯片的C驅(qū)動程序

    臺系宏康HY3102 24位sigma-delta ADC芯片,SPI接口。本人寫的主控HY16F198 C驅(qū)動程序,經(jīng)過測試驗(yàn)證可用。程序及注釋完整,有需要的可以下載參考。

    標(biāo)簽: ADC sigma-delta hy3102 驅(qū)動

    上傳時間: 2022-06-22

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  • 基于FPGA的快速路由查找算法研究及實(shí)現(xiàn).rar

    現(xiàn)代通信朝著全網(wǎng)IP化的進(jìn)程逐步發(fā)展,越來越多的通信需要IP路由查找;同時光纖技術(shù)的發(fā)展,使得比特速率達(dá)到了20Gbps,路由技術(shù)成了整個通信系統(tǒng)的瓶頸,迫切需要一種具有高查找性能,低成本的路由算法,能夠適應(yīng)大規(guī)模應(yīng)用。 本文研究了一種高性能、低成本的路由算法。在四分支并行路由查找算法的基礎(chǔ)上,實(shí)現(xiàn)了雙分支并行,每個分支流水查找的16-8-8路由算法。該算法由三級表構(gòu)成,長度小于16的前綴通過擴(kuò)展成為長度16的前綴存儲在第一級表中;長度小于24位的前綴通過擴(kuò)展成為長度24的前綴存儲在前兩級表中;長度大于24的前綴則通過專門的存儲空間進(jìn)行存儲。將IP路由的二維查找轉(zhuǎn)化為一維精確查找,每次查找最多訪問存儲器3次,就可以查得下一跳的路由信息。使用Verilog語言實(shí)現(xiàn)了本文提出的算法,并對算法進(jìn)行了功能仿真。為了實(shí)現(xiàn)低成本,該算法采用了FPGA和SSRAM的硬件結(jié)構(gòu)實(shí)現(xiàn)。 功能仿真表明本文設(shè)計(jì)的算法查找速度能適應(yīng)20Gbps的接口轉(zhuǎn)發(fā)速率。

    標(biāo)簽: FPGA 路由 查找算法

    上傳時間: 2013-04-24

    上傳用戶:金宜

  • 基于FPGA的全彩色LED同步顯示屏控制系統(tǒng)的設(shè)計(jì).rar

    LED顯示屏作為一項(xiàng)高新科技產(chǎn)品正引起人們的高度重視,它以其動態(tài)范圍廣,亮度高,壽命長,工作性能穩(wěn)定而日漸成為顯示媒體中的佼佼者,現(xiàn)已廣泛應(yīng)用于廣告、證券、交通、信息發(fā)布等各方面,且隨著全彩屏顯示技術(shù)的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統(tǒng),提出了一個系統(tǒng)實(shí)現(xiàn)方案,整個系統(tǒng)分三部分組成:DVI解碼電路、發(fā)送系統(tǒng)以及接收系統(tǒng)。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數(shù)據(jù),經(jīng)過T.D.M.S.解碼恢復(fù)出可供LED屏顯示的紅、綠、藍(lán)共24位像素?cái)?shù)據(jù)和一些控制信號。發(fā)送系統(tǒng)用于將收到的數(shù)據(jù)流進(jìn)行緩存,經(jīng)處理后發(fā)送至以太網(wǎng)芯片進(jìn)行以太網(wǎng)傳輸。接收系統(tǒng)接收以太網(wǎng)上傳來的視頻數(shù)據(jù)流,經(jīng)過位分離操作后存入SRAM進(jìn)行緩存,再串行輸入至LED顯示屏進(jìn)行掃描顯示。然后,從多方面論述了該方案的可行性,仔細(xì)推導(dǎo)了LED顯示屏各技術(shù)參數(shù)之間的聯(lián)系及約束關(guān)系。 本課題采用可編程邏輯器件來完成系統(tǒng)功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點(diǎn),不僅可以滿足高速圖像數(shù)據(jù)處理對速度的要求,而且增加了設(shè)計(jì)的靈活性,不需修改電路硬件設(shè)計(jì),縮短了設(shè)計(jì)周期,還可以進(jìn)行在線升級。

    標(biāo)簽: FPGA LED 全彩色

    上傳時間: 2013-04-24

    上傳用戶:西伯利亞

  • 基于FPGA的OFDM調(diào)制解調(diào)器的設(shè)計(jì)與實(shí)現(xiàn)

    正交頻分復(fù)用(OFDM)技術(shù)是一種多載波數(shù)字調(diào)制技術(shù),具有頻譜利用率高、抗多徑干擾能力強(qiáng)、成本低等特點(diǎn),適合無線通信的高速化、寬帶化及移動化的需求,將成為下一代無線通信系統(tǒng)(4G)的核心調(diào)制傳輸技術(shù)。 本文首先描述了OFDM技術(shù)的基本原理。對OFDM的調(diào)制解調(diào)以及其中涉及的特性和關(guān)鍵技術(shù)等做了理論上的分析,指出了OFDM區(qū)別于其他調(diào)制技術(shù)的巨大優(yōu)勢;然后針對OFDM中的信道估計(jì)技術(shù),深入分析了基于FFT級聯(lián)的信道估計(jì)理論和基于聯(lián)合最大似然函數(shù)的半盲分組估計(jì)理論,在此基礎(chǔ)上詳細(xì)研究描述了用于OFDM系統(tǒng)的迭代的最大似然估計(jì)算法,并利用Matlab做了相應(yīng)的仿真比較,驗(yàn)證了它們的有效性。 而后,在Matlab中應(yīng)用Simulink工具構(gòu)建OFDM系統(tǒng)仿真平臺。在此平臺上,對OFDM系統(tǒng)在多徑衰落、高斯白噪聲等多種不同的模型參數(shù)下進(jìn)行了仿真,并給出了數(shù)據(jù)曲線,通過分析結(jié)果可正確評價OFDM系統(tǒng)在多個方面的性能。 在綜合了OFDM的系統(tǒng)架構(gòu)和仿真分析之后,設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的OFDM調(diào)制解調(diào)系統(tǒng)。首先根據(jù)802.16協(xié)議和OFDM系統(tǒng)的具體要求,設(shè)定了合理的參數(shù);然后從調(diào)制器和解調(diào)器的具體組成模塊入手,對串/并轉(zhuǎn)換,QPSK映射,過采樣處理,插入導(dǎo)頻,添加循環(huán)前綴,IFFT/FFT,幀同步檢測等各個模塊進(jìn)行硬件設(shè)計(jì),詳細(xì)介紹了各個模塊的設(shè)計(jì)和實(shí)現(xiàn)過程,并給出了相應(yīng)的仿真波形和參數(shù)說明。其中,針對定點(diǎn)運(yùn)算的局限性,為系統(tǒng)設(shè)計(jì)并自定義了24位的浮點(diǎn)運(yùn)算格式,參與傅立葉反變換和傅立葉變換的運(yùn)算,在系統(tǒng)參數(shù)允許的范圍內(nèi),充分利用了有限資源,提高了系統(tǒng)運(yùn)算精度;然后重點(diǎn)描述了基于FPGA的快速傅立葉變換算法的改進(jìn)、優(yōu)化和設(shè)計(jì)實(shí)現(xiàn),針對原始快速傅立葉變換FPGA實(shí)現(xiàn)算法運(yùn)算空閑時間過多,資源占用較大的問題,提出了帶有流水作業(yè)功能、資源占用較少的快速傅立葉變換優(yōu)化算法設(shè)計(jì)方案,使之運(yùn)用于OFDM基帶處理系統(tǒng)當(dāng)中并加以實(shí)現(xiàn),結(jié)果滿足系統(tǒng)參數(shù)的需求。最后以理論分析為依據(jù),對整個OFDM的基帶處理系統(tǒng)進(jìn)行了系統(tǒng)調(diào)試與性能分析,證明了設(shè)計(jì)的可行性。 綜上所述,本文完成了一個基于FPGA的OFDM基帶處理系統(tǒng)的設(shè)計(jì)、仿真和實(shí)現(xiàn)。本設(shè)計(jì)為OFDM通信系統(tǒng)的進(jìn)一步改進(jìn)提供了大量有用的數(shù)據(jù)。

    標(biāo)簽: FPGA OFDM 調(diào)制解調(diào)器

    上傳時間: 2013-04-24

    上傳用戶:vaidya1bond007b1

  • 介紹了各種數(shù)字圖像處理的算法分析及編程實(shí)現(xiàn)技術(shù)。全書由12章和一個附錄組成。主要內(nèi)容包括:位圖基礎(chǔ)、圖像的顯示、圖像的幾何變換、圖像灰度變換、圖像的平滑處理、圖像銳化處理及邊緣檢測、圖像分割及測量、圖

    介紹了各種數(shù)字圖像處理的算法分析及編程實(shí)現(xiàn)技術(shù)。全書由12章和一個附錄組成。主要內(nèi)容包括:位圖基礎(chǔ)、圖像的顯示、圖像的幾何變換、圖像灰度變換、圖像的平滑處理、圖像銳化處理及邊緣檢測、圖像分割及測量、圖像的形態(tài)學(xué)處理、圖像的變換域處理及應(yīng)用、圖像的合成、24位彩色圖像的處理、JPEG圖像的壓縮編碼。

    標(biāo)簽: 圖像 數(shù)字圖像處理 實(shí)現(xiàn)技術(shù) 位圖

    上傳時間: 2014-12-08

    上傳用戶:comua

  • TI德州儀器高性能模擬數(shù)字混合處理器msc1211的程序

    TI德州儀器高性能模擬數(shù)字混合處理器msc1211的程序,主要側(cè)重于其內(nèi)部高精度24位ad以及串口通信,這個是我做的一個項(xiàng)目上用的

    標(biāo)簽: 1211 msc 德州儀器 高性能模擬

    上傳時間: 2015-09-23

    上傳用戶:leixinzhuo

  • UCGUI字庫文件:包括12位

    UCGUI字庫文件:包括12位,16位,24位點(diǎn)陣字庫

    標(biāo)簽: UCGUI 庫文件

    上傳時間: 2016-08-14

    上傳用戶:whenfly

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