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  • Allegro_SPB_16-3速成教材

    Allegro_SPB_16-3速成教材

    標(biāo)簽: Allegro_SPB 16 教材

    上傳時間: 2013-06-28

    上傳用戶:1417818867

  • Allegro.16.3.官方教程

    Allegro.16.3.官方教程

    標(biāo)簽: Allegro 16 教程

    上傳時間: 2013-06-28

    上傳用戶:魚魚魚yu

  • CCS3.3簡易教程

    CCS3.3簡易教程

    標(biāo)簽: CCS 3.3 教程

    上傳時間: 2013-07-08

    上傳用戶:athjac

  • Cadence Allegro SPB 16.3下載加破解方法和破解程序

    之前的內(nèi)容有點(diǎn)問題,2013.6.26重新修改了一下,軟件1.74GB,另有破解程序,licence,教程包,4.9MB 下面破解步驟,參考一下: Cadence SPB 16.3的破解, 安裝步驟: 1.關(guān)閉殺毒軟件啊 2.運(yùn)動setup.exe然后點(diǎn)擊“License Manager”,安裝過程中詢問license file時,選擇取消。結(jié)束安裝。 3.拷貝 cdslmd.exe到\"C:\\Cadence\\LicenseManager\\\"(安裝目錄),替代原文件。 4.復(fù)制license163.lic到安裝目錄 5.打開license163.lic,編輯第1行,將this_host修改為電腦名稱(電腦名稱不能為中文及注意英文大小寫) 6.運(yùn)行LicenseServerConfiguration.exe 7.選取license163.lic 8.端口填寫5280(此步一般不需要做) 9.編輯window主計(jì)算機(jī)名,檢查hostname是否正確。可使用LMTOOLS查看(此步一般不需要做) 10.安裝Cadence SPB/orCAD 選取默認(rèn)值 11.拷貝orcad_163.exe到C:\\Cadence\\安裝目錄, 12.運(yùn)行orcad_163.exe破解補(bǔ)丁 13.OK

    標(biāo)簽: Cadence Allegro 16.3 SPB

    上傳時間: 2013-07-23

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  • cpld max7128s控制3路AD7472采樣

    cpld max7128s控制3路AD7472采樣,希望對大家有幫助。

    標(biāo)簽: 7128s cpld 7128 7472

    上傳時間: 2013-08-22

    上傳用戶:hn891122

  • FPGA-CPLD_DesignTool,事例程序3-4

    FPGA-CPLD_DesignTool,事例程序3-4陸續(xù)上傳請需要的朋友下載

    標(biāo)簽: FPGA-CPLD_DesignTool 程序

    上傳時間: 2013-08-31

    上傳用戶:xingyuewubian

  • pcb 設(shè)計(jì)工具 altium designer6.3新功能教程

    pcb 設(shè)計(jì)工具 altium designer6.3新功能教程,

    標(biāo)簽: designer altium pcb 6.3

    上傳時間: 2013-09-13

    上傳用戶:wang0123456789

  • allegro16.3教程

    allegro16.3教程1

    標(biāo)簽: allegro 16.3 教程

    上傳時間: 2013-11-16

    上傳用戶:urgdil

  • PADS9.3完整破解版和CadenceAllegro16.5完整破解版親測win7安裝下載地址

    請注意軟件勿用于商業(yè)用途,否則后果自負(fù)!請不要做拿手黨,好用大家享!頂起吧!解壓不成功時請把你們解壓軟件升級到最新版本! 附件也有本人學(xué)習(xí)PADS9.3、CadenceAllegro16.5、orcad軟件以及教程一塊上傳,下載時最好不要用第三方軟件,直接保存就可以了。 PADS9.3安裝說明(兼容win7、xp): 1.參考“PADS9.3圖文安裝方法(WIN7_XP)”完成軟件安裝。 2.參考“PADS9.3”完成破解!破解需要dos環(huán)境下完成,具體操作步驟教程有。 3.安裝目錄和源文件都不能是中文目錄 CadenceAllegro16.5(兼容win7、xp)兩個文件下載完成才能解壓,: 1.參考“真正的cadence_16.5_破解方法”按照操作步驟即可。 2.安裝目錄和源文件都不能是中文目錄 注意!!! 如果破解不成功有可能破解文件壞掉了,請把“Cadence_Allegro16.5crack-修正破解方法”文件解壓,用里面破解文件重新破解一遍!

    標(biāo)簽: CadenceAllegro PADS 16.5 win7

    上傳時間: 2013-12-22

    上傳用戶:butterfly2013

  • IBIS模型第3部分-利用IBIS模型研究信號完整性問題

    本文是關(guān)于在印刷電路板 (PCB) 開發(fā)階段使用數(shù)字輸入/輸出緩沖信息規(guī)范(IBIS) 模擬模型的系列文章之第 3 部分(共三部分)。“第 1 部分”討論了 IBIS仿真模型的基本組成,以及它們在 SPICE 環(huán)境中產(chǎn)生的過程1。“第 2 部分”討論了 IBIS 模型有效性驗(yàn)證。2 在設(shè)計(jì)階段,我們會碰到許多信號完整性問題,而 IBIS 模型為這些問題帶來了一種簡單的解決方案。本文即“第 3 部分”,將介紹如何使用一個 IBIS 模型來提取一些重要的變量,用于信號完整性計(jì)算和確定 PCB 設(shè)計(jì)解決方案。請注意,該提取值是 IBIS 模型不可或缺的組成部分。

    標(biāo)簽: IBIS 模型 信號完整性

    上傳時間: 2013-10-15

    上傳用戶:hehuaiyu

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