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ALtera-FPGA

  • 七天玩轉Altera:學習FPGA必經之路

             七天玩轉Altera:學習FPGA必經之路包括基礎篇、時序篇和驗證篇三個部分。

    標簽: Altera FPGA

    上傳時間: 2013-10-11

    上傳用戶:woshinimiaoye

  • Altera公司 Stratix V GX FPGA開發板電路圖

        本資料是關于Altera公司 Stratix V GX FPGA開發板電路圖的資料。資料包括開發板原理圖、PCB圖。

    標簽: Stratix Altera FPGA GX

    上傳時間: 2014-01-22

    上傳用戶:18707733937

  • ETL-002 Altera Cyclone III系列FPGA開發板簡介

    ETL-002 FPGA開發板是以Altera公司的最新系列Cyclone III中的3C10為主芯片,并提供了極為豐富的芯片外圍接口資源以及下載線,數據線以及資料光盤等。除了這些硬件外,我們還提供了十多個接口實驗,并公開了電路原理圖和實驗的Verilog源代碼,以便于大家對照學習,并可以在該開發板上進行二次開發。

    標簽: Cyclone Altera FPGA ETL

    上傳時間: 2013-10-29

    上傳用戶:1477849018@qq.com

  • FPGA實現的直接數字頻率合成器

    FPGA實現的直接數字頻率合成器,本文基于DDS的基本原理,利用Altera公司的FPGA芯片FLEX10系列器件完成了一個DDS系統的設計。

    標簽: FPGA 數字頻率合成器

    上傳時間: 2013-08-06

    上傳用戶:wangzhen1990

  • 用FPGA實現的8點32 位FFT 處理器方案

    :文章針對目前數字信號處理中大量采用的快速傅立葉變換[FFT] 算法采用軟件編程來處理的應用現狀,在對FFT 算法進行\\\\\\\\r\\\\\\\\n分析的基礎上,給出了用FPGA[Field Programmable Gate Array] 實現的8 點32 位FFT 處理器方案,并得到了系統的仿真結果。\\\\\\\\r\\\\\\\\n最后在Altera 公司FLEX10K系列FPGA 芯片上成功地實現了綜合。

    標簽: FPGA FFT 處理器 方案

    上傳時間: 2013-08-09

    上傳用戶:yangzhiwei

  • FPGA開發板的原理圖很詳細的

    FPGA開發板的原理圖很詳細的,主要是ALTERA公司的CYCLONE,用protel畫的,

    標簽: FPGA 開發板 原理圖

    上傳時間: 2013-08-10

    上傳用戶:atdawn

  • FPGA開發板

    FPGA開發板,提供ALTERA公司多款FPGA的開發板。

    標簽: FPGA 開發板

    上傳時間: 2013-08-12

    上傳用戶:chenhr

  • 高級FPGA教學實驗指導書-邏輯設計部分

    高級FPGA教學實驗指導書-邏輯設計部分.pdf QuatusII5.0 是Altera 公司的最新產品。MaxplusII 是一套非常成功的PLD 開發軟件,雖然QuartusII 已經推出了4 年,并且Altera 宣布不再對MaxplusII 進行升級,但至今仍有非常多的工程師在使用MaxplusII。 Altera 在QuartusII 中允許將軟件界面設置為MaxplusII 風格,以吸引MaxplusII 的用戶轉向QuartusII。

    標簽: FPGA 教學實驗 指導書

    上傳時間: 2013-08-17

    上傳用戶:life840315

  • 16QAM接收機解調芯片的FPGA實現

    描述了一個用于微波傳輸設備的16QAM接收機解調芯片的FPGA實現,芯片集成了定時恢復、載波恢復和自適應盲判決反饋均衡器(DFE),采用恒模算法(CMA)作為均衡算法。芯片支持高達25M波特的符號速率,在一片EP1C12Q240C8(ALTERA)上實現,即將用于量產的微波傳輸設備中。\\r\\n

    標簽: FPGA QAM 16 接收機

    上傳時間: 2013-08-22

    上傳用戶:23333

  • 一種在FPGA上實現的FIR濾波器的資源優化算法

    在數字濾波器中,FIR濾波器是一種結構簡單且總是穩定的濾波器,同時也只有FIR濾波器擁有線性相位的特性。傳統的直接型濾波器運算速度過慢,而改進型的DA結構的濾波器需要過高的芯片面積消耗大量的邏輯資源很難達到運算速度以及邏輯資源節約的整體優化。本文提出了一種基于RAG算法的FIR濾波器,與傳統的基于DA算法的濾波器結構的濾波器相比,RAG算法簡化了FIR濾波器乘法模塊的結構,減少了邏輯資源的消耗和硬件實現面積,提高了計算速度。本文設計的16階FIR濾波器用VerilogHDL進行描述,并綜合到Altera公司的CycloneⅡ系列FPGA中。仿真實驗表明基于RAG算法的FIR濾波器達到了邏輯資源的節約和運算速度的提高的整體優化效果。

    標簽: FPGA FIR 濾波器 優化算法

    上傳時間: 2014-12-28

    上傳用戶:feilinhan

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