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BUILdeR

  • DSP BUILdeR設(shè)計(jì)深入

    該文檔為DSP BUILdeR設(shè)計(jì)深入資料,講解的還不錯(cuò),感興趣的可以下載看看…………………………

    標(biāo)簽: dsp

    上傳時(shí)間: 2021-11-07

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  • 基于DSP BUILdeR的帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)

    該文檔為基于DSP BUILdeR的帶寬自適應(yīng)全數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)總結(jié)文檔,是一份很不錯(cuò)的參考資料,具有較高參考價(jià)值,感興趣的可以下載看看………………

    標(biāo)簽: dsp

    上傳時(shí)間: 2022-05-01

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  • SOPC BUILdeR  0

    SoPC BUILdeR在一個(gè)工具中實(shí)現(xiàn)了嵌入式系統(tǒng)各個(gè)方面的開(kāi)發(fā),包括軟件的設(shè)計(jì)和驗(yàn)證,為充分利用SoPC技術(shù)提高電子系統(tǒng)的性能和降低成本提供了強(qiáng)有力的支持。

    標(biāo)簽: 精品課

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • PLATFORM BUILdeR 5.0/6.00

    Platform BUILdeR 6.0 是以VS2005的插件形式安裝集成的。 Platform BUILdeR正版是需要向微軟或者其代理機(jī)構(gòu)購(gòu)買的,官方只有評(píng)估版本的下載。

    標(biāo)簽: 五金手冊(cè)

    上傳時(shí)間: 2013-06-01

    上傳用戶:eeworm

  • BORLAND C++ BUILdeR 60

    Borland C++ BUILdeR Compiler 是一個(gè)BC 編譯器。它是用來(lái)優(yōu)化BC 開(kāi)發(fā)系統(tǒng)的工具。它包括最后版本的ANSI/ISO C++ 語(yǔ)言的支持,包括RTL,C++ 的STL框架結(jié)構(gòu)支持

    標(biāo)簽: 固件

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • 超級(jí)單片機(jī)工具.rar

    單片機(jī)開(kāi)發(fā)過(guò)程中用到的多功能工具,包括熱敏電阻RT值--HEX數(shù)據(jù)轉(zhuǎn)換;3種LED編碼;色環(huán)電阻計(jì)算器;HEX/BIN 文件互相轉(zhuǎn)換;eeprom數(shù)據(jù)到C/ASM源碼轉(zhuǎn)換;CRC校驗(yàn)生成;串口調(diào)試,帶簡(jiǎn)單而實(shí)用的數(shù)據(jù)分析功能;串口/并口通訊監(jiān)視等功能. 用C++ BUILdeR開(kāi)發(fā),無(wú)須安裝,直接運(yùn)行,不對(duì)注冊(cè)表進(jìn)行操作。純綠色軟件。

    標(biāo)簽: 超級(jí)單片機(jī)

    上傳時(shí)間: 2013-06-19

    上傳用戶:6546544

  • STATCOM控制系統(tǒng)研究.rar

    隨著我國(guó)工業(yè)化進(jìn)程加快,各種電力負(fù)荷迅速增加,造成了電網(wǎng)無(wú)功功率消耗增加,使電能的傳輸和利用效率降低,電能質(zhì)量中的無(wú)功功率補(bǔ)償問(wèn)題變得越來(lái)越重要。靜止無(wú)功發(fā)生器(STATCOM)作為柔性交流輸電系統(tǒng)的重要裝置之一,是無(wú)功功率補(bǔ)償發(fā)展的趨勢(shì)。 論文首先介紹并比較了現(xiàn)有的無(wú)功補(bǔ)償裝置,分析了STATCOM相對(duì)于其他無(wú)功補(bǔ)償裝置的優(yōu)越性。總結(jié)了STATCOM的間接電流控制和直接電流控制兩種控制方式,并對(duì)兩種控制方式所衍生的幾種控制結(jié)構(gòu)進(jìn)行了介紹,說(shuō)明了其控制原理。 詳細(xì)討論了直接電流控制的幾種控制結(jié)構(gòu),并建立了相應(yīng)的仿真模型,進(jìn)行了仿真和比較分析。研究了它們?cè)诜€(wěn)態(tài)性能和動(dòng)態(tài)性能上的優(yōu)缺點(diǎn)。其中重點(diǎn)討論了采用空間電壓矢量調(diào)制方法(SVPWM)跟蹤給定電壓矢量,來(lái)控制STATCOM的電流產(chǎn)生,并且采用直流側(cè)電壓可變給定。仿真結(jié)果證明此種方法具有直流側(cè)電壓利用率高、降低功率器件的開(kāi)關(guān)損耗、適應(yīng)電網(wǎng)電壓不對(duì)稱的環(huán)境的優(yōu)點(diǎn)。 介紹了基于FPGA和DSP硬件開(kāi)發(fā)平臺(tái)設(shè)計(jì)方法。對(duì)FPGA的控制軟件編程設(shè)計(jì)進(jìn)行了詳細(xì)討論,其中重點(diǎn)討論了應(yīng)用DSP BUILdeR。工具箱實(shí)現(xiàn)全數(shù)字三相鎖相環(huán)和SVPWM控制模塊的方法。

    標(biāo)簽: STATCOM 控制 系統(tǒng)研究

    上傳時(shí)間: 2013-04-24

    上傳用戶:youth25

  • 基于FPGA的嵌入式系統(tǒng)設(shè)計(jì).rar

    隨著電子技術(shù)的不斷發(fā)展和進(jìn)步,嵌入式系統(tǒng)也越來(lái)越廣泛的滲入到人類生活的方方面面。我們生活中常用的手機(jī)、數(shù)碼相機(jī)、掌上電腦、便攜式掃描儀等等都應(yīng)用到了嵌入式系統(tǒng)。 論文首先介紹了嵌入式系統(tǒng),包括嵌入式系統(tǒng)的構(gòu)成、特點(diǎn)、發(fā)展趨勢(shì)以及FPGA在嵌入式中的應(yīng)用等,指明嵌入式系統(tǒng)設(shè)計(jì)一般可分為硬件設(shè)計(jì)和軟件設(shè)計(jì)兩部分。 硬件設(shè)計(jì)部分,首先介紹了FPGA的相關(guān)知識(shí),包括FPGA構(gòu)成、特性、開(kāi)發(fā)工具、開(kāi)發(fā)流程等,并對(duì)論文中選用的Altera公司的CyclonⅡ器件做了詳細(xì)的介紹。利用SOPC BUILdeR、NiosⅡ等工具設(shè)計(jì)創(chuàng)建了NiosⅡ CPU內(nèi)核,添加以太網(wǎng)、Flash、PIO以及VGA接口等模塊,生成了一個(gè)Nios CPU內(nèi)核,完成硬件設(shè)計(jì)。 軟件設(shè)計(jì)部分,研究了嵌入式操作系統(tǒng)的發(fā)展、種類、特點(diǎn)等,簡(jiǎn)單介紹了幾種代表性的嵌入式操作系統(tǒng)。選擇嵌入式操作系統(tǒng)時(shí),綜合考慮了內(nèi)核、可移植性、可裁剪性、外掛模塊、成本、服務(wù)等各種因素,最終選用μCLinux操作系統(tǒng)。詳細(xì)介紹了μCLinux的特點(diǎn)、基本架構(gòu)、代碼結(jié)構(gòu)等。利用NiosⅡIDE為宿主機(jī)建立Linux開(kāi)發(fā)環(huán)境。在IDE里配置Linux內(nèi)核和文件系統(tǒng),編譯后上載到做好的硬件平臺(tái)上。啟動(dòng)μCLinux后將一個(gè)C語(yǔ)言編寫的九宮格求解程序下載到開(kāi)發(fā)板中運(yùn)行,檢驗(yàn)運(yùn)行結(jié)果,驗(yàn)證嵌入式系統(tǒng)的正確性。 論文所做的只是嵌入式系統(tǒng)的一個(gè)應(yīng)用實(shí)例。實(shí)際應(yīng)用過(guò)程中,用戶可以根據(jù)自己的實(shí)際需要對(duì)軟硬件進(jìn)行修改,以實(shí)現(xiàn)不同的功能。

    標(biāo)簽: FPGA 嵌入式系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-07-19

    上傳用戶:zhuoying119

  • 基于FPGA的電壓波動(dòng)與閃變測(cè)量的數(shù)字化實(shí)現(xiàn)研究.rar

    隨著我國(guó)工業(yè)和國(guó)民經(jīng)濟(jì)的快速發(fā)展,電網(wǎng)負(fù)荷急劇增加,特別是沖擊性、非線性負(fù)荷所占比重不斷加大,使得供電電壓發(fā)生波動(dòng)和閃變,嚴(yán)重影響著電網(wǎng)的電能質(zhì)量。根據(jù)國(guó)際電工委員會(huì)(IEC)電磁兼容(EMC)標(biāo)準(zhǔn)IEC61000-3-7以及國(guó)標(biāo)GB12326-2000,電壓波動(dòng)和閃變己成為衡量電能質(zhì)量的重要指標(biāo)。 電壓波動(dòng)和閃變作為衡量電能質(zhì)量的重要指標(biāo),能更直接、迅速地反映出電網(wǎng)的供電質(zhì)量。然而,目前國(guó)內(nèi)還沒(méi)有很好的電壓波動(dòng)與閃變測(cè)量的數(shù)字信號(hào)處理方法。為此,論文在深入研究電壓波動(dòng)和閃變測(cè)量技術(shù)的基礎(chǔ)上,提出一種基于Simulink/DSP BUILdeR的數(shù)字信號(hào)處理的FPGA設(shè)計(jì)方法,利用DSP BUILdeR工具將Simulink的模型文件(.mdl)轉(zhuǎn)化成通用的硬件描述語(yǔ)言VHDL文件,避免了VHDL語(yǔ)言手動(dòng)編寫系統(tǒng)的煩瑣過(guò)程,從而能夠?qū)⒏嗑杏谙到y(tǒng)算法的優(yōu)化上。該方法充分利用Matlab/Simulink系統(tǒng)建模的優(yōu)勢(shì),同時(shí)也能夠發(fā)揮FPGA并行執(zhí)行速度快、測(cè)量精度高的優(yōu)點(diǎn)。 論文首先介紹了電壓波動(dòng)和閃變的基木概念、特征量,闡述了電壓波動(dòng)與閃變的測(cè)量原理,分析比較了現(xiàn)有測(cè)量方法和裝置的特點(diǎn)和優(yōu)劣。然后依據(jù)電壓波動(dòng)與閃變測(cè)量的IEC標(biāo)準(zhǔn)以及國(guó)家標(biāo)準(zhǔn),在對(duì)電壓波動(dòng)與閃變測(cè)量模擬仿真的基礎(chǔ)上研究其數(shù)字化實(shí)現(xiàn)方法,即采用數(shù)字濾波的方式在Simulink/DSP BUILdeR工具下設(shè)計(jì)電壓波動(dòng)與閃變測(cè)量系統(tǒng)的數(shù)字模型。同時(shí)在ModelSim SE6.1d軟件下進(jìn)行了系統(tǒng)功能仿真,并且在Altera公司的FPGA設(shè)計(jì)軟件QuartusⅡ6.0下進(jìn)行了系統(tǒng)時(shí)序仿真。 仿真結(jié)果表明,基于Simulink/DSP BUILdeR窗口化的數(shù)字信號(hào)處理的FPGA設(shè)計(jì)方案,設(shè)計(jì)簡(jiǎn)單、快捷高效,能夠滿足電壓波動(dòng)和閃變測(cè)量最初的系統(tǒng)設(shè)計(jì)要求,為進(jìn)一步從事電壓波動(dòng)和閃變測(cè)量研究提供了一種全新的設(shè)計(jì)理念,具有一定的理論與現(xiàn)實(shí)意義。

    標(biāo)簽: FPGA 電壓波動(dòng) 測(cè)量

    上傳時(shí)間: 2013-07-10

    上傳用戶:笨小孩

  • 基于FPGA的數(shù)字圖像處理的研究.rar

    圖像是人類智能活動(dòng)重要的信息來(lái)源之一,是人類相互交流和認(rèn)識(shí)世界的主要媒體。隨著信息高速公路、數(shù)字地球概念的提出,人們對(duì)圖像處理技術(shù)的需求與日劇增,同時(shí)VLSI技術(shù)的發(fā)展給圖像處理技術(shù)的應(yīng)用提供了廣闊的平臺(tái)。圖像處理技術(shù)是圖像識(shí)別和分析的基礎(chǔ),所以圖像處理技術(shù)對(duì)整個(gè)圖像工程來(lái)說(shuō)就非常重要,對(duì)圖像處理技術(shù)的實(shí)現(xiàn)的研究也就具有重要的理論意義與實(shí)用價(jià)值,包括對(duì)傳統(tǒng)算法的改進(jìn)和硬件實(shí)現(xiàn)的研究。仿生算法的興起為圖像處理問(wèn)題的解決提供了一條十分有效的新途徑;FPGA技術(shù)的發(fā)展為圖像處理的硬件實(shí)現(xiàn)提供了有效的平臺(tái)。 @@ 本文在詳細(xì)介紹鄰域圖像處理算法及其數(shù)據(jù)結(jié)構(gòu)、遺傳算法和蟻群算法基本原理的基礎(chǔ)上,將其應(yīng)用于圖像增強(qiáng)和圖像分割的圖像處理問(wèn)題之中,并將其用FPGA技術(shù)實(shí)現(xiàn)。論文中采用遺傳算法自適應(yīng)的確定非線性變換函數(shù)的參數(shù)對(duì)圖像進(jìn)行增強(qiáng),在采用FPGA來(lái)實(shí)現(xiàn)的過(guò)程中先對(duì)系統(tǒng)進(jìn)行模塊劃分,主要分為初始化模塊、選擇模塊、適應(yīng)度模塊、控制模塊等,然后利用VHDL語(yǔ)言描述各個(gè)功能模塊,為了提高設(shè)計(jì)效率,利用IP核進(jìn)行存儲(chǔ)器設(shè)計(jì),利用DSP BUILdeR進(jìn)行數(shù)學(xué)運(yùn)算處理。時(shí)序控制是整個(gè)系統(tǒng)設(shè)計(jì)的核心,為盡量避免毛刺現(xiàn)象,各模塊的時(shí)序控制都是采用單進(jìn)程的Moore狀態(tài)機(jī)實(shí)現(xiàn)的。在圖像分割環(huán)節(jié)中,圖像分割問(wèn)題轉(zhuǎn)換為求圖像的最大熵問(wèn)題,采用蟻群算法對(duì)改進(jìn)的最大熵確定的適應(yīng)度函數(shù)進(jìn)行優(yōu)化,并對(duì)基于FPGA和蟻群算法實(shí)現(xiàn)圖像分割的各個(gè)模塊設(shè)計(jì)進(jìn)行了詳細(xì)介紹。 @@ 對(duì)實(shí)驗(yàn)結(jié)果進(jìn)行分析表明遺傳算法和蟻群算法在數(shù)字圖像處理中的使用明顯改善了處理的效果,在利用FPGA實(shí)現(xiàn)遺傳算法和蟻群算法的整個(gè)設(shè)計(jì)過(guò)程中由于充分發(fā)揮了FPGA的并行計(jì)算能力及流水線技術(shù)的應(yīng)用,大大提高算法的運(yùn)行速度。 @@關(guān)鍵詞:圖像處理;遺傳算法;蟻群算法;FPGA

    標(biāo)簽: FPGA 數(shù)字圖像處理

    上傳時(shí)間: 2013-06-03

    上傳用戶:小火車?yán)怖怖?/p>

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