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Base-v

3-V TO 5.5-V MULTICHANNEL RS-2

The MAX3243E device consists of three line drivers, five line receivers, and a dual charge-pump circuit with±15-kV ESD (HBM and IEC61000-4-2, Air-Gap Discharge) and ±8-kV ESD (IEC61000-4-2, Contact Discharge)protection on serial-port connection pins. The device meets the requirements of TIA/EIA-232-F and provides theelectrical interface between an asynchronous communication controller and the serial-port connector. Thiscombination of drivers and receivers matches that needed for the typical serial port used in an IBM PC/AT, orcompatible. The charge pump and four small external capacitors allow operation from a single 3-V to 5.5-Vsupply. In addition, the device includes an always-active noninverting output (ROUT2B), which allowsapplications using the ring indicator to transmit data while the device is powered down. The device operates atdata signaling rates up to 250 kbit/s and a maximum of 30-V/ms driver output slew rate.

標簽： MULTICHANNEL 5.5 TO RS

上傳時間： 2013-10-19

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SPMC75F2413A在三相交流感應電機的開環(huán)V/F控制的

SPMC75F2413A在三相交流感應電機的開環(huán)V/F控制的應用:系統(tǒng)輸入電源電壓為AC110V/AC220V，經(jīng)全波整流后供系統(tǒng)使用。系統(tǒng)使用Sunplus公司的SPMC75F2413A產(chǎn)生AC三相異步電機的VVVF控制所需的SPWM信號,并完成系統(tǒng)控制。使用三菱公司的智能功率模塊PS21865實現(xiàn)電機的功率驅動。在AC220V輸入時，系統(tǒng)最大能驅動1.5KW的負載。系統(tǒng)的變頻區(qū)間為2Hz~200Hz。

標簽： 2413A F2413 SPMC 2413

上傳時間： 2013-11-06

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Cyclone V FPGA：采用低功耗28nm FPGA減少總系統(tǒng)成本

本文主要介紹Cyclone V FPGA的一個很明顯的特性，也可以說是一個很大的優(yōu)勢，即：采用低功耗28nm FPGA減少總系統(tǒng)成本

標簽： FPGA Cyclone 28 nm

上傳時間： 2013-10-26

上傳用戶：huxiao341000
Arria V系列 FPGA芯片白皮書（英文）

　　Arria V系列 FPGA芯片基本描述　　（1）28nm FPGA，在成本、功耗和性能上達到均衡；　　（2）包括低功耗6G和10G串行收發(fā)器；　　（3）總功耗比6G Arria II FPGA低40%；　　（4）豐富的硬核IP模塊，提高了集成度　　（5）目前市場上支持10.3125Gbps收發(fā)器技術、功耗最低的中端FPGA。

標簽： Arria FPGA V系列芯片

上傳時間： 2013-10-26

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基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現(xiàn)

本文是基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現(xiàn)（英文資料）

標簽： DSP Cyclone Arria 精度可調

上傳時間： 2014-12-28

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Altera公司 Cyclone V 28nm FPGA功耗優(yōu)勢

Cyclone V FPGA功耗優(yōu)勢：采用低功耗28nm FPGA活的最低系統(tǒng)功耗（英文資料）

標簽： Cyclone Altera FPGA 28

上傳時間： 2013-11-23

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Stratix V FPGA 28 nm創(chuàng)新技術超越摩爾定律

　　本白皮書介紹 Stratix V FPGA 是怎樣幫助用戶提高帶寬同時保持其成本和功耗預算不變。在工藝方法基礎上，Altera 利用 FPGA 創(chuàng)新技術超越了摩爾定律，滿足更大的帶寬要求，以及成本和功耗預算。Altera Stratix ® V FPGA 通過 28-Gbps 高功效收發(fā)器突破了帶寬限制，支持用戶使用嵌入式 HardCopy ®模塊將更多的設計集成到單片F(xiàn)PGA中，部分重新配置功能還提高了靈活性。

標簽： Stratix FPGA 28 創(chuàng)新技術

上傳時間： 2013-10-30

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Altera公司 Stratix V GX FPGA開發(fā)板電路圖

本資料是關于Altera公司 Stratix V GX FPGA開發(fā)板電路圖的資料。資料包括開發(fā)板原理圖、PCB圖。

標簽： Stratix Altera FPGA GX

上傳時間： 2014-01-22

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Employing a Single-Chip Transceiver in Femtocell Base-Station Applications

Abstract: This application note discusses the development and deployment of 3G cellular femtocell base stations. The technicalchallenges for last-mile residential connectivity and adding system capacity in dense urban environments are discussed, with 3Gfemtocell base stations as a cost-effective solution. Maxim's 3GPP TS25.104-compliant transceiver solution is presented along withcomplete radio reference designs such as RD2550. For more information on the RD2550, see reference design 5364, "FemtocellRadio Reference Designs Using the MAX2550–MAX2553 Transceivers."

標簽： Base-Station Applications Single-Chip Transceiver

上傳時間： 2013-11-07

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用MDK生成bin格式的可執(zhí)行文件

用MDK 生成bin 文件1用MDK 生成bin 文件Embest 徐良平在RV MDK 中，默認情況下生成*.hex 的可執(zhí)行文件，但是當我們要生成*.bin 的可執(zhí)行文件時怎么辦呢？答案是可以使用RVCT 的fromelf.exe 工具進行轉換。也就是說首先將源文件編譯鏈接成*.axf 的文件，然后使用fromelf.exe 工具將*.axf 格式的文件轉換成*.bin格式的文件。下面將具體說明這個操作步驟：1. 打開Axf_To_Bin 文件中的Axf_To_Bin.uv2 工程文件；2. 打開Options for Target ‘Axf_To_Bin’對話框，選擇User 標簽頁；3. 構選Run User Programs After Build/Rebuild 框中的Run #1 多選框，在后邊的文本框中輸入C:\Keil\ARM\BIN31\fromelf.exe --bin -o ./output/Axf_To_Bin.bin ./output/Axf_To_Bin.axf 命令行；4. 重新編譯文件，在./output/文件夾下生成了Axf_To_Bin.bin 文件。在上面的步驟中，有幾點值得注意的是：1. C:\Keil\ARM\BIN31\表示RV MDK 的安裝目錄；2. fromelf.exe 命令的具體語法格式如下：命令的格式為：fromelf [options] input_file命令選項如下：--help 顯示幫助信息--vsn 顯示版本信息--output file 輸出文件(默認的輸出為文本格式)--nodebug 在生成的映象中不包含調試信息--nolinkview 在生成的映象中不包含段的信息二進制輸出格式：--bin 生成Plain Binary 格式的文件--m32 生成Motorola 32 位十六進制格式的文件--i32 生成Intel 32 位十六進制格式的文件--vhx 面向字節(jié)的位十六進制格式的文件t--base addr 設置m32，i32 格式文件的基地址--text 顯示文本信息文本信息的標志-v 打印詳細信息-a 打印數(shù)據(jù)地址(針對帶調試信息的映象)-d 打印數(shù)據(jù)段的內(nèi)容-e 打印表達式表print exception tables-f 打印消除虛函數(shù)的信息-g 打印調試表print debug tables-r 打印重定位信息-s 打印字符表-t 打印字符串表-y 打印動態(tài)段的內(nèi)容-z 打印代碼和數(shù)據(jù)大小的信息

標簽： MDK bin 可執(zhí)行文件

上傳時間： 2013-12-17

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