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CAVLC

  • H264AVC的CAVLC編碼算法研究及FPGA實(shí)現(xiàn).rar

    H.264/AVC是國際電信聯(lián)盟與國際標(biāo)準(zhǔn)化組織/國際電工委員會聯(lián)合推出的活動圖像編碼標(biāo)準(zhǔn),簡稱H.264。作為最新的國際視頻編碼標(biāo)準(zhǔn),H.264/AVC與MPEG-4、H.263等視頻編碼標(biāo)準(zhǔn)相比,性能有了很大的提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應(yīng)用。 本論文的研究課題是基于H.264/AVC視頻編碼標(biāo)準(zhǔn)的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應(yīng)可變長編碼)編碼算法研究及FPGA實(shí)現(xiàn)。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應(yīng)算術(shù)編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標(biāo)準(zhǔn)不同,它所有的編碼都是基于上下文進(jìn)行。這種方法比傳統(tǒng)的查單一表的方法提高了編碼效率,但也增加了設(shè)計上的困難。 作者在全面學(xué)習(xí)H.264/AVC協(xié)議和深入研究CAVLC編碼算法的基礎(chǔ)上,確定了并行編碼的CAVLC編碼器結(jié)構(gòu)框圖,并總結(jié)出了影響CAVLC編碼器實(shí)現(xiàn)的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進(jìn)行了優(yōu)化設(shè)計,這些優(yōu)化設(shè)計包括多參考塊的表格預(yù)測法、快速查找表法、算術(shù)消除法等。最后,用Verilog硬件描述語言對所設(shè)計的CAVLC編碼器進(jìn)行了描述,用EDA軟件對其主要功能模塊進(jìn)行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗(yàn)證了它們的功能。結(jié)果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實(shí)時通信要求,為整個CAVLC編碼器的實(shí)時通信提供了良好的基礎(chǔ)。

    標(biāo)簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-22

    上傳用戶:diamondsGQ

  • H264AVC的CAVLC編碼算法研究及FPGA實(shí)現(xiàn)

    H.264/AVC是國際電信聯(lián)盟與國際標(biāo)準(zhǔn)化組織/國際電工委員會聯(lián)合推出的活動圖像編碼標(biāo)準(zhǔn),簡稱H.264。作為最新的國際視頻編碼標(biāo)準(zhǔn),H.264/AVC與MPEG-4、H.263等視頻編碼標(biāo)準(zhǔn)相比,性能有了很大的提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應(yīng)用。 本論文的研究課題是基于H.264/AVC視頻編碼標(biāo)準(zhǔn)的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應(yīng)可變長編碼)編碼算法研究及FPGA實(shí)現(xiàn)。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應(yīng)算術(shù)編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標(biāo)準(zhǔn)不同,它所有的編碼都是基于上下文進(jìn)行。這種方法比傳統(tǒng)的查單一表的方法提高了編碼效率,但也增加了設(shè)計上的困難。 作者在全面學(xué)習(xí)H.264/AVC協(xié)議和深入研究CAVLC編碼算法的基礎(chǔ)上,確定了并行編碼的CAVLC編碼器結(jié)構(gòu)框圖,并總結(jié)出了影響CAVLC編碼器實(shí)現(xiàn)的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進(jìn)行了優(yōu)化設(shè)計,這些優(yōu)化設(shè)計包括多參考塊的表格預(yù)測法、快速查找表法、算術(shù)消除法等。最后,用Verilog硬件描述語言對所設(shè)計的CAVLC編碼器進(jìn)行了描述,用EDA軟件對其主要功能模塊進(jìn)行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗(yàn)證了它們的功能。結(jié)果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實(shí)時通信要求,為整個CAVLC編碼器的實(shí)時通信提供了良好的基礎(chǔ)。

    標(biāo)簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-04

    上傳用戶:libenshu01

  • 改進(jìn)了的CAVLC編碼方式

    改進(jìn)了的CAVLC編碼方式

    標(biāo)簽: CAVLC 編碼方式

    上傳時間: 2015-01-26

    上傳用戶:jkhjkh1982

  • H.264解碼器中CAVLC碼表查找算法的改進(jìn).PDF

    H.264解碼器中CAVLC碼表查找算法的改進(jìn).PDF

    標(biāo)簽: CAVLC 264 解碼器

    上傳時間: 2015-05-01

    上傳用戶:lindor

  • H.264幀內(nèi)預(yù)測算法優(yōu)化及幾個重要模塊的FPGA實(shí)現(xiàn).rar

    H.264作為新一代視頻編碼標(biāo)準(zhǔn),相比上一代視頻編碼標(biāo)準(zhǔn)MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標(biāo)準(zhǔn)僅設(shè)定了碼流的語法結(jié)構(gòu)和解碼器結(jié)構(gòu),實(shí)現(xiàn)靈活性極大,其規(guī)定了三個檔次,每個檔次支持一組特定的編碼功能,并支持一類特定的應(yīng)用,因此。H.264的編碼器的設(shè)計可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復(fù)雜度卻比一般編碼器高的多。本文對H.264進(jìn)行了編碼復(fù)雜度分析,并統(tǒng)計了整個軟件編碼中計算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預(yù)測編碼的效率。在該算法下進(jìn)行幀內(nèi)預(yù)測時,為了得到一個宏塊的預(yù)測模式,需要進(jìn)行592次率失真代價計算。因此為了降低幀內(nèi)預(yù)測模式選擇的計算復(fù)雜度,本文改進(jìn)了幀內(nèi)預(yù)測模式選擇算法。實(shí)踐證明,在PSNR值的損失可以忽略不計的情況下,該算法相比原算法,幀內(nèi)編碼時間平均節(jié)約60﹪以上,對編碼的實(shí)時性有較大幫助。 為了實(shí)現(xiàn)實(shí)時編碼,考慮到FPGA的高效運(yùn)算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實(shí)現(xiàn)。首先研究了H.264編碼器硬件實(shí)現(xiàn)架構(gòu),并對影響編碼速度,且具有硬件實(shí)現(xiàn)優(yōu)越性的幾個重要部分進(jìn)行了算法研究和FPGA.實(shí)現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對這些模塊進(jìn)行了綜合和時序仿真,并將驗(yàn)證后通過的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進(jìn)行了在線測試,驗(yàn)證了該系統(tǒng)對輸入的殘差數(shù)據(jù)實(shí)時壓縮編碼的功能。 本文對H.264編碼器幀內(nèi)預(yù)測模式選擇算法的改進(jìn),算法實(shí)現(xiàn)簡單,對軟件編碼的實(shí)時性有很大幫助。本文對在單片F(xiàn)PGA上實(shí)現(xiàn)H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設(shè)計有著積極的借鑒性。

    標(biāo)簽: FPGA 264 幀內(nèi)預(yù)測

    上傳時間: 2013-06-13

    上傳用戶:夜月十二橋

  • 基于H264的網(wǎng)絡(luò)視頻監(jiān)控的FPGA實(shí)現(xiàn)研究.rar

    隨著科學(xué)技術(shù)的發(fā)展與公共安全保障需求的提高,視頻監(jiān)控系統(tǒng)在工業(yè)生產(chǎn)、日常生活、警備與軍事方面的應(yīng)用越來越廣泛。采用基于 FPGA 的SOPC技術(shù)、H.264壓縮編碼技術(shù)和網(wǎng)絡(luò)傳輸控制技術(shù)實(shí)現(xiàn)網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng),在穩(wěn)定性、功能、成本與擴(kuò)展性等方面都有著突出的優(yōu)勢,具有重要的學(xué)術(shù)意義與實(shí)用意義, 本課題所設(shè)計的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)由以Nios Ⅱ?yàn)楹诵牡那度胧綀D像服務(wù)器、相關(guān)網(wǎng)絡(luò)設(shè)備與若干PC機(jī)客戶端組成。嵌入式圖像服務(wù)器實(shí)時采集圖像,采用H.264 編碼算法進(jìn)行壓縮,并持續(xù)監(jiān)聽網(wǎng)絡(luò)。PC機(jī)客戶端可通過網(wǎng)絡(luò)對服務(wù)器進(jìn)行遠(yuǎn)程訪問,接收編碼數(shù)據(jù),使用H.264解碼算法重建圖像并實(shí)時顯示,使監(jiān)控人員有效地掌握現(xiàn)場情況, 在嵌入式圖像服務(wù)器設(shè)計階段,本文首先進(jìn)行了芯片選型與開發(fā)平臺選擇。然后構(gòu)建圖像采集子系統(tǒng),采用雙緩存乒乓交換的方法設(shè)計圖像采集用戶自定義模塊。接著設(shè)計雙Nios Ⅱ架構(gòu)的SOPC系統(tǒng),闡述了雙軟核設(shè)計中定制連接、內(nèi)存芯片共享、數(shù)據(jù)搬移、通信與互斥的解決方法。同時完成了網(wǎng)絡(luò)服務(wù)器的設(shè)計,采用μC/OS-Ⅱ進(jìn)行多任務(wù)的管理與調(diào)度, H.264視頻壓縮編解碼算法設(shè)計與實(shí)現(xiàn)是本文的重點(diǎn)。文中首先分析H.264.標(biāo)準(zhǔn),規(guī)劃編解碼器結(jié)構(gòu)。接著設(shè)計了16×16幀內(nèi)預(yù)測算法,并設(shè)計宏塊掃描方式,采用兩次判決策略進(jìn)行預(yù)測模式選擇。然后設(shè)計4×4子塊掃描方式,編寫整數(shù)變換與量化算法程序。熵編碼采用Exp-Golomb編碼與CAVLC相結(jié)合的方案,針對除拖尾系數(shù)之外的非零系數(shù)值編碼子算法,實(shí)現(xiàn)了一種基于表示范圍判別的編碼方法。最后設(shè)計了網(wǎng)絡(luò)傳輸?shù)拇a流組成格式,并針對編碼算法設(shè)計相應(yīng)解碼算法。使用VC++完成算法驗(yàn)證,并進(jìn)行測試,觀察不同參數(shù)下壓縮率與失真度的變化。 算法驗(yàn)證完成后,本文進(jìn)行了PC機(jī)客戶端設(shè)計,使其具有遠(yuǎn)程訪問、H.264解碼與實(shí)時顯示的功能。同時將H.264 編碼算法程序移植到NiosⅡ中,并將嵌入式圖像服務(wù)器與若干客戶端接入網(wǎng)絡(luò)進(jìn)行聯(lián)合調(diào)試,構(gòu)建完整的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng), 實(shí)驗(yàn)結(jié)果表明,本系統(tǒng)視頻壓縮率高,監(jiān)控圖像質(zhì)量良好,充分證明了系統(tǒng)軟硬件與圖像編解碼算法設(shè)計成功。本系統(tǒng)具有成本低、擴(kuò)展性好及適用范圍廣等優(yōu)點(diǎn),發(fā)展前景十分廣闊。

    標(biāo)簽: H264 FPGA 網(wǎng)絡(luò)視頻監(jiān)控

    上傳時間: 2013-04-24

    上傳用戶:wang0123456789

  • H.264幀內(nèi)預(yù)測算法優(yōu)化及幾個重要模塊的FPGA實(shí)現(xiàn)

    H.264作為新一代視頻編碼標(biāo)準(zhǔn),相比上一代視頻編碼標(biāo)準(zhǔn)MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標(biāo)準(zhǔn)僅設(shè)定了碼流的語法結(jié)構(gòu)和解碼器結(jié)構(gòu),實(shí)現(xiàn)靈活性極大,其規(guī)定了三個檔次,每個檔次支持一組特定的編碼功能,并支持一類特定的應(yīng)用,因此。H.264的編碼器的設(shè)計可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復(fù)雜度卻比一般編碼器高的多。本文對H.264進(jìn)行了編碼復(fù)雜度分析,并統(tǒng)計了整個軟件編碼中計算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預(yù)測編碼的效率。在該算法下進(jìn)行幀內(nèi)預(yù)測時,為了得到一個宏塊的預(yù)測模式,需要進(jìn)行592次率失真代價計算。因此為了降低幀內(nèi)預(yù)測模式選擇的計算復(fù)雜度,本文改進(jìn)了幀內(nèi)預(yù)測模式選擇算法。實(shí)踐證明,在PSNR值的損失可以忽略不計的情況下,該算法相比原算法,幀內(nèi)編碼時間平均節(jié)約60﹪以上,對編碼的實(shí)時性有較大幫助。 為了實(shí)現(xiàn)實(shí)時編碼,考慮到FPGA的高效運(yùn)算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實(shí)現(xiàn)。首先研究了H.264編碼器硬件實(shí)現(xiàn)架構(gòu),并對影響編碼速度,且具有硬件實(shí)現(xiàn)優(yōu)越性的幾個重要部分進(jìn)行了算法研究和FPGA.實(shí)現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對這些模塊進(jìn)行了綜合和時序仿真,并將驗(yàn)證后通過的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進(jìn)行了在線測試,驗(yàn)證了該系統(tǒng)對輸入的殘差數(shù)據(jù)實(shí)時壓縮編碼的功能。 本文對H.264編碼器幀內(nèi)預(yù)測模式選擇算法的改進(jìn),算法實(shí)現(xiàn)簡單,對軟件編碼的實(shí)時性有很大幫助。本文對在單片F(xiàn)PGA上實(shí)現(xiàn)H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設(shè)計有著積極的借鑒性。

    標(biāo)簽: FPGA 264 幀內(nèi)預(yù)測 算法優(yōu)化

    上傳時間: 2013-05-25

    上傳用戶:refent

  • 基于H.264的網(wǎng)絡(luò)視頻監(jiān)控的FPGA實(shí)現(xiàn)研究

    隨著科學(xué)技術(shù)的發(fā)展與公共安全保障需求的提高,視頻監(jiān)控系統(tǒng)在工業(yè)生產(chǎn)、日常生活、警備與軍事方面的應(yīng)用越來越廣泛。采用基于 FPGA 的SOPC技術(shù)、H.264壓縮編碼技術(shù)和網(wǎng)絡(luò)傳輸控制技術(shù)實(shí)現(xiàn)網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng),在穩(wěn)定性、功能、成本與擴(kuò)展性等方面都有著突出的優(yōu)勢,具有重要的學(xué)術(shù)意義與實(shí)用意義, 本課題所設(shè)計的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)由以Nios Ⅱ?yàn)楹诵牡那度胧綀D像服務(wù)器、相關(guān)網(wǎng)絡(luò)設(shè)備與若干PC機(jī)客戶端組成。嵌入式圖像服務(wù)器實(shí)時采集圖像,采用H.264 編碼算法進(jìn)行壓縮,并持續(xù)監(jiān)聽網(wǎng)絡(luò)。PC機(jī)客戶端可通過網(wǎng)絡(luò)對服務(wù)器進(jìn)行遠(yuǎn)程訪問,接收編碼數(shù)據(jù),使用H.264解碼算法重建圖像并實(shí)時顯示,使監(jiān)控人員有效地掌握現(xiàn)場情況, 在嵌入式圖像服務(wù)器設(shè)計階段,本文首先進(jìn)行了芯片選型與開發(fā)平臺選擇。然后構(gòu)建圖像采集子系統(tǒng),采用雙緩存乒乓交換的方法設(shè)計圖像采集用戶自定義模塊。接著設(shè)計雙Nios Ⅱ架構(gòu)的SOPC系統(tǒng),闡述了雙軟核設(shè)計中定制連接、內(nèi)存芯片共享、數(shù)據(jù)搬移、通信與互斥的解決方法。同時完成了網(wǎng)絡(luò)服務(wù)器的設(shè)計,采用μC/OS-Ⅱ進(jìn)行多任務(wù)的管理與調(diào)度, H.264視頻壓縮編解碼算法設(shè)計與實(shí)現(xiàn)是本文的重點(diǎn)。文中首先分析H.264.標(biāo)準(zhǔn),規(guī)劃編解碼器結(jié)構(gòu)。接著設(shè)計了16×16幀內(nèi)預(yù)測算法,并設(shè)計宏塊掃描方式,采用兩次判決策略進(jìn)行預(yù)測模式選擇。然后設(shè)計4×4子塊掃描方式,編寫整數(shù)變換與量化算法程序。熵編碼采用Exp-Golomb編碼與CAVLC相結(jié)合的方案,針對除拖尾系數(shù)之外的非零系數(shù)值編碼子算法,實(shí)現(xiàn)了一種基于表示范圍判別的編碼方法。最后設(shè)計了網(wǎng)絡(luò)傳輸?shù)拇a流組成格式,并針對編碼算法設(shè)計相應(yīng)解碼算法。使用VC++完成算法驗(yàn)證,并進(jìn)行測試,觀察不同參數(shù)下壓縮率與失真度的變化。 算法驗(yàn)證完成后,本文進(jìn)行了PC機(jī)客戶端設(shè)計,使其具有遠(yuǎn)程訪問、H.264解碼與實(shí)時顯示的功能。同時將H.264 編碼算法程序移植到NiosⅡ中,并將嵌入式圖像服務(wù)器與若干客戶端接入網(wǎng)絡(luò)進(jìn)行聯(lián)合調(diào)試,構(gòu)建完整的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng), 實(shí)驗(yàn)結(jié)果表明,本系統(tǒng)視頻壓縮率高,監(jiān)控圖像質(zhì)量良好,充分證明了系統(tǒng)軟硬件與圖像編解碼算法設(shè)計成功。本系統(tǒng)具有成本低、擴(kuò)展性好及適用范圍廣等優(yōu)點(diǎn),發(fā)展前景十分廣闊。

    標(biāo)簽: FPGA 264 網(wǎng)絡(luò)視頻監(jiān)控 實(shí)現(xiàn)研究

    上傳時間: 2013-08-03

    上傳用戶:88mao

  • 高效的CABAC解碼器設(shè)計及FPGA實(shí)現(xiàn)

    H.264/AVC是ITU與ISO/IEC(International Standard Organization/Intemational Electrotechnical Commission國際標(biāo)準(zhǔn)化組織/國際電工委員會)聯(lián)合推出的活動圖像編碼標(biāo)準(zhǔn)。作為最新的國際視頻編碼標(biāo)準(zhǔn),H.264/AVC與MPEG-4、H.263等視頻編碼標(biāo)準(zhǔn)相比,性能有了很大提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應(yīng)用?;谏舷挛牡淖赃m應(yīng)二進(jìn)制算術(shù)編碼(Conrext-based Adaptive Binary Arithmetic Coding,CABAC)是H.264/AVC的兩個熵編碼方案之一,相對于另一熵編碼方案-CAVLC(基于上下文的自適應(yīng)可變長編碼),CABAC具有更高的數(shù)據(jù)壓縮率:在同等編碼質(zhì)量下要比CAVLC提高10%~15%的壓縮率。CABAC能實(shí)現(xiàn)很高的數(shù)據(jù)壓縮率,但這是以增加實(shí)現(xiàn)的復(fù)雜性為代價的。在已有的硬件實(shí)現(xiàn)方法上,CABAC的解碼效率并不高。 論文在深入研究CABAC解碼算法及其實(shí)現(xiàn)流程,并在仔細(xì)分析了H.264/AVC碼流結(jié)構(gòu)的基礎(chǔ)上,總結(jié)出了影響CABAC解碼效率的各個環(huán)節(jié),并以此為出發(fā)點(diǎn),對CABAC解碼所需中的各個功能模塊進(jìn)行了優(yōu)化設(shè)計,設(shè)計出一種新的CABAC解碼器結(jié)構(gòu),相對于一般的CABAC解碼器,它的解碼效率得到了顯著提高。論文針對影響CABAC解碼過程的"瓶頸"問題一多次訪問存儲部件影響解碼速率,提出了新的存儲組織方式,并根據(jù)CABAC的碼流結(jié)構(gòu)特性,采用4個子解碼器級聯(lián)的方式來進(jìn)一步提高解碼速率。 最后,用Verilog語言對所設(shè)計的CABAC解碼器進(jìn)行了描述,用EDA軟件對其進(jìn)行了仿真,并在FPGA上驗(yàn)證了其功能,結(jié)果顯示,該CABAC解碼器結(jié)構(gòu)顯著提高了解碼效率,能夠滿足高檔次實(shí)時通訊的要求。

    標(biāo)簽: CABAC FPGA 解碼器

    上傳時間: 2013-07-03

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  • 基于FPGA的H264視頻編碼器設(shè)計

    隨著多媒體編碼技術(shù)的發(fā)展,視頻壓縮標(biāo)準(zhǔn)在很多領(lǐng)域都得到了成功應(yīng)用,如視頻會議(H.263)、DVD(MPEG-2)、機(jī)頂盒(MPEG-2)等等,而網(wǎng)絡(luò)帶寬的不斷提升和高效視頻壓縮技術(shù)的發(fā)展使人們逐漸把關(guān)注的焦點(diǎn)轉(zhuǎn)移到了寬帶網(wǎng)絡(luò)數(shù)字電視(IPTV)、流媒體等基于傳輸?shù)臉I(yè)務(wù)上來。帶寬的增加為流式媒體的發(fā)展鋪平了道路,而高效的視頻壓縮標(biāo)準(zhǔn)的出臺則是流媒體技術(shù)發(fā)展的關(guān)鍵。H.264/AVC是由國際電信聯(lián)合會和國際標(biāo)準(zhǔn)化組織共同發(fā)展的下一代視頻壓縮標(biāo)準(zhǔn)之一。新標(biāo)準(zhǔn)中采用了新的視頻壓縮技術(shù),如多模式幀間預(yù)測、1/4像素精度預(yù)測、整數(shù)DCT變換、變塊尺寸運(yùn)動補(bǔ)償、基于上下文的二元算術(shù)編碼(CABAC)、基于上下文的變長編碼(CAVLC)等等,這些技術(shù)的采用大大提高了視頻壓縮的效率,更有利于寬帶網(wǎng)絡(luò)數(shù)字電視(IPTV)、流媒體等基于傳輸?shù)臉I(yè)務(wù)的實(shí)現(xiàn)。 本文主要根據(jù)視頻會議應(yīng)用的需要對JM8.6代碼進(jìn)行優(yōu)化,目標(biāo)是實(shí)現(xiàn)基于Baseline的低復(fù)雜度的CIF編碼器,并對部分功能模塊進(jìn)行電路設(shè)計。在設(shè)計方法上采用自頂向下的設(shè)計方法,首先對H.264編碼器的C代碼和算法進(jìn)行優(yōu)化,并對優(yōu)化后的結(jié)果進(jìn)行測試比較,結(jié)果顯示在圖像質(zhì)量沒有明顯降低的情況下,H.264編碼器編碼CIF格式視頻每秒達(dá)到15幀以上,滿足了視頻會議應(yīng)用的實(shí)時性要求。然后,以C模型為參考對H.264編碼器的部分功能模塊電路進(jìn)行設(shè)計。采用Verilog HDL實(shí)現(xiàn)了這些模塊,并在Quartus Ⅱ中進(jìn)行了綜合、仿真、驗(yàn)證。主要完成了Zig-zag掃描和CAVLC模塊的設(shè)計,詳細(xì)說明模塊的工作原理和過程,然后進(jìn)行多組的仿真測試,結(jié)果與C模型相應(yīng)部分的結(jié)果一致,證明了設(shè)計的正確性。

    標(biāo)簽: FPGA H264 視頻編碼器

    上傳時間: 2013-06-11

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