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CLock

K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按鍵 K4 --- 清零按鍵開機顯示： SECOND-CLock 0 TIM

K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按鍵 K4 --- 清零按鍵開機顯示： SECOND-CLock 0 TIME 00:00:00:00 K3 --- 控制按鍵：第一次按下時,開始計時。顯示 BEGIN COUNT 1 TIME 00:00:01:88 第二次按下時,暫停計時。顯示 PAUST COUNT 2 TIME 00:00:01:88 第三次按下時,累計計時。顯示 BEGIN COUNT 3 TIME 00:08:08:88 第四次按下時,暫停計時。顯示 PAUST COUNT 4 TIME 00:08:08:88 K4 --- 清零按鍵：在任何狀態下，按一下K4，均可清零。顯示 SECOND-CLock 0 TIME 00:00:00:00 0,1,2,3,4 表示按下K3鍵的次數。

標簽： SECOND-CLock K3 BEEP K4

上傳時間： 2014-01-14

上傳用戶：515414293
這是編寫的一個操作系統的CLock算法。是在vc++環境下編繹的。

這是編寫的一個操作系統的CLock算法。是在vc++環境下編繹的。

標簽： CLock vc 編寫操作系統

上傳時間： 2013-12-24

上傳用戶：hxy200501
c8051f020 實時時鐘模塊程序內含IIC模塊程序/********************** SYSTEM CLock 8M********************************/

c8051f020 實時時鐘模塊程序內含IIC模塊程序/********************** SYSTEM CLock 8M********************************/ extern unsigned char xdata currenttime[16]={0} extern unsigned char xdata settime[16]={ 0x00, // control regesiter 1 0x00, // control regesiter 2 0x01, //current second 0x19, //current minute 0x20, //current hour 0x29, //current data 0x04, //current week 0x07, //current month 0x05, //current year 0x00, // alarm value reset 0x00, // alarm value reset 0x00, // alarm value reset 0x00, // alarm value reset 0x00, // clk out disable 0x00, // close timer 0x00, } /*********************************************************************/ extern void Current_Time ( void ) extern void Set_Time ( void )

標簽： c8051f020 SYSTEM CLock IIC

上傳時間： 2015-06-30

上傳用戶：edisonfather
CLock 源程序c lock 源程序 CLock 源程序c lock 源程序

CLock 源程序c lock 源程序 CLock 源程序c lock 源程序

標簽： CLock lock 源程序

上傳時間： 2013-12-18

上傳用戶：lgnf
Digital CLock in Assembly 我的一個大學滿分VHDL作品

Digital CLock in Assembly 我的一個大學滿分VHDL作品，數字石英鐘的模擬程序。

標簽： Assembly Digital CLock VHDL

上傳時間： 2014-01-25

上傳用戶：hullow
芯片為EM78P153 P64,P65接晶振,振蕩模式為4MHz晶振看門狗關,指令周期為2個CLock,P63為復位腳

芯片為EM78P153 P64,P65接晶振,振蕩模式為4MHz晶振看門狗關,指令周期為2個CLock,P63為復位腳

標簽： CLock 4MHz P153 153

上傳時間： 2015-08-24

上傳用戶：1966640071
My thesis entitled "fpga digital CLock," immature, to enlighten

My thesis entitled "fpga digital CLock," immature, to enlighten

標簽： enlighten entitled immature digital

上傳時間： 2014-01-02

上傳用戶：hxy200501
時鐘萬年歷代碼 CLock.java放在了一個名叫 CLock的包里

時鐘萬年歷代碼 CLock.java放在了一個名叫 CLock的包里

標簽： CLock java 時鐘萬年歷

上傳時間： 2014-01-10

上傳用戶：zq70996813
* This a software code module for a time-of-day CLock object. * The CLock may be fixed 12-hour, fi

* This a software code module for a time-of-day CLock object. * The CLock may be fixed 12-hour, fixed 24-hour, or dynamically * configurable between these two types. CLock data can be accessed * as a binary number representing the number of minutes since midnight * or a BCD number formatted according to the time-of-day description * in the TIME module 0404x. The functions work with time-of-day values * which conform to normally accepted CLock values of 1:00 to * 12:59 BCD / 0 to 719 binary for a 12-hour CLock or CLock values * 00:00 to 23:59 BCD / 0 to 1439 binary for a 24-hour CLock. On power-up * the CLock is 12:00 BCD / 0 binary for a 12-hour or dynamically * configurable CLock, or 00:00 BCD / 0 binary for a 24-hour CLock.

標簽： CLock time-of-day software module

上傳時間： 2013-12-07

上傳用戶：llandlu
Dallas RTC （Real Time CLock）code 的源碼

Dallas RTC （Real Time CLock）code 的源碼

標簽： Dallas CLock Real Time

上傳時間： 2015-09-09

上傳用戶：270189020

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CLock

K3:--- P1.6 K4:--- P1.7 BEEP:--- P3.7 K3 --- 控制按鍵 K4 --- 清零按鍵開機顯示： SECOND-CLock 0 TIM

這是編寫的一個操作系統的CLock算法。是在vc++環境下編繹的。

c8051f020 實時時鐘模塊程序內含IIC模塊程序/ SYSTEM CLock 8M**********/

CLock 源程序c lock 源程序 CLock 源程序c lock 源程序

Digital CLock in Assembly 我的一個大學滿分VHDL作品

芯片為EM78P153 P64,P65接晶振,振蕩模式為4MHz晶振看門狗關,指令周期為2個CLock,P63為復位腳

My thesis entitled "fpga digital CLock," immature, to enlighten

時鐘萬年歷代碼 CLock.java放在了一個名叫 CLock的包里

* This a software code module for a time-of-day CLock object. * The CLock may be fixed 12-hour, fi

Dallas RTC （Real Time CLock）code 的源碼