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CLock

CLock on micro attyny2313 and pcf8583, and alarm

CLock on micro attyny2313 and pcf8583, and alarm

標(biāo)簽： and attyny CLock alarm

上傳時(shí)間： 2016-08-06

上傳用戶：6546544
CLock QT編程的例子　如果需要還有很多．郵箱聯(lián)系

CLock QT編程的例子　如果需要還有很多．郵箱聯(lián)系

標(biāo)簽： CLock 編程

上傳時(shí)間： 2014-01-02

上傳用戶：sz_hjbf
CLock program for all people use thanks!

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標(biāo)簽： program people thanks CLock

上傳時(shí)間： 2016-08-19

上傳用戶：wl9454
FM1702的例子程序 Chip type : ATmega16L Program type : Application CLock frequency : 7.372800 MHz Memo

FM1702的例子程序 Chip type : ATmega16L Program type : Application CLock frequency : 7.372800 MHz Memory model : Small External SRAM size : 0 Data Stack size : 256

標(biāo)簽： type Application frequency 7.372800

上傳時(shí)間： 2016-10-08

上傳用戶：chfanjiang
A CLock writing by Verilog which can count from 00:00 to 23:59. With a C file to see the simulation

A CLock writing by Verilog which can count from 00:00 to 23:59. With a C file to see the simulation results. A co-design example of C and Verilog.

標(biāo)簽： simulation Verilog writing CLock

上傳時(shí)間： 2016-10-12

上傳用戶：王者A
CLock_Dithering_Verilog this is a CLock u_dither, 大家想要做Verilog去抖動(dòng)的可以參考.

CLock_Dithering_Verilog this is a CLock u_dither, 大家想要做Verilog去抖動(dòng)的可以參考.

標(biāo)簽： CLock_Dithering_Verilog u_dither Verilog CLock

上傳時(shí)間： 2013-12-09

上傳用戶：
CRC碼產(chǎn)生器與校驗(yàn)器程序 Features ： Executes in one CLock cycle per data word Any polynomial from 4 to 32 b

CRC碼產(chǎn)生器與校驗(yàn)器程序 Features ： Executes in one CLock cycle per data word Any polynomial from 4 to 32 bits Any data width from 1 to 256 bits Any initialization value Synchronous or asynchronous reset

標(biāo)簽： polynomial Features Executes CLock

上傳時(shí)間： 2013-12-18

上傳用戶：Ants
just division the CLock into 2

just division the CLock into 2

標(biāo)簽： division CLock just into

上傳時(shí)間： 2014-12-04

上傳用戶：zq70996813
using event and delegate to perfoem CLock

using event and delegate to perfoem CLock

標(biāo)簽： delegate perfoem using event

上傳時(shí)間： 2016-11-10

上傳用戶：com1com2
操作系統(tǒng)中改進(jìn)型CLock頁(yè)面置換算法的演示算法

操作系統(tǒng)中改進(jìn)型CLock頁(yè)面置換算法的演示算法

標(biāo)簽： CLock 算法操作系統(tǒng) 改進(jìn)型

上傳時(shí)間： 2016-11-28

上傳用戶：dyctj

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CLock

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FM1702的例子程序 Chip type : ATmega16L Program type : Application CLock frequency : 7.372800 MHz Memo

A CLock writing by Verilog which can count from 00:00 to 23:59. With a C file to see the simulation

CLock_Dithering_Verilog this is a CLock u_dither, 大家想要做Verilog去抖動(dòng)的可以參考.

CRC碼產(chǎn)生器與校驗(yàn)器程序 Features ： Executes in one CLock cycle per data word Any polynomial from 4 to 32 b

just division the CLock into 2

using event and delegate to perfoem CLock

操作系統(tǒng)中改進(jìn)型CLock頁(yè)面置換算法的演示算法