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CPld

CPld采用CMOSEPROM、EEPROM、快閃存儲器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線

用一片CPld實現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.

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標(biāo)簽： CPld VHDL 數(shù)字鎖相環(huán) 語言

上傳時間： 2013-12-24

上傳用戶：l254587896
用一片CPld實現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.

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標(biāo)簽： CPld VHDL 數(shù)字鎖相環(huán) 語言

上傳時間： 2014-01-07

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CPld在USB20接口中的應(yīng)用

CPld在USB20接口中的應(yīng)用，usb大家都用過吧，不用多說了吧。

標(biāo)簽： CPld USB 20 接口

上傳時間： 2014-01-19

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用CPld做了個FPGA的FPP下載時序

用CPld做了個FPGA的FPP下載時序，驗證過。

標(biāo)簽： CPld FPGA FPP

上傳時間： 2013-12-30

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FPGA/CPld集成開發(fā)環(huán)境ISE的使用詳解示例代碼1

FPGA/CPld集成開發(fā)環(huán)境ISE的使用詳解示例代碼1

標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2014-01-17

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FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－2

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－2

標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2013-12-20

上傳用戶：hullow
FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－3

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標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2013-12-17

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FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－4

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－4

標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2015-09-29

上傳用戶：agent
FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－5

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－5

標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2014-01-23

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FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－6

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標(biāo)簽： FPGA CPld ISE 集成開發(fā)環(huán)境

上傳時間： 2013-12-01

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CPld

用一片CPld實現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.

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CPld在USB20接口中的應(yīng)用

用CPld做了個FPGA的FPP下載時序

FPGA/CPld集成開發(fā)環(huán)境ISE的使用詳解示例代碼1

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－2

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－3

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－4

FPGA/CPld集成開發(fā)環(huán)境ISE使用詳解實例－5

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