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CPld

CPld采用CMOSEPROM、EEPROM、快閃存儲(chǔ)器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線

FPGA/CPld集成開(kāi)發(fā)環(huán)境ise的使用詳解示例代碼8

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標(biāo)簽： FPGA CPld ise 集成開(kāi)發(fā)環(huán)境

上傳時(shí)間： 2014-12-04

上傳用戶：JIUSHICHEN
FPGA/CPld集成開(kāi)發(fā)環(huán)境ise的使用詳解示例代碼9

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標(biāo)簽： FPGA CPld ise 集成開(kāi)發(fā)環(huán)境

上傳時(shí)間： 2015-10-28

上傳用戶：凌云御清風(fēng)
FPGA/CPld集成開(kāi)發(fā)環(huán)境ise的使用詳解示例代碼10

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標(biāo)簽： FPGA CPld ise 集成開(kāi)發(fā)環(huán)境

上傳時(shí)間： 2015-10-28

上傳用戶：894898248
FPGA/CPld集成開(kāi)發(fā)環(huán)境ise的使用詳解示例代碼

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標(biāo)簽： FPGA CPld ise 集成開(kāi)發(fā)環(huán)境

上傳時(shí)間： 2013-11-26

上傳用戶：anng
PSD4256G flash inside CPld example code

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標(biāo)簽： example inside 4256G flash

上傳時(shí)間： 2015-10-29

上傳用戶：二驅(qū)蚊器
基于CPld的USB下載電纜設(shè)計(jì).rar

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標(biāo)簽： CPld USB

上傳時(shí)間： 2015-10-31

上傳用戶：清風(fēng)冷雨
altera USB blaste 制作全套資料。包括原理圖、93LC46的配置文件和CPld的VHDL源程序。

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標(biāo)簽： altera blaste CPld VHDL

上傳時(shí)間： 2015-11-06

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學(xué)習(xí)CPld的朋友注意了

學(xué)習(xí)CPld的朋友注意了，這是一本非常好的入門書籍，對(duì)初學(xué)者是很有幫助的

標(biāo)簽： CPld

上傳時(shí)間： 2014-01-27

上傳用戶：dengzb84
智能全數(shù)字鎖相環(huán)的設(shè)計(jì)用VHDL語(yǔ)言在CPld上實(shí)現(xiàn)串行通信

智能全數(shù)字鎖相環(huán)的設(shè)計(jì)用VHDL語(yǔ)言在CPld上實(shí)現(xiàn)串行通信

標(biāo)簽： VHDL CPld 全數(shù)字串行通信

上傳時(shí)間： 2014-01-08

上傳用戶：weiwolkt
錯(cuò)誤檢測(cè)與糾正電路的設(shè)計(jì)與實(shí)現(xiàn)用VHDL語(yǔ)言在CPld上實(shí)現(xiàn)串行通信.doc

錯(cuò)誤檢測(cè)與糾正電路的設(shè)計(jì)與實(shí)現(xiàn)用VHDL語(yǔ)言在CPld上實(shí)現(xiàn)串行通信.doc

標(biāo)簽： VHDL CPld 錯(cuò)誤檢測(cè)與糾正

上傳時(shí)間： 2015-11-06

上傳用戶：hwl453472107

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FPGA/CPld集成開(kāi)發(fā)環(huán)境ise的使用詳解示例代碼

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