Verilog module containing a synthesizable CRC function // * polynomial: (0 1 8) // * data width: 8
標簽： synthesizable containing polynomial function
上傳時間： 2016-09-26
上傳用戶：lacsx
這是一個在FPGA上實現CRC算法的程序，包含了CRC-8,CRC-12,CRC-16,CRC-CCIT,CRC-32一共五種校驗形式。
標簽： FPGA CRC 算法 程序
上傳時間： 2016-09-28
上傳用戶：123456wh
用FPGA實現CRC算法，只用一個脈沖就能實現，比傳統的移位算法大大節約時間
標簽： FPGA CRC 算法
上傳時間： 2016-10-01
上傳用戶：003030
用DELPHI寫的Modbus RTU CRC檢驗方法，希望對你有所作為。
標簽： DELPHI Modbus CRC RTU
上傳時間： 2013-12-24
上傳用戶：redmoons
MSP430 CRC算法的實現 （基于msp430x16x）
標簽： 430 430x MSP 16x
上傳時間： 2013-12-03
上傳用戶：zhaiyanzhong
軟件作者：kylinpoet (E.S.T) PS：發現網上用VB寫加花程序的源碼很難找 同時也為了加深一下對PE結構的了解 就動手寫了這個程序 本來還想加個 crc校驗 或者 修改PE結構 欺騙OD 什么 想想也沒什么必要 就不加了 參數修改 或者 自己添加花指令的話 就直接在 xml文件里操作吧 自定義的花只用 添加花頭 如： xxxx xxxx ------------ jmp xxxx jmp是自己生成的不用添加 花指令支持空格 自帶的花指令有可能被卡巴認為是病毒 請自行斟酌使用 希望大家玩得愉快
標簽： E.S.T kylinpoet crc 程序
上傳時間： 2016-10-10
上傳用戶：ruixue198909
freescale crc模塊驅動 經調試，可正常工作
標簽： freescale crc 模塊 驅動
上傳時間： 2014-12-01
上傳用戶：康郎
cdma2000系統中編碼中的crc模塊，通過matlab的simulink模擬crc編碼
標簽： cdma 2000 crc
上傳時間： 2016-10-18
上傳用戶：皇族傳媒
CRC碼產生器與校驗器程序 Features ： Executes in one clock cycle per data word Any polynomial from 4 to 32 bits Any data width from 1 to 256 bits Any initialization value Synchronous or asynchronous reset
標簽： polynomial Features Executes clock
上傳時間： 2013-12-18
上傳用戶：Ants
一個16位CRC校驗軟件算法。通過查表、移位、異或得出一定字節數的16為CRC校驗碼。
標簽： CRC 軟件算法 移位 字節
上傳時間： 2016-10-19
上傳用戶：sqq
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