DDS數(shù)字頻率合成器，使用很方便，整個(gè)工程下載，vhdl語(yǔ)言
標(biāo)簽： DDS 數(shù)字頻率合成器
上傳時(shí)間： 2017-08-18
上傳用戶(hù)：zl5712176
DDS的簡(jiǎn)單介紹，簡(jiǎn)單易懂，放的和事實(shí)上發(fā)，地和十分哈哈方式大河
標(biāo)簽： DDS
上傳時(shí)間： 2013-12-18
上傳用戶(hù)：aeiouetla
FPGA實(shí)現(xiàn)DDS，f=90kHZ~5MHZ范圍
標(biāo)簽： FPGA DDS
上傳時(shí)間： 2017-08-20
上傳用戶(hù)：BOBOniu
本文詳細(xì)介紹了dds的原理，希望對(duì)大家有所幫助，
標(biāo)簽： dds 詳細(xì)介紹
上傳時(shí)間： 2014-01-08
上傳用戶(hù)：ljmwh2000
DDS波形發(fā)生器，可產(chǎn)生三角波、方波、三角波源程序。
標(biāo)簽： DDS 波形發(fā)生器
上傳時(shí)間： 2013-12-25
上傳用戶(hù)：yd19890720
dds 用vhdl語(yǔ)言寫(xiě)成，可以看看！dds dds dds
標(biāo)簽： vhdl dds 語(yǔ)言
上傳時(shí)間： 2014-01-01
上傳用戶(hù)：gtf1207
DDS設(shè)計(jì)采用51單片機(jī) 用C語(yǔ)言編程 適合畢業(yè)設(shè)計(jì)等小型設(shè)計(jì)
標(biāo)簽： DDS 51單片機(jī) C語(yǔ)言編程 畢業(yè)設(shè)計(jì)
上傳時(shí)間： 2017-09-10
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本文介紹了如何用VHDL進(jìn)行DDS的設(shè)計(jì)，其中關(guān)鍵的相位累加器，正弦信號(hào)發(fā)生器等用VHDL描述
標(biāo)簽： VHDL DDS
上傳時(shí)間： 2014-02-28
上傳用戶(hù)：qweqweqwe
DDS信號(hào)源，9858+8051LCD顯示。好用。簡(jiǎn)單
標(biāo)簽： DDS 信號(hào)源
上傳時(shí)間： 2013-12-15
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基于FPGA 的直接數(shù)字頻率合成信號(hào)發(fā)生器(DDS)設(shè)計(jì)
標(biāo)簽： FPGA DDS 數(shù)字頻率合成 信號(hào)發(fā)生器
上傳時(shí)間： 2017-09-14
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