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DDS-FPGA

CPLD/FPGA學(xué)習(xí)與應(yīng)用

CPLD/FPGA學(xué)習(xí)與應(yīng)用，學(xué)習(xí)可編程邏輯的好書籍。

標(biāo)簽： CPLD FPGA

上傳時(shí)間： 2013-08-20

上傳用戶：幾何公差
分析了MATLAB/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計(jì)中優(yōu)點(diǎn)

分析了MATLAB/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計(jì)中優(yōu)點(diǎn)，\\r\\n然后結(jié)合FSK 信號(hào)的產(chǎn)生原理，給出了如何利用DSP Builder 模塊庫建立FSK 信號(hào)發(fā)生器模\\r\\n型，以及對(duì)FSK 信號(hào)發(fā)生器模型進(jìn)行算法級(jí)仿真和生成VHDL 語言的方法，并在modelsim\\r\\n中對(duì)FSK 信號(hào)發(fā)生器進(jìn)行RTL 級(jí)仿真，最后介紹了在FPGA 芯片中實(shí)現(xiàn)FSK 信號(hào)發(fā)生器的設(shè)\\r\\n計(jì)方法。

標(biāo)簽： Simulink Builder MATLAB FPGA

上傳時(shí)間： 2013-08-20

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FPGA 在無刷直流電機(jī)控制中的應(yīng)用

FPGA 在無刷直流電機(jī)控制中的應(yīng)用，學(xué)習(xí)應(yīng)用有參考價(jià)值

標(biāo)簽： FPGA 無刷直流中的應(yīng)用電機(jī)控制

上傳時(shí)間： 2013-08-20

上傳用戶：段璇琮*
基于QUARTUSII軟件實(shí)現(xiàn)FPGA（ATERA CYCLONE II系列）與SD卡SD模式通信源碼

基于QUARTUSII軟件實(shí)現(xiàn)FPGA（ATERA CYCLONE II系列）與SD卡SD模式通信\r\n所用語言位verilog HDL

標(biāo)簽： QUARTUSII CYCLONE ATERA FPGA

上傳時(shí)間： 2013-08-20

上傳用戶：it男一枚
FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能

FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺(tái)灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章

標(biāo)簽： FPGA 嵌入式系統(tǒng) 性能

上傳時(shí)間： 2013-08-20

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FPGA設(shè)計(jì)全流程

FPGA設(shè)計(jì)全流程：Modelsim>>Synplify.Pro>>ISE\\r\\n第一章 Modelsim編譯Xilinx庫\\r\\n第二章調(diào)用Xilinx CORE-Generator\\r\\n第三章使用Synplify.Pro綜合HDL和內(nèi)核\\r\\n第四章綜合后的項(xiàng)目執(zhí)行\(zhòng)\r\\n第五章不同類型結(jié)構(gòu)的仿真

標(biāo)簽： FPGA 流程

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FPGA驅(qū)動(dòng)STN （16x2）的程序

FPGA驅(qū)動(dòng)STN （16x2）的程序，沒有相應(yīng)的液晶屏是看不到效果的，而且不是個(gè)工程文件，只能從中學(xué)習(xí)下，驅(qū)動(dòng)液晶的信號(hào)怎么來。

標(biāo)簽： FPGA 16x2 STN 驅(qū)動(dòng)

上傳時(shí)間： 2013-08-20

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基于FPGA的機(jī)器人視頻監(jiān)視系統(tǒng)

基于FPGA的機(jī)器人視頻監(jiān)視系統(tǒng)，內(nèi)有各種詳盡的資料，絕對(duì)準(zhǔn)確可靠！

標(biāo)簽： FPGA 機(jī)器人視頻監(jiān)視系統(tǒng)

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FPGA相關(guān)硬件仿真程序

FPGA相關(guān)硬件仿真程序，編譯環(huán)境QUARTER Ⅱ。

標(biāo)簽： FPGA 硬件仿真程序

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一種計(jì)算高階矩陣奇異值分解的FPGA實(shí)現(xiàn)方法

一種計(jì)算高階矩陣奇異值分解的FPGA實(shí)現(xiàn)方法。

標(biāo)簽： FPGA 計(jì)算矩陣奇異值分解

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