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FIFO

FirstInputFirstOutput的縮寫，先入先出隊列，這是一種傳統的按序執行方法，先進入的指令先完成并引退，跟著才執行第二條指令。

FIFO級聯

FIFO級聯，利用verilog語言實現Xilinx FIFO18單元的多個級聯，增大FIFO深度。

標簽： FIFO 級聯

上傳時間： 2017-01-28

上傳用戶：skfreeman
操作系統實驗頁面置換 FIFO LRU 最優頁面調度算法opT

操作系統實驗頁面置換 FIFO LRU 最優頁面調度算法opT

標簽： FIFO LRU opT 頁

上傳時間： 2013-12-23

上傳用戶：lifangyuan12
一個用VHDL源碼編寫的先進先出(FIFO)緩沖器模塊.可以進行FIFO的仿真驗證

一個用VHDL源碼編寫的先進先出(FIFO)緩沖器模塊.可以進行FIFO的仿真驗證

標簽： FIFO VHDL 源碼模塊

上傳時間： 2014-02-28

上傳用戶：lunshaomo
另外一個用VHDL源碼編寫的FIFO模塊程序,可以比較一下和FIFO有什么區別.

另外一個用VHDL源碼編寫的FIFO模塊程序,可以比較一下和FIFO有什么區別.

標簽： FIFO VHDL 源碼模塊

上傳時間： 2017-02-05

上傳用戶：xlcky
FIFO vhdl源碼

FIFO vhdl源碼，高可靠性，帶有格雷碼同步，有需要可依進行參考！

標簽： FIFO vhdl 源碼

上傳時間： 2014-01-20

上傳用戶：manking0408
EZ-USB的CY7C68013A實現Slave FIFO的AutoIN。關鍵配置見TD_Init函數。

EZ-USB的CY7C68013A實現Slave FIFO的AutoIN。關鍵配置見TD_Init函數。

標簽： TD_Init EZ-USB 68013A C68013

上傳時間： 2014-12-01

上傳用戶：ynsnjs
VERILOG Synchronous FIFO. 4 x 16 bit words.

VERILOG Synchronous FIFO. 4 x 16 bit words.

標簽： Synchronous VERILOG words FIFO

上傳時間： 2017-02-18

上傳用戶：410805624
USB 2.0 FIFO 工作模式 C語言編程 CY7C68013單片機

USB 2.0 FIFO 工作模式 C語言編程 CY7C68013單片機

標簽： C68013 68013 FIFO USB

上傳時間： 2017-02-19

上傳用戶：baiom
FIFO和計數器以及時鐘控制

FIFO和計數器以及時鐘控制，用于程控交換機教學，與DSP和ADDA芯片配合完成程控交換機功能

標簽： FIFO 計數器時鐘控制

上傳時間： 2013-11-28

上傳用戶：410805624
FIFO example vhdl code

FIFO example vhdl code

標簽： example FIFO code vhdl

上傳時間： 2014-11-11

上傳用戶：康郎

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FIFO

FIFO級聯

操作系統實驗頁面置換 FIFO LRU 最優頁面調度算法opT

一個用VHDL源碼編寫的先進先出(FIFO)緩沖器模塊.可以進行FIFO的仿真驗證

另外一個用VHDL源碼編寫的FIFO模塊程序,可以比較一下和FIFO有什么區別.

FIFO vhdl源碼

EZ-USB的CY7C68013A實現Slave FIFO的AutoIN。關鍵配置見TD_Init函數。

VERILOG Synchronous FIFO. 4 x 16 bit words.

USB 2.0 FIFO 工作模式 C語言編程 CY7C68013單片機

FIFO和計數器以及時鐘控制

FIFO example vhdl code