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FM解調(diào)器

高速互連 (第9版本)

美信公司的高速互連 (第9版本) 資料，主要內(nèi)容有： 3mm x 3mm串行器支持微型安全攝像機(jī)設(shè)計(jì) .2吉比特、多端口、LVDS交叉點(diǎn)開關(guān)，有效降低系統(tǒng)成本 ...318位、智能型雙向LVDS SerDes，無(wú)需CAN或LIN接口 .....4帶有LVDS系統(tǒng)接口的GMSL SerDes，電路板尺寸縮減50% ....5GMSL SerDes提供完備的數(shù)字視頻、音頻和控制數(shù)據(jù)支持 6利用HDCP GMSL SerDes實(shí)現(xiàn)安全的數(shù)據(jù)傳輸 ....7降低汽車導(dǎo)航系統(tǒng)的EMI和成本 ....821位、直流平衡LVDS解串器，可編程擴(kuò)頻 .....9選型指南 ....10

標(biāo)簽： 高速互連版本

上傳時(shí)間： 2014-12-05

上傳用戶：athjac
PCB疊層阻抗工具Si8000破解版下載

資料介紹說(shuō)明： si8000m破解版帶破解文件crack si8000m是全新的邊界元素法場(chǎng)效解算器，建立在我們熟悉的早期POLAR阻抗設(shè)計(jì)系統(tǒng)易用使用的用戶界面之上。si8000m增加了強(qiáng)化建模技術(shù)，可以預(yù)測(cè)多電介質(zhì)PCB的成品阻抗，同時(shí)考慮了密集差分結(jié)構(gòu)介電常數(shù)局部變化。建模時(shí)常常忽略了便面圖層，si8000m模擬圖層與表面線路之間的阻焊厚度。這是一種更好的解決方案，可根據(jù)電路板采用的特殊阻焊方法進(jìn)行定制。新的si8000m還提取偶模阻抗和共模阻抗。（偶模阻抗是黨倆條傳輸線對(duì)都采用相同量值，相同級(jí)性的信號(hào)驅(qū)動(dòng)，傳輸線一邊的特性阻抗.)在USB2.0和LVDS等高速系統(tǒng)中，越來(lái)越需要控制這些特征阻抗。

標(biāo)簽： 8000 PCB Si 疊層

上傳時(shí)間： 2013-11-05

上傳用戶：古谷仁美
PCB疊層阻抗工具Si8000破解版下載

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標(biāo)簽： 8000 PCB Si 疊層

上傳時(shí)間： 2013-11-16

上傳用戶：jiangfire
高速I/O接口技術(shù)

現(xiàn)代通信技術(shù)朝著高速、精確的方向發(fā)展,尤其是高速串行通信,逐漸成為通信技術(shù)的主流,在各行各業(yè)扮演著極其重要的角色,文中簡(jiǎn)述了高速I/O的相關(guān)技術(shù),如SERDES (串行器/解串器)技術(shù)、8B /10B編碼、COMMA字符、預(yù)加重等,并列舉了具有代表性的Xilinx公司的FPGA產(chǎn)品,展示了Rocket IO技術(shù)的實(shí)際應(yīng)用。關(guān)鍵詞:高速I/O接口; SERDES;預(yù)加重

標(biāo)簽： 接口技術(shù)

上傳時(shí)間： 2013-11-23

上傳用戶：子虛烏有
XAPP858 - 利用 Virtex-5 FPGA 實(shí)現(xiàn)的高性能 DDR2 SDRAM 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實(shí)現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 SDRAM 接口的

XAPP858 - 利用 Virtex-5 FPGA 實(shí)現(xiàn)的高性能 DDR2 SDRAM 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實(shí)現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 SDRAM 接口的控制器和數(shù)據(jù)采集的技巧。本數(shù)據(jù)采集技巧使用了輸入串行器/解串器（ISERDES）和輸出串行器/解串器（OSERDES）的功能。

標(biāo)簽： SDRAM DDR2 Virtex XAPP

上傳時(shí)間： 2014-01-19

上傳用戶：sk5201314
Fluent中文教程 pdf格式

Fluent中文教程 pdf格式，對(duì)于開始學(xué)習(xí)Fluent的人來(lái)說(shuō)相當(dāng)適用，可以按照本書學(xué)習(xí)！ I、目錄第一章、開始第二章、操作界面第三章、文件的讀寫第四章、單位系統(tǒng) 第五章、讀入和操作網(wǎng)格第六章、邊界條件第七章、物理特性第八章、基本物理模型第九章、湍流模型第十章、輻射模型第十一章、化學(xué)輸運(yùn)與反應(yīng)流第十二章、污染形成模型第十三章、相變模擬第十四章、多相流模型第十五章、動(dòng)坐標(biāo)系下的流動(dòng) 第十六章、解算器的使用第十七章、網(wǎng)格適應(yīng) 第十八章、數(shù)據(jù)顯示與報(bào)告界面第十九章、圖形與可視化第二十章、Alphanumeric Report 第二十一章、流場(chǎng)函數(shù)定義第二十二章、并行處理第二十三章、自定義函數(shù) 第二十四章、參考向?qū)? 第二十五章、索引（Bibliograph 第二十六章、命令索引 II、如何使用該教程

標(biāo)簽： Fluent 教程

上傳時(shí)間： 2013-12-18

上傳用戶：netwolf
高速電路設(shè)計(jì) 詳細(xì)基礎(chǔ)理論知識(shí)

設(shè)計(jì)高速電路必須考慮高速訊號(hào)所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng)，所以訊號(hào)完整性 (signal integrity)將是考量設(shè)計(jì)電路優(yōu)劣的一項(xiàng)重要指標(biāo)，電路日異複雜必須仰賴可靠的軟體來(lái)幫忙分析這些複雜的效應(yīng)，才比較可能獲得高品質(zhì)且可靠的設(shè)計(jì)，因此熟悉軟體的使用也將是重要的研究項(xiàng)目之一。另外了解高速訊號(hào)所引發(fā)之各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路設(shè)計(jì)的重點(diǎn)之一。目前高速示波器的功能越來(lái)越多，使用上很複雜，必須事先進(jìn)修學(xué)習(xí)，否則無(wú)法全盤了解儀器之功能，因而無(wú)法有效發(fā)揮儀器的量測(cè)功能。其次就是高速訊號(hào)量測(cè)與介面的一些測(cè)試規(guī)範(fàn)也必須熟悉，像眼圖分析，探針效應(yīng)，抖動(dòng)(jitter)測(cè)量規(guī)範(fàn)及高速串列介面量測(cè)規(guī)範(fàn)等實(shí)務(wù)技術(shù)，必須充分了解研究學(xué)習(xí)，進(jìn)而才可設(shè)計(jì)出優(yōu)良之教學(xué)教材及教具。

標(biāo)簽： 高速電路

上傳時(shí)間： 2021-11-02

上傳用戶：jiabin
高速串行SERDES以及應(yīng)用介紹

SERDES是英文SERializer(串行器)/DESerializer(解串器)的簡(jiǎn)稱。它是一種時(shí)分多路復(fù)用(TDM)、點(diǎn)對(duì)點(diǎn)的通信技術(shù)，即在發(fā)送端多路低速并行信號(hào)被轉(zhuǎn)換成高速串行信號(hào)，經(jīng)過(guò)傳輸媒體(光纜或銅線)，最后在接收端高速串行信號(hào)重新轉(zhuǎn)換成低速并行信號(hào)。這種點(diǎn)對(duì)點(diǎn)的串行通信技術(shù)充分利用傳輸媒體的信道容量，減少所需的傳輸信道和器件引腳數(shù)目，從而大大降低通信成本。隨著對(duì)信息流量需求的不斷增長(zhǎng)，傳統(tǒng)并行接口技術(shù)成為進(jìn)一步提高數(shù)據(jù)傳輸速率的瓶頸。過(guò)去主要用于光纖通信的串行通信技術(shù)——SERDES正在取代傳統(tǒng)并行總線而成為高速接口技術(shù)的主流。本文闡述了介紹SERDES的架構(gòu)、關(guān)鍵技術(shù)、SERDES硬件設(shè)計(jì)要點(diǎn)以及測(cè)試方法。

標(biāo)簽： 高速 serdes

上傳時(shí)間： 2022-06-30

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FM發(fā)射器電路圖全集(PDF下載)

FM發(fā)射器電路圖全集(PDF下載)，有整體有局部，好！

標(biāo)簽： 發(fā)射器電路圖

上傳時(shí)間： 2013-06-03

上傳用戶：yuchunhai1990
51寄存器詳解

51寄存器的所有寄存器名稱，（包括寄存器每一位的作用及用法）資源詳解！

標(biāo)簽： 51寄存器

上傳時(shí)間： 2013-05-22

上傳用戶：ABCD_ABCD