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FPGA EDK

分析了MATLAB/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計中優(yōu)點

分析了MATLAB/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計中優(yōu)點，\\r\\n然后結(jié)合FSK 信號的產(chǎn)生原理，給出了如何利用DSP Builder 模塊庫建立FSK 信號發(fā)生器模\\r\\n型，以及對FSK 信號發(fā)生器模型進(jìn)行算法級仿真和生成VHDL 語言的方法，并在modelsim\\r\\n中對FSK 信號發(fā)生器進(jìn)行RTL 級仿真，最后介紹了在FPGA 芯片中實現(xiàn)FSK 信號發(fā)生器的設(shè)\\r\\n計方法。

標(biāo)簽： Simulink Builder MATLAB FPGA

上傳時間： 2013-08-20

上傳用戶：herog3
FPGA 在無刷直流電機(jī)控制中的應(yīng)用

FPGA 在無刷直流電機(jī)控制中的應(yīng)用，學(xué)習(xí)應(yīng)用有參考價值

標(biāo)簽： FPGA 無刷直流中的應(yīng)用電機(jī)控制

上傳時間： 2013-08-20

上傳用戶：段璇琮*
基于QUARTUSII軟件實現(xiàn)FPGA（ATERA CYCLONE II系列）與SD卡SD模式通信源碼

基于QUARTUSII軟件實現(xiàn)FPGA（ATERA CYCLONE II系列）與SD卡SD模式通信\r\n所用語言位verilog HDL

標(biāo)簽： QUARTUSII CYCLONE ATERA FPGA

上傳時間： 2013-08-20

上傳用戶：it男一枚
FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計改善即時應(yīng)用性能

FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計改善即時應(yīng)用性能，臺灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章

標(biāo)簽： FPGA 嵌入式系統(tǒng) 性能

上傳時間： 2013-08-20

上傳用戶：liuwei6419
FPGA設(shè)計全流程

FPGA設(shè)計全流程：Modelsim>>Synplify.Pro>>ISE\\r\\n第一章 Modelsim編譯Xilinx庫\\r\\n第二章調(diào)用Xilinx CORE-Generator\\r\\n第三章使用Synplify.Pro綜合HDL和內(nèi)核\\r\\n第四章綜合后的項目執(zhí)行\(zhòng)\r\\n第五章不同類型結(jié)構(gòu)的仿真

標(biāo)簽： FPGA 流程

上傳時間： 2013-08-20

上傳用戶：cuibaigao
FPGA驅(qū)動STN （16x2）的程序

FPGA驅(qū)動STN （16x2）的程序，沒有相應(yīng)的液晶屏是看不到效果的，而且不是個工程文件，只能從中學(xué)習(xí)下，驅(qū)動液晶的信號怎么來。

標(biāo)簽： FPGA 16x2 STN 驅(qū)動

上傳時間： 2013-08-20

上傳用戶：shus521
基于FPGA的機(jī)器人視頻監(jiān)視系統(tǒng)

基于FPGA的機(jī)器人視頻監(jiān)視系統(tǒng)，內(nèi)有各種詳盡的資料，絕對準(zhǔn)確可靠！

標(biāo)簽： FPGA 機(jī)器人視頻監(jiān)視系統(tǒng)

上傳時間： 2013-08-20

上傳用戶：012345
FPGA相關(guān)硬件仿真程序

FPGA相關(guān)硬件仿真程序，編譯環(huán)境QUARTER Ⅱ。

標(biāo)簽： FPGA 硬件仿真程序

上傳時間： 2013-08-20

上傳用戶：lanhuaying
一種計算高階矩陣奇異值分解的FPGA實現(xiàn)方法

一種計算高階矩陣奇異值分解的FPGA實現(xiàn)方法。

標(biāo)簽： FPGA 計算矩陣奇異值分解

上傳時間： 2013-08-21

上傳用戶：253189838
可以在里面修改協(xié)議.主要是cmos---fpga--usb(68013a)中除68013a部分的程序

可以在里面修改協(xié)議.主要是cmos---fpga--usb(68013a)中除68013a部分的程序

標(biāo)簽： 68013a cmos fpga usb

上傳時間： 2013-08-21

上傳用戶：半熟1994