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IP內(nèi)(nèi)核

經(jīng)過門級網(wǎng)單驗證的USB2.0 IP核 RTL代碼

經(jīng)過門級網(wǎng)單驗證的USB2.0 IP核 RTL代碼

標(biāo)簽： USB 2.0 RTL 門級

上傳時間： 2014-01-06

上傳用戶：heart520beat
摘要探討了IP 核的驗證與測試的方法及其和 VHDL語言在 IC 設(shè)計中的應(yīng)用并給出了其在RISC8 框架 CPU 核中的下載實例．

摘要探討了IP 核的驗證與測試的方法及其和 VHDL語言在 IC 設(shè)計中的應(yīng)用并給出了其在RISC8 框架 CPU 核中的下載實例．

標(biāo)簽： RISC8 VHDL CPU IC

上傳時間： 2014-07-11

上傳用戶：lunshaomo
soc中ip核集成時所采用的一種片上總線

soc中ip核集成時所采用的一種片上總線，開發(fā)的，為opencores所采用，wishbone片上總線指南

標(biāo)簽： soc 集成片上總線

上傳時間： 2014-01-23

上傳用戶：colinal
fpga 8051單片機(jī)IP核。This is version 1.3 of the MC8051 IP core

fpga 8051單片機(jī)IP核。This is version 1.3 of the MC8051 IP core

標(biāo)簽： 8051 version fpga This

上傳時間： 2015-06-12

上傳用戶：waitingfy
A率/u率壓縮與解壓縮的IP核

A率/u率壓縮與解壓縮的IP核，。 # 由AHDL語言寫成，可在MaxplusII和QuartusII中使用，源代碼加密。

標(biāo)簽： A率解壓 IP核

上傳時間： 2015-06-19

上傳用戶：aysyzxzm
本文件是altera公司fpga的ip核

本文件是altera公司fpga的ip核，從國外網(wǎng)站下載的免費(fèi)源碼。

標(biāo)簽： altera fpga

上傳時間： 2015-06-20

上傳用戶：qw12
ATA接口的IP核,經(jīng)過量產(chǎn)的驗證,已經(jīng)在quartus5.1下編譯通過了.

ATA接口的IP核,經(jīng)過量產(chǎn)的驗證,已經(jīng)在quartus5.1下編譯通過了.

標(biāo)簽： quartus ATA 5.1 接口

上傳時間： 2014-01-17

上傳用戶：xz85592677
DMA的控制器的IP核,和ATA控制器配合,可以實現(xiàn)DMA方式高速傳輸數(shù)據(jù).

DMA的控制器的IP核,和ATA控制器配合,可以實現(xiàn)DMA方式高速傳輸數(shù)據(jù).

標(biāo)簽： DMA ATA 控制器 IP核

上傳時間： 2014-05-30

上傳用戶：zhaiyanzhong
關(guān)于FPGA的一些常識及含IP核的VHDL設(shè)計源代碼。

關(guān)于FPGA的一些常識及含IP核的VHDL設(shè)計源代碼。

標(biāo)簽： FPGA VHDL 常識 IP核

上傳時間： 2013-12-11

上傳用戶：xmsmh
VHDL中IP核之參數(shù)化觸發(fā)器中文使用介紹

VHDL中IP核之參數(shù)化觸發(fā)器中文使用介紹

標(biāo)簽： VHDL IP核參數(shù) 觸發(fā)器

上傳時間： 2014-01-16

上傳用戶：宋桃子