可以嵌入任何的fpga中的mc8051cpu IP核，
上傳時間： 2013-05-27
上傳用戶：cjl42111
本文深入研究了Nios 自定制指令的軟硬件接口，基于Altera 的IP 核FFT V2.2.0實現了變換長度為1024 點的高速復數FFT 算法，提出了一種在Nios 嵌入式系統中定制用戶FFT 算
上傳時間： 2013-04-24
上傳用戶：hfmm633
SoC(System On a Chip)又稱為片上系統，是指將微處理器、模擬IP核、數字IP核和存儲器（或片外存儲器接口）集成在單一芯片上。SoC產品不斷朝著體積小、功能強的方向發展，芯片內部整合越來越多的功能。ARM架構作為嵌入式系統流行的應用，其應用的擴展面臨軟件擴充的問題，而X86平臺上卻有很多軟件資源。若將已有的X86軟件移植到ARM平臺，則可以在一定程度上解決軟件擴充的問題。 本論文針對X86指令在ARM中兼容的應用，以智能手機的應用為例，提出了基于ARM嵌入式平臺，使用X86指令到ARM指令的二進制翻譯模塊，達到對X86指令的兼容。主要研究ARM公司的片上總線系統——AMBA AHB和AMBA APB片上總線標準。對Multi-layer總線結構進行研究，分析了Multi-layer AHB系統中使用的Bus Matrix模塊的結構，從Bus Matrix模塊的內部矩陣結構和系統架構兩方面針對系統的特點作出優化。 最后介紹了論文采用的事物級模型與Verilog HDL協同仿真的方法和系統的控制過程，通過仿真結果的比較，驗證了利用二進制翻譯模塊實現X86指令執行的可行性和優化后的架構較適合于X86翻譯系統的應用。
上傳時間： 2013-06-28
上傳用戶：釣鰲牧馬
正交頻分復用(Orthogonal Frequency Division Multiplexing，OFDM)技術是一種多載波傳輸技術，它的基本思想是在頻域內將給定信道劃分成幾個相互正交的子信道，每個子信道使用一個子載波進行調制，各子載波并行傳輸。該技術可以有效提高頻譜利用率，能夠對抗多徑效應產生的頻率選擇性衰弱和載波間干擾，在時變、頻變、多徑干擾嚴重的水聲信道中具有較強的優勢。 隨著計算機和多媒體通信技術的發展，嵌入式系統在各個領域的應用不斷深入。其中，基于ARM技術知識產權(IP)核的微處理器依靠其高性能、低功耗和易擴展的特點，在工業控制、無線通信、消費電子等多個領域得到廣泛的應用；隨著嵌入式系統復雜度的提高，操作系統已成為嵌入式系統不可缺少的一部分。其中，嵌入式Linux憑借免費開源、功能強大、成熟穩定等特點，目前已成為主要的嵌入式操作系統之一。 數字信號處理器(Digital Signal Processor，DSP)具有很強的數字信號處理能力，可以滿足各種高實時要求，但其尋址范圍小，I/O功能較差。ARM+DSP雙處理器的結構可以充分利用ARM和DSP各自的優勢實現協同工作。 本論文的主要工作是研究和實現一個基于OFDM技術的由ARM+DSP硬件平臺實現的能夠完成水下聲信道圖像傳輸的系統。主要研究內容包括OFDM系統的基本原理、ARM+DSP底層硬件的驅動和控制，Linux操作系統的移植、MiniGUI人機界面的設計、相關應用軟件的編寫以及在TMS320VC5502上初步實現OFDM的調制解調，以期對今后水下圖像傳輸系統的實現能具有較大的參考價值。
上傳時間： 2013-05-20
上傳用戶：Ruzzcoy
無線局域網(WLAN,Wireless Local Area Network)是未來移動通信系統的重要組成部分.為了滿足用戶高速率、方便靈活的接入互聯網的需求,WLAN的研究和建設正在世界范圍內如火如荼的展開.由于擺脫了有線連接的束縛,無線局域網具有移動性好、成本低和不會出現線纜故障等特點.該文對無線局域網的主流協議IEEE 802.11a的物理層實現技術進行了系統的研究和分析,并采用可編程ASIC器件FPGA,設計實現了物理層基帶處理的關鍵模塊,為今后形成具有自主知識產權的IP核奠定了基礎.該文研究內容得到了天津市信息化辦公室"寬帶無線局域網關鍵技術研究"項目經費的支持.該文在對IEEE 802.11a協議深入研究的基礎上,提出了物理層的實現方案和功能模塊劃分.重點研究了實現基帶處理的關鍵模塊:FIR濾波器、卷積碼編碼器以及(2,1,7)Viterbi譯碼器的實現算法和硬件結構.在Viterbi譯碼器的設計中,
上傳時間： 2013-06-19
上傳用戶：xinzhch
隨著集成電路技術的飛速發展，芯片的規模越來越大，集成度越來越高，工作頻率越來越快，但是芯片的設計能力卻面臨巨大的挑戰。而IP核的重用則是解決當今芯片設計所面臨問題的最有效的解決方法。 MDIO接口模塊為以太網接口芯片中MAC層對PHY器件的控制管理接口。隨著以太網技術的快速發展以及MAC應用越來越廣泛，MDIO接口模塊的應用也越來越多，因此將MDIO接口模塊設計成可重用的IP核對于以各種太網接口集成芯片的設計具有很重要的作用。 本文詳細描述了MDIO接口模塊IP核的設計，介紹了該IP核的系統結構以及各個子模塊的詳細設計方法，對此IP核進行了仿真驗證，最后進行了FPGA測試，功能和性能達到了要求，最終通過了IP審核流程并且已成功應用于企業的以太網接口芯片中。
上傳時間： 2013-07-20
上傳用戶：nanfeicui
加密算法一直在信息安全領域起著極其重要的作用,它直接影響著國家的安全和發展.隨著計算機技術的飛速發展,原有的數據加密標準(DES)已不能滿足人們的保密要求.在未來的20年內,高級數據加密標準(AES)將替代DES成為新的數據加密標準.在不對原有應用系統作大的改動的情況下,3-DES算法有了很大的生存空間.該文介紹了DES和3-DES算法的概要,給出了一種電路實現模型,并基于XILINX公司的FPGA器件設計了IP核,介紹了I P核設計中主要模塊的設計方法.最后對該IP核進行了分析,給出它的性能參數.該課題系統地論述了基3-DES算法的密碼IP核設計全過程.文章首先闡述了該設計的課題背景,給出了使用VHDL方法設計密碼電路的特點和研究思路和特點,然后對IP核的設計環境和密碼算法進行了介紹.在此基礎上,詳細討論了3-DES算法的密碼芯片設計方法和各個電路模塊實現的結構圖,包括算法電路、譯碼電路、接口電路和控制模塊電路等.通過對各個模塊設計的介紹,闡明了使用VHDL語言設計專用集成電路的原理和特點.
上傳時間： 2013-04-24
上傳用戶：萌萌噠小森森
隨著電子技術和信息技術的發展，可編程邏輯器件的應用領域越來越寬。可編程SoC設計已成為SoC設計的新方法。論文介紹了可編程邏輯器件的設計方法和開發技術，并用硬件描述語言和FPGA／CPLD設計技術，探索和研究了基于FPGA的RISCMCU的設計與實現過程。 論文參照Mircochip公司的PICl6C5X單片機的體系結構，設計了8位RISCMCU。該嵌入式MCU設計采用了自頂向下的設計方法和模塊化設計思想。MCU總體結構設計劃分控制模塊、ALU模塊、存儲模塊三大模塊。然后，對各模塊的具體技術實現細節分別進行了闡述。論文中設計的MCU能實現PICl6C5X單片機33條指令中除OPTION、CLRWDT、SLEEP和TRIS四條指令以外的其余29條指令的功能，但應用是基于FPGA的，能與其他外設IP方便的結合在一起使用，比ASIC的PICl6C57X的應用更具靈活性。 軟件仿真和硬件驗證表明：所設計的嵌入式MCU在各方面均達到了一定的性能指標，在Altera公司ACEX1K系列的EPlK30TCl44-3器件上的工作頻率達21.88MHz。這些為自主設計R／SCMCU的IP核提供了值得借鑒的探索成果和設計思路，在通用控制領域也有一定的實用價值。 此外，論文中還介紹了三相SPWM控制模塊的設計，該模塊具有死區時間和載波比任意可調的特點，可以單獨應用，也可以作為MCU的外設子模塊應用。
上傳時間： 2013-07-16
上傳用戶：熊少鋒
本文主要介紹了如何運用可編程邏輯器件(FPGA)實現電機的變頻調速控制系統。 目前，電機控制芯片主要有兩種選擇。一種是專用集成芯片(ASIC)，一種是單片機(MCU)或數字信號處理器(DSP)。而FPGA的數字資源豐富、工作頻率高、可在系統編程等特點使得開發靈活、開發周期相對短，可以取代前二種通用的方式。本文利用80C196KC和FPGA控制感應電機，簡化了硬件和軟件設計，并充分利用了FPGA的快速性，利用FPGA，除本身可以用來控制電機以外：可以制成通用的“IP核”應用到MCU(或DSP)，或是作為片內外設，這樣就節約了片內資源；另外，它還是ASIC設計的驗證的必經階段，這是本文選題和工作的意義。本文設計的FPGA調速控制系統以及2個IP核，下載到芯片，通過驗證。 本文第一章緒論介紹了可編程邏輯器件的發展、應用，以及EDA的發展歷程，還介紹了ASIC等。針對FPGA的快速發展，論述了它在變頻調速技術應用中的優勢。 第二章介紹了交流電動機變頻調速技術及其相關技術的發展和應用情況。著重介紹了電壓空間矢量調制方式，以及矢量控制技術、技術發展。 第三章詳細介紹了SVPWM調速系統整個系統的FPGA設計，給出了設計思路、具體方案、邏輯時序分析；最后給出了軟件仿真結果和實驗波形對照。文中還給出了SVPWM調速系統運用的FPGA設計結果，驅動電機，得到實驗波形。論證了FPGA在調速系統應用中的可行性和意義。 第四章介紹了作者針對課題相關的一些內容所設計出的IP核，給出的實驗結果等。 論文最后，對本課題所做的工作進行了簡單的總結。
上傳時間： 2013-04-24
上傳用戶：zhaiyanzhong
卷積碼是無線通信系統中廣泛使用的一種信道編碼方式。Viterbi譯碼算法是一種卷積碼的最大似然譯碼算法，它具有譯碼效率高、速度快等特點，被認為是卷積碼的最佳譯碼算法。本文的主要內容是在FPGA上實現約束長度為9，碼率為1/2，采用軟判決方式的Viterbi譯碼器。 本文首先介紹了卷積碼的基本概念，闡述了Viterbi算法的原理，重點討論了決定Viterbi算法復雜度和譯碼性能的關鍵因素，在此基礎上設計了采用“串-并”結合運算方式的Viterbi譯碼器，并在Altera EP1C20 FPGA芯片上測試通過。本文的主要工作如下： 1.對輸入數據采用了二比特四電平量化的軟判決方式，對歐氏距離的計算方法進行了簡化，以便于用硬件電路方式實現。 2.對ACS運算單元采用了“串-并”結合的運算方式，和全并行的設計相比，在滿足譯碼速度的同時，節約了芯片資源。本文中提出了一種路徑度量值存儲器的組織方式，簡化了控制模塊的邏輯電路，優化了系統的時序。 3.在幸存路徑的選擇輸出上采用了回溯譯碼方法，與傳統的寄存器交換法相比，減少了寄存器的使用，大大降低了功耗和設計的復雜度。 4.本文中設計了一個仿真平臺，采用Modelsim仿真器對設計進行了功能仿真，結果完全正確。同時提出了一種在被測設計內部插入監視器的調試方法，巧妙地利用了Matlab算法仿真程序的輸出結果，提高了追蹤錯誤的效率。 5.該設計在Altera EP1C20 FPGA芯片上通過測試，最大運行時鐘頻率110MHz，最大譯碼輸出速率10.3Mbps。 本文對譯碼器的綜合結果和Altera設計的Viterbi譯碼器IP核進行了性能比較，比較結果證明本文中設計的Viterbi譯碼器具有很高的工程實用價值。
上傳時間： 2013-07-23
上傳用戶：葉山豪
