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該論文闡述了用于硬件信號處理的基于4基數(shù)12點快速傅立葉變換的VHDL核的設(shè)計過程。作者：Vite-Frias Jose Alberto、Romero-Troncoso Rene de Jesus、O

該論文闡述了用于硬件信號處理的基于4基數(shù)12點快速傅立葉變換的VHDL核的設(shè)計過程。作者：Vite-Frias Jose Alberto、Romero-Troncoso Rene de Jesus、Ordaz-Moreno

標(biāo)簽： Romero-Troncoso Vite-Frias Alberto Jesus

上傳時間： 2014-01-23

上傳用戶：xmsmh