針對(duì)傳統(tǒng)的Max-Log-map譯碼算法時(shí)效性差、存儲(chǔ)空間開銷大的特點(diǎn)，本文對(duì)傳統(tǒng)的Max-Log-map譯碼算法進(jìn)行了改進(jìn)。改進(jìn)的算法對(duì)前、后向度量使用了蝶形結(jié)構(gòu)圖，便于DSP實(shí)現(xiàn)；將原始幀均分為多個(gè)子塊，設(shè)計(jì)子塊間的并行運(yùn)算以減小系統(tǒng)延遲；子塊內(nèi)采取進(jìn)一步地優(yōu)化措施，以減小數(shù)據(jù)存儲(chǔ)量并提高譯碼速率。在DSP C6416平臺(tái)上的仿真結(jié)果表明了算法的可實(shí)現(xiàn)性與可靠性。
標(biāo)簽： Max-Log-map DSP 譯碼算法
上傳時(shí)間： 2013-11-08
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程序包括Turbo 碼的編碼與譯碼算法.Turbo 碼譯碼算法包括Log-map和SOVA.
標(biāo)簽： Turbo Log-map SOVA 譯碼算法
上傳時(shí)間： 2014-01-08
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這是Log-map或者說(shuō)是軟輸出維特比算法的一個(gè)實(shí)現(xiàn)。
上傳時(shí)間： 2015-04-18
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基于logmap算法的vhdl的實(shí)現(xiàn)。 通信系統(tǒng)的log—map算法數(shù)字vhdl的實(shí)現(xiàn)
上傳時(shí)間： 2015-05-18
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turbo code Log-map descdent decode
標(biāo)簽： descdent Log-map decode turbo
上傳時(shí)間： 2016-01-13
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Max Log MAP decoding
標(biāo)簽： decoding Max Log MAP
上傳時(shí)間： 2017-04-12
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max-Log-map算法的C語(yǔ)言的實(shí)現(xiàn)，能計(jì)算出所需要的LLR，做出軟判決和硬判決。
標(biāo)簽： max-Log-map C語(yǔ)言 算法
上傳時(shí)間： 2017-06-10
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max-Log-map,DVB-RCS,Turbo,譯碼,程序
標(biāo)簽： max-Log-map DVB-RCS Turbo 譯碼 程序
上傳時(shí)間： 2018-12-20
上傳用戶：digitallife_wj
采用 DVB反向鏈路（DVB-RCS）標(biāo)準(zhǔn)中的雙二元Turbo碼matlab仿真程序和仿真結(jié)果。支持1/2和1/3碼率。支持MAP，Log-map解碼算法。
標(biāo)簽： DVB-RCS matlab Turbo DVB
上傳時(shí)間： 2015-11-19
上傳用戶：xhz1993
Turbo碼是一類并行級(jí)聯(lián)的系統(tǒng)卷積碼，它是在綜合級(jí)聯(lián)碼、最大后驗(yàn)概率(MAP)譯碼、軟輸入軟輸出及迭代譯碼等理論基礎(chǔ)上的一種創(chuàng)新。Turbo碼的基本原理是通過(guò)對(duì)編碼器結(jié)構(gòu)的巧妙設(shè)計(jì)，多個(gè)子碼通過(guò)交織器隔離進(jìn)行并行級(jí)聯(lián)編碼輸出，增大了碼距。譯碼器則以類似內(nèi)燃機(jī)引擎廢氣反復(fù)利用的機(jī)理進(jìn)行迭代譯碼以反復(fù)利用有效信息流，從而獲得卓越的糾錯(cuò)能力。計(jì)算機(jī)仿真表明，Turbo碼不但在加性高斯噪聲信道下性能優(yōu)越，而且具有很強(qiáng)的抗衰落、抗干擾能力，當(dāng)交織長(zhǎng)度足夠長(zhǎng)時(shí)，其糾錯(cuò)性能接近香農(nóng)極限。 FPGA(FieldProgrammableGateArray)，即現(xiàn)場(chǎng)可編程門陣列，是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。FPGA技術(shù)具有大規(guī)模、高集成度、高可靠性、設(shè)計(jì)周期短、投資小、靈活性強(qiáng)等優(yōu)點(diǎn)，逐步成為復(fù)雜數(shù)字硬件電路設(shè)計(jì)的理想選擇。 本論文以東南大學(xué)移動(dòng)通信實(shí)驗(yàn)室B3G課題組提出的“支持多天線的廣義多載波無(wú)線傳輸技術(shù)”(MIMO-GMC)為背景，分析了Turbo譯碼算法，并針對(duì)MIMO-GMC系統(tǒng)的迭代接收機(jī)中所采用的外信息保留和聯(lián)合檢測(cè)譯碼迭代的特點(diǎn)，完成了采用滑動(dòng)窗Log-map算法的軟輸入、軟輸出的Turbo譯碼器的設(shè)計(jì)。整個(gè)譯碼器模塊的設(shè)計(jì)采用Verilog語(yǔ)言描述，并在VirtexⅡPro系列FPGA芯片上實(shí)現(xiàn)。
上傳時(shí)間： 2013-04-24
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