針對傳統(tǒng)的MAx-log-map譯碼算法時效性差、存儲空間開銷大的特點(diǎn)，本文對傳統(tǒng)的MAx-log-map譯碼算法進(jìn)行了改進(jìn)。改進(jìn)的算法對前、后向度量使用了蝶形結(jié)構(gòu)圖，便于DSP實(shí)現(xiàn)；將原始幀均分為多個子塊，設(shè)計子塊間的并行運(yùn)算以減小系統(tǒng)延遲；子塊內(nèi)采取進(jìn)一步地優(yōu)化措施，以減小數(shù)據(jù)存儲量并提高譯碼速率。在DSP C6416平臺上的仿真結(jié)果表明了算法的可實(shí)現(xiàn)性與可靠性。
標(biāo)簽： MAx-log-map DSP 譯碼算法
上傳時間： 2013-11-08
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Max Log MAP decoding
標(biāo)簽： decoding Max Log MAP
上傳時間： 2017-04-12
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MAx-log-map算法的C語言的實(shí)現(xiàn)，能計算出所需要的LLR，做出軟判決和硬判決。
標(biāo)簽： MAx-log-map C語言 算法
上傳時間： 2017-06-10
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MAx-log-map,DVB-RCS,Turbo,譯碼,程序
標(biāo)簽： MAx-log-map DVB-RCS Turbo 譯碼 程序
上傳時間： 2018-12-20
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程序包括Turbo 碼的編碼與譯碼算法.Turbo 碼譯碼算法包括LOG-MAP和SOVA.
標(biāo)簽： Turbo LOG-MAP SOVA 譯碼算法
上傳時間： 2014-01-08
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這是log-map或者說是軟輸出維特比算法的一個實(shí)現(xiàn)。
上傳時間： 2015-04-18
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基于logmap算法的vhdl的實(shí)現(xiàn)。 通信系統(tǒng)的log—map算法數(shù)字vhdl的實(shí)現(xiàn)
上傳時間： 2015-05-18
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turbo code log-map descdent decode
標(biāo)簽： descdent log-map decode turbo
上傳時間： 2016-01-13
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本文以Turbo碼譯碼器的FPGA實(shí)現(xiàn)為目標(biāo)，對Turbo碼的迭代譯碼算法及用硬件語言實(shí)現(xiàn)其譯碼算法進(jìn)行了深入研究。 本文首先在理論上對Turbo碼的編譯碼原理進(jìn)行了深入的研究，并用C語言對其MAP譯碼算法進(jìn)行了驗證仿真，接著就Turbo碼MAP算法的衍生算法即LOG_MAP和MAX_LOG_MAP算法用C程序做了仿真和測試。隨后本文就一些對MAP譯碼性能起著重要影響的參數(shù)也用C程序做了仿真對比。 最后，考慮到硬件實(shí)現(xiàn)的簡化，MAx-log-map算法成為了本文的硬件實(shí)現(xiàn)方案。本文采用了模塊化設(shè)計，在對各個模塊進(jìn)行設(shè)計的基礎(chǔ)上提出了一些改進(jìn)的方案，對Turbo碼編碼器設(shè)計中的同步問題進(jìn)行了改進(jìn)，對分塊并行Turbo碼譯碼算法的硬件實(shí)現(xiàn)進(jìn)行了研究。在設(shè)計中綜合運(yùn)用了“自頂向下”和“自下而上”的設(shè)計方去，通過功能模塊分割，合理設(shè)置系統(tǒng)參數(shù)，并通過模塊之間的參數(shù)傳遞，使Turbo碼編譯碼器具有較好的靈活性。
上傳時間： 2013-04-24
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在通信系統(tǒng)中，人們一直致力于信息傳輸?shù)挠行院涂煽啃缘难芯浚诺兰m錯編碼技術(shù)一直是人們研究的重點(diǎn)。1993年，Turbo碼的提出，以其接近Shannon極限的優(yōu)異的譯碼性能在編碼界引起了轟動，并成為研究糾錯編碼的熱點(diǎn)課題。經(jīng)過十幾年的研究和發(fā)展，目前，Turbo碼已經(jīng)走向了實(shí)用化的道路，如何用硬件實(shí)現(xiàn)有效的Turbo碼編譯碼器成為了人們研究的重點(diǎn)。 論文以基于FPGA實(shí)現(xiàn)Turbo碼譯碼器為研究目標(biāo)，首先分析了Turbo碼的基本編譯碼原理和3GPP標(biāo)準(zhǔn)的Turbo碼編碼結(jié)構(gòu)和交織算法。然后重點(diǎn)分析了MAP譯碼算法，Log-MAP譯碼算法和：MAx-log-map譯碼算法，并對三種譯碼算法進(jìn)行了詳細(xì)的理論推導(dǎo)和計算復(fù)雜度的定量分析比較，對影響Turbo碼譯碼性能的主要因素進(jìn)行了MATLB仿真分析。 論文在深入分析比較上述三種譯碼算法的基礎(chǔ)之上，選擇MAx-log-map譯碼算法進(jìn)行了Turbo碼譯碼器的FPGA設(shè)計實(shí)現(xiàn)。主要針對FPGA實(shí)現(xiàn)的數(shù)據(jù)量化、定點(diǎn)數(shù)據(jù)表示方式、MAx-log-map算法子譯碼器關(guān)鍵運(yùn)算單元的FPGA設(shè)計和基于3GPP標(biāo)準(zhǔn)的Turbo碼譯碼器的內(nèi)交織的FPGA設(shè)計進(jìn)行了深入研究，完成了固定譯碼長度的Turbo碼譯碼器的FPGA設(shè)計實(shí)現(xiàn)，并利用ModelSim和MATLAB分別對譯碼器進(jìn)行了功能時序驗證和FPGA定點(diǎn)仿真測試。
上傳時間： 2013-07-09
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