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OPC 通信測試

OPC 通信測試

OPC client 和 OPC server 測試軟件

標簽： OPC 通信測試

上傳時間： 2015-03-13

上傳用戶：小小秋麗
LED電源驅動器測試解決方案

發光二極體(Light Emitting Diode, LED)為半導體發光之固態光源。它成為具省電、輕巧、壽命長、環保(不含汞)等優點之新世代照明光源。目前LED已開始應用於液晶顯示

標簽： LED 電源方案驅動器

上傳時間： 2013-04-24

上傳用戶：王慶才
pcb layout design(臺灣硬件工程師15年經驗

PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD，不管是否鑽孔、電鍍。5. BOTTOM PAD：在銲錫面上所設計之零件腳PAD，不管是否鑽孔、電鍍。6. POSITIVE LAYER：單、雙層板之各層線路；多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER：通常指多層板之電源層。8. INNER PAD：多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD：多層板之NEGATIVE LAYER 上所使用之絕緣範圍，不與零件腳相接。10. THERMAL PAD：多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD，一般稱為散熱孔或導通孔。11. PAD (銲墊)：除了SMD PAD 外，其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點)，其原則如下：1. 一般測試點大小均為30-35mil，元件分布較密時，測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil，一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上，避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

標簽： layout design pcb 硬件工程師

上傳時間： 2013-10-22

上傳用戶：pei5
pcb layout規則

LAYOUT REPORT .............. 1 目錄.................. 1 1. PCB LAYOUT 術語解釋(TERMS)......... 2 2. Test Point : ATE 測試點供工廠ICT 測試治具使用............ 2 3. 基準點 (光學點) -for SMD:........... 4 4. 標記 (LABEL ING)......... 5 5. VIA HOLE PAD................. 5 6. PCB Layer 排列方式...... 5 7.零件佈置注意事項 (PLACEMENT NOTES)............... 5 8. PCB LAYOUT 設計............ 6 9. Transmission Line ( 傳輸線 )..... 8 10.General Guidelines – 跨Plane.. 8 11. General Guidelines – 繞線....... 9 12. General Guidelines – Damping Resistor. 10 13. General Guidelines - RJ45 to Transformer................. 10 14. Clock Routing Guideline........... 12 15. OSC & CRYSTAL Guideline........... 12 16. CPU

標簽： layout pcb

上傳時間： 2013-12-20

上傳用戶：康郎
透過MOSFET電壓電流最佳化控制傳導性及輻射性EMI

經由改變外部閘極電阻(gate resistors)或增加一個跨在汲極(drain)和源極(source)的小電容來調整MOSFET的di/dt和dv/dt，去觀察它們如何對EMI產生影響。然後我們可了解到如何在效率和EMI之間取得平衡。我們拿一個有著單組輸出+12V/4.1A及初級側MOSFET AOTF11C60 (αMOSII/11A/600V/TO220F) 的50W電源轉接器(adapter)來做傳導性及輻射性EMI測試。

標簽： MOSFET EMI 電壓電流控制

上傳時間： 2014-09-08

上傳用戶：swing
基于OMAP1510的mp3播放器設計

　　第一章序論……………………………………………………………6 　　1- 1 研究動機…………………………………………………………..7 　　1- 2 專題目標…………………………………………………………..8 　　1- 3 工作流程…………………………………………………………..9 　　1- 4 開發環境與設備…………………………………………………10 　　第二章德州儀器OMAP 開發套件…………………………………10 　　2- 1 OMAP介紹………………………………………………………10 　　2-1.1 OMAP是什麼?…….………………………………….…10 　　2-1.2 DSP的優點……………………………………………....11 　　2- 2 OMAP Architecture介紹………………………………………...12 　　2-2-1 OMAP1510 硬體架構………………………………….…12 　　2-2.2 OMAP1510軟體架構……………………………………...12 　　2-2.3 DSP / BIOS Bridge簡述…………………………………...13 　　2- 3 TI Innovator套件 -- OMAP1510 ……………………………..14 　　2-2.1 General Purpose processor -- ARM925T………………...14 　　2-2.2 DSP processor -- TMS320C55x …………………………15 　　2-2.3 IDE Tool – CCS …………………………………………15 　　2-2.4 Peripheral ………………………………………………..16 　　第三章在OMAP1510上建構Embedded Linux System…………….17 　　3- 1 嵌入式工具………………………………………………………17 　　3-1.1 嵌入式程式開發與一般程式開發之不同………….….17 　　3-1.2 Cross Compiling的GNU工具程式……………………18 　　3-1.3 建立ARM-Linux Cross-Compiling 工具程式………...19 　　3-1.4 Serial Communication Program………………………...20 　　3- 2 Porting kernel………………………………………………….…21 　　3-2.1 Setup CCS ………………………………………….…..21 　　3-2.2 編譯及上傳Loader…………………………………..…23 　　3-2.3 編譯及上傳Kernel…………………………………..…24 　　3- 3 建構Root File System………………………………………..…..26 　　3-3.1 Flash ROM……………………………………………...26 　　3-3.2 NFS mounting…………………………………………..27 　　3-3.3 支援NFS Mounting 的kernel…………………………..27 　　3-3.4 提供NFS Mounting Service……………………………29 　　3-3.5 DHCP Server……………………………………………31 　　3-3.6 Linux root 檔案系統……………………………….…..32 　　3- 4 啟動及測試Innovator音效裝置…………………………..…….33 　　3- 5 建構支援DSP processor的環境…………………………...……34 　　3-5.1 Solution -- DSP Gateway簡介……………………..…34 　　3-5.2 DSP Gateway運作架構…………………………..…..35 　　3- 6 架設DSP Gateway………………………………………….…36 　　3-6.1 重編kernel……………………………………………...36 　　3-6.2 DEVFS driver…………………………………….……..36 　　3-6.3 編譯DSP tool和API……………………………..…….37 　　3-6.4 測試……………………………………………….…….37 　　第四章 MP3 Player……………………………………………….…..38 　　4- 1 MP3 介紹………………………………………………….…….38 　　4- 2 MP3 壓縮原理……………………………………………….….39 　　4- 3 Linux MP3 player – splay………………………………….…….41 　　4.3-1 splay介紹…………………………………………….…..41 　　4.3-2 splay 編譯………………………………………….…….41 　　4.3-3 splay 的使用說明………………………………….……41 　　第五章程式改寫………………………………………………...…...42 　　5-1 程式評估與改寫………………………………………………...…42 　　5-1.1 Inter-Processor Communication Scheme…………….....42 　　5-1.2 ARM part programming……………………………..…42 　　5-1.3 DSP part programming………………………………....42 　　5-2 程式碼………………………………………………………..……43 　　5-3 雙處理器程式開發注意事項…………………………………...…47 　　第六章效能評估與討論……………………………………………48 　　6-1 速度……………………………………………………………...48 　　6-2 CPU負載………………………………………………………..49 　　6-3 討論……………………………………………………………...49 　　6-3.1分工處理的經濟效益………………………………...49 　　6-3.2音質v.s 浮點與定點運算………………………..…..49 　　6-3.3 DSP Gateway架構的限制………………………….…50 　　6-3.4減少IO溝通……………….………………………….50 　　6-3.5網路掛載File System的Delay…………………..……51 　　第七章結論心得…

標簽： OMAP 1510 mp3 播放器

上傳時間： 2013-10-14

上傳用戶：a471778
了解軟體設計RF儀器的優點

本技術文章將介紹如何運用 NI LabVIEW FPGA 來設計並客製化個人的 RF 儀器，同時探索軟體設計儀器可為測試系統所提供的優勢。

標簽： 軟體 RF儀器

上傳時間： 2013-11-24

上傳用戶：toyoad
ICT知識簡介

全面介紹ICT測試技術

標簽： ICT

上傳時間： 2013-11-18

上傳用戶：lchjng
ICT知識簡介

全面介紹ICT測試技術

標簽： ICT

上傳時間： 2013-11-07

上傳用戶：xfbs821
pcb layout design(臺灣硬件工程師15年經驗

PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD，不管是否鑽孔、電鍍。5. BOTTOM PAD：在銲錫面上所設計之零件腳PAD，不管是否鑽孔、電鍍。6. POSITIVE LAYER：單、雙層板之各層線路；多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER：通常指多層板之電源層。8. INNER PAD：多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD：多層板之NEGATIVE LAYER 上所使用之絕緣範圍，不與零件腳相接。10. THERMAL PAD：多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD，一般稱為散熱孔或導通孔。11. PAD (銲墊)：除了SMD PAD 外，其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點)，其原則如下：1. 一般測試點大小均為30-35mil，元件分布較密時，測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil，一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上，避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

標簽： layout design pcb 硬件工程師

上傳時間： 2013-11-17

上傳用戶：cjf0304