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PLD-N

  • 基于N溝道MOS管H橋驅動電路設計與制作

    基于N溝道MOS管H橋驅動電路設計與制作

    標簽: MOS N溝道 H橋驅動 電路設計

    上傳時間: 2014-08-01

    上傳用戶:1109003457

  • 采用歸零法的N進制計數器原理

    計數器是一種重要的時序邏輯電路,廣泛應用于各類數字系統中。介紹以集成計數器74LS161和74LS160為基礎,用歸零法設計N進制計數器的原理與步驟。用此方法設計了3種36進制計數器,并用Multisim10軟件進行仿真。計算機仿真結果表明設計的計數器實現了36進制計數的功能。基于集成計數器的N進制計數器設計方法簡單、可行,運用Multisim 10進行電子電路設計和仿真具有省時、低成本、高效率的優越性。

    標簽: 歸零法 N進制計數器原

    上傳時間: 2013-10-11

    上傳用戶:gtzj

  • p-n結的隧道擊穿模型研究

    在理論模型的基礎上探討了電子勢壘的形狀以及勢壘形狀隨外加電壓的變化, 并進行定量計算, 得出隧穿電壓隨雜質摻雜濃度的變化規律。所得結論與硅、鍺p-n 結實驗數據相吻合, 證明了所建立的理論模型在定量 研究p-n 結的隧道擊穿中的合理性與實用性。該理論模型對研究一般材料或器件的隧道擊穿具有重要的借鑒意義。

    標簽: p-n 隧道 擊穿 模型研究

    上傳時間: 2013-10-31

    上傳用戶:summery

  • N+緩沖層對PT-IGBT通態壓降影響的研究

     N+緩沖層設計對PT-IGBT器件特性的影響至關重要。文中利用Silvaco軟件對PT-IGBT的I-V特性進行仿真。提取相同電流密度下,不同N+緩沖層摻雜濃度PT-IGBT的通態壓降,得到了通態壓降隨N+緩沖層摻雜濃度變化的曲線,該仿真結果與理論分析一致。對于PT-IGBT結構,N+緩沖層濃度及厚度存在最優值,只要合理的選取可以有效地降低通態壓降。

    標簽: PT-IGBT 緩沖層

    上傳時間: 2013-11-12

    上傳用戶:thesk123

  • (N+X)熱插拔模塊并聯逆變電源應用前景

    隨著我國通信、電力事業的發展,通信、電力網絡的規模越來越大,系統越來越復雜。與之相應的對交流供電的可靠性、靈活性、智能化、免維護越來越重要。在中國通信、電力網絡中,傳統的交流供電方案是以UPS或單機式逆變器提供純凈不間斷的交流電源。由于控制技術的進步、完善,(N+X)熱插拔模塊并聯逆變電源已經非常成熟、可靠;在歐美的通信、電力發達的國家,各大通信運營商、電力供應商、軍隊均大量應用了這種更合理的供電方案。與其它方案相比較,(N+X)熱插拔模塊并聯逆變電源具有以下明顯的優點。

    標簽: 熱插拔 模塊 并聯 應用前景

    上傳時間: 2014-03-24

    上傳用戶:alan-ee

  • 51單片機串口發N字節

    適用于51單片機的串口發n

    標簽: 51單片機 串口 字節

    上傳時間: 2014-12-25

    上傳用戶:qingzhuhu

  • 一種用N+1條線實現矩陣鍵盤

    89c51一種用N+1條線實現矩陣鍵盤

    標簽: 矩陣鍵盤

    上傳時間: 2014-12-26

    上傳用戶:lhw888

  • 以PLD器件實現自動掃描去抖的編碼鍵盤設計

    以PLD器件實現自動掃描去抖的編碼鍵盤設計:鍵盤在單片機控制系統中是最常用的輸入設備之一。雖然非編碼鍵盤的硬件電路較為簡單,但按鍵的識別及鍵值的計算則需軟件來完成,因此需要耗費寶貴的機時;而編碼鍵盤雖然程序簡單且易于使用,但硬件比較復雜。因此,設計人員常常難以決定采用哪一類鍵盤。本文以GAL6002為例,介紹了一種用PLD器件來實現4X4鍵盤自動掃描去抖的編碼鍵盤電路及其設計方法。

    標簽: PLD 器件 去抖 自動

    上傳時間: 2013-10-17

    上傳用戶:yangbo69

  • 用單片機配置FPGA—PLD設計技巧

    用單片機配置FPGA—PLD設計技巧 Configuration/Program Method for Altera Device Configure the FLEX Device You can use any Micro-Controller to configure the FLEX device–the main idea is clocking in ONE BITof configuration data per CLOCK–start from the BIT 0􀂄The total Configuration time–e.g. 10K10 need 15K byte configuration file•calculation equation–10K10* 1.5= 15Kbyte–configuration time for the file itself•15*1024*8*clock = 122,880Clock•assume the CLOCK is 4MHz•122,880*1/4Mhz=30.72msec

    標簽: FPGA PLD 用單片機 設計技巧

    上傳時間: 2013-10-09

    上傳用戶:a67818601

  • PLD、FPGA優秀設計的十條戒律

    PLD、FPGA優秀設計的十條戒律, 該文淺顯易懂的介紹了一個優秀設計必須考慮的問題,給出了設計方法和建議。仔細閱讀和消化本文,對提高PLD/FPGA設計水平大有裨益

    標簽: FPGA PLD

    上傳時間: 2013-11-23

    上傳用戶:tsfh

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