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PlusII

  • 用MAX+PlusII編寫的4輸入7輸出的BCD碼編譯器圖形文件

    用MAX+PlusII編寫的4輸入7輸出的BCD碼編譯器圖形文件

    標(biāo)簽: PlusII MAX BCD 編寫

    上傳時(shí)間: 2014-11-16

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  • MAX+PlusII下載電纜制作資料 ,.內(nèi)有電路圖等

    MAX+PlusII下載電纜制作資料 ,.內(nèi)有電路圖等

    標(biāo)簽: PlusII MAX 下載電纜 制作資料

    上傳時(shí)間: 2017-07-26

    上傳用戶:Divine

  • CPLD數(shù)字電路設(shè)計(jì)--使用MAX+plusⅡ入門篇,學(xué)習(xí)MAX+PlusII必備書籍。

    CPLD數(shù)字電路設(shè)計(jì)--使用MAX+plusⅡ入門篇,學(xué)習(xí)MAX+PlusII必備書籍。

    標(biāo)簽: MAX PlusII CPLD plus

    上傳時(shí)間: 2017-08-18

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  • 十字路口交通信號(hào)燈試驗(yàn),用max+PlusII編程。希望對(duì)大家有用

    十字路口交通信號(hào)燈試驗(yàn),用max+PlusII編程。希望對(duì)大家有用,

    標(biāo)簽: PlusII max 十字路口 交通信號(hào)燈

    上傳時(shí)間: 2013-12-25

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  • 利用EDA工具M(jìn)AX-PlusII的VDHL輸入法

    利用EDA工具M(jìn)AX-PlusII的VDHL輸入法,輸入VHDL程序,實(shí)現(xiàn)2位計(jì)數(shù)器,在七段譯碼器上以十進(jìn)制顯示:0、1、2、3、0、...。時(shí)鐘信號(hào)使用83管腳。采用自動(dòng)機(jī)狀態(tài)轉(zhuǎn)換方式設(shè)計(jì)該計(jì)數(shù)器;建立相應(yīng)仿真波形文件,并進(jìn)行波形仿真;分析設(shè)計(jì)電路的正確性。

    標(biāo)簽: MAX-PlusII VDHL EDA 輸入法

    上傳時(shí)間: 2014-01-25

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  • MAX+PlusII教材及實(shí)例(西文) 152頁 1.7M PDF版.rar

    可編程邏輯器件相關(guān)專輯 96冊(cè) 1.77GMAX+PlusII教材及實(shí)例(西文) 152頁 1.7M PDF版.rar

    標(biāo)簽:

    上傳時(shí)間: 2014-05-05

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  • 應(yīng)用VHDL基于FPGA設(shè)計(jì)FIR濾波器

    伴隨高速DSP技術(shù)的廣泛應(yīng)用,實(shí)時(shí)快速可靠地進(jìn)行數(shù)字信號(hào)處理成為用戶追求的目標(biāo)。同時(shí),由于可編程器件在速度和集成度方面的飛速提高,使得利用硬件實(shí)現(xiàn)數(shù)字信號(hào)實(shí)時(shí)快速可靠處理有了新的途徑。 FIR濾波器是數(shù)字信號(hào)處理中常用部件,它的最大優(yōu)點(diǎn)在于:設(shè)計(jì)任何幅頻特性時(shí),可以具有嚴(yán)格的線性相位,這一點(diǎn)對(duì)數(shù)字信號(hào)的實(shí)時(shí)處理非常關(guān)鍵。 FPGA是常用的可編程器件,它所具有的查找表結(jié)構(gòu)非常適用于實(shí)現(xiàn)實(shí)時(shí)快速可靠的FIR濾波器,在加上VHDL語言靈活的描述方法以及與硬件無關(guān)的特點(diǎn),使得使用VHDL語言基于FPGA芯片實(shí)現(xiàn)FIR濾波器成為研究的方向。 本文對(duì)基于FPGA的FIR數(shù)字濾波器實(shí)現(xiàn)進(jìn)行了研究,并設(shè)計(jì)了一個(gè)16階的FIR低通濾波器。所做的主要工作為: 1.以FIR數(shù)字濾波器的基本理論為依據(jù),使用分布式算法作為濾波器的硬件實(shí)現(xiàn)算法,并對(duì)其進(jìn)行了詳細(xì)的討論。針對(duì)分布式算法中查找表規(guī)模過大的缺點(diǎn),采用多塊查找表的方式減小硬件規(guī)模。 2.在設(shè)計(jì)中采用了自頂向下的層次化、模塊化的設(shè)計(jì)思想,將整個(gè)濾波器劃分為多個(gè)模塊,利用VHDL語言的描述方法進(jìn)行了各個(gè)功能模塊的設(shè)計(jì),最終完成了FIR數(shù)字濾波器的系統(tǒng)設(shè)計(jì)。 3.采用FLEX10K系列器件實(shí)現(xiàn)一個(gè)16階的FIR低通濾波器的設(shè)計(jì)實(shí)例,用MAX+PlusII軟件進(jìn)行了仿真,并用MATLAB對(duì)仿真結(jié)果進(jìn)行了分析,證明所設(shè)計(jì)的FIR數(shù)字濾波器功能正確。 仿真結(jié)果表明,本論文所設(shè)計(jì)的FIR濾波器硬件規(guī)模較小,采樣率達(dá)到了17.73MHz。同時(shí)只要將查找表進(jìn)行相應(yīng)的改動(dòng),就能分別實(shí)現(xiàn)低通、高通、帶通FIR濾波器,體現(xiàn)了設(shè)計(jì)的靈活性。

    標(biāo)簽: VHDL FPGA FIR 濾波器

    上傳時(shí)間: 2013-04-24

    上傳用戶:zdluffy

  • 計(jì)算機(jī)組成實(shí)驗(yàn)平臺(tái)的設(shè)計(jì)與實(shí)現(xiàn)

    《計(jì)算機(jī)組成原理》是計(jì)算機(jī)系的一門核心課程。但是它涉及的知識(shí)面非常廣,內(nèi)容包括中央處理器、指令系統(tǒng)、存儲(chǔ)系統(tǒng)、總線和輸入輸出系統(tǒng)等方面,學(xué)生在學(xué)習(xí)該課程時(shí),普遍覺得內(nèi)容抽象難于理解。但借助于該計(jì)算機(jī)組成原理實(shí)驗(yàn)系統(tǒng),學(xué)生通過實(shí)驗(yàn)環(huán)節(jié),可以進(jìn)一步融會(huì)貫通學(xué)習(xí)內(nèi)容,掌握計(jì)算機(jī)各模塊的工作原理,相互關(guān)系的來龍去脈。 為了增強(qiáng)實(shí)驗(yàn)系統(tǒng)的功能,提高系統(tǒng)的靈活性,降低實(shí)驗(yàn)成本,我們采用FPGA芯片技術(shù)來徹底更新現(xiàn)有的計(jì)算器組成原理實(shí)驗(yàn)平臺(tái)。該技術(shù)可根據(jù)用戶要求為芯片加載由VHDL語言所編寫出的不同的硬件邏輯,F(xiàn)PGA芯片具有重復(fù)編程能力,使得系統(tǒng)內(nèi)硬件的功能可以像軟件一樣被編程,這種稱為“軟”硬件的全新系統(tǒng)設(shè)計(jì)概念,使實(shí)驗(yàn)系統(tǒng)具有極強(qiáng)的靈活性和適應(yīng)性。它不僅使該系統(tǒng)性能的改進(jìn)和擴(kuò)充變得十分簡(jiǎn)易和方便,而且使學(xué)生自己設(shè)計(jì)不同的實(shí)驗(yàn)變?yōu)榭赡堋S?jì)算機(jī)組成原理實(shí)驗(yàn)的最終目的是讓學(xué)生能夠設(shè)計(jì)CPU,但首先,學(xué)生必須知道CPU的各個(gè)功能部件是如何工作,以及相互之間是如何配合構(gòu)成CPU的。因此,我們必須先設(shè)計(jì)出一個(gè)教學(xué)用的以FPGA芯片為核心的硬件平臺(tái),然后在此基礎(chǔ)上開發(fā)出VHDL部件庫及主要邏輯功能,并設(shè)計(jì)出一套實(shí)驗(yàn)。 本文重點(diǎn)研究了基于FPGA芯片的VHDL硬件系統(tǒng),由于VHDL的高標(biāo)準(zhǔn)化和硬件描述能力,現(xiàn)代CPU的主要功能如計(jì)算,存儲(chǔ),I/O操作等均可由VHDL來實(shí)現(xiàn)。同時(shí)設(shè)計(jì)實(shí)驗(yàn)內(nèi)容,包括時(shí)序電路的組成及控制原理實(shí)驗(yàn)、八位運(yùn)算器的組成及復(fù)合運(yùn)算實(shí)驗(yàn)、存儲(chǔ)器實(shí)驗(yàn)、數(shù)據(jù)通路實(shí)驗(yàn)、浮點(diǎn)運(yùn)算器實(shí)驗(yàn)、多流水線處理器實(shí)驗(yàn)等,這些實(shí)驗(yàn)形成一個(gè)相互關(guān)聯(lián)的系統(tǒng)。每個(gè)實(shí)驗(yàn)先由教師講解原理及原理圖,學(xué)生根據(jù)教師提供的原理圖,自己用MAX+PlusII完成電路輸入,學(xué)生實(shí)驗(yàn)實(shí)際上是編寫VHDL,不需要寫得很復(fù)雜,只要能調(diào)用接口,然后將程序燒入平臺(tái),這樣既不會(huì)讓學(xué)生花太多的時(shí)間在畫電路圖上,又能讓學(xué)生更好的理解每個(gè)部件的工作原理和工作過程。 論文首先研究分析了FPGA硬件實(shí)驗(yàn)平臺(tái),即實(shí)驗(yàn)系統(tǒng)的硬件組成。系統(tǒng)采用FPGA-XC4010EPC84,62256CPLD以及其他外圍芯片(例如74LS244,74LS275)組成。根據(jù)不同的實(shí)驗(yàn)要求,規(guī)劃不同實(shí)驗(yàn)控制邏輯。用戶可選擇不同的實(shí)驗(yàn)邏輯,通過把實(shí)驗(yàn)邏輯下載到FPGA芯片中構(gòu)成自己的實(shí)驗(yàn)平臺(tái)。 其次,論文詳細(xì)的闡述了VHDL模塊化設(shè)計(jì),如何運(yùn)用VHDL技術(shù)來依次實(shí)現(xiàn)CPU的各個(gè)功能部件。VHDL語言作為一種國際標(biāo)準(zhǔn)化的硬件描述語言,自1987年獲得IEEE批準(zhǔn)以來,經(jīng)過了1993年和2001年兩次修改,至今已被眾多的國際知名電子設(shè)計(jì)自動(dòng)化(EDA)工具研發(fā)商所采用,并隨同EDA設(shè)計(jì)工具一起廣泛地進(jìn)入了數(shù)字系統(tǒng)設(shè)計(jì)與研發(fā)領(lǐng)域,目前已成為電子業(yè)界普遍接受的一種硬件設(shè)計(jì)技術(shù)。再次,論文針對(duì)實(shí)驗(yàn)平臺(tái)中遇到的較為棘手的多流水線等問題,也進(jìn)行了深入的闡述和剖析。學(xué)生需要什么樣的實(shí)驗(yàn)條件,實(shí)驗(yàn)內(nèi)容及步驟才能了解當(dāng)今CPU所采用的核心技術(shù),才能掌握CPU的設(shè)計(jì),運(yùn)行原理。另外,本論文的背景是需要學(xué)生熟悉基本的VHDL知識(shí)或技能,因?yàn)閷?shí)驗(yàn)是在編寫VHDL代碼的前提下完成的。 本文在基于實(shí)驗(yàn)室的環(huán)境下,基本上較為完整的實(shí)現(xiàn)了一個(gè)基于FPGA的實(shí)驗(yàn)平臺(tái)方案。在此基礎(chǔ)上,進(jìn)行了部分功能的測(cè)試和部分性能方面的分析。本論文的研究,為FPGA在實(shí)際系統(tǒng)中的應(yīng)用提供研究思路和參考方案。論文的研究結(jié)果將對(duì)FPGA與VHDL標(biāo)準(zhǔn)的進(jìn)一步發(fā)展具有重要的理論和現(xiàn)實(shí)意義。

    標(biāo)簽: 計(jì)算機(jī)組成 實(shí)驗(yàn)

    上傳時(shí)間: 2013-04-24

    上傳用戶:小強(qiáng)mmmm

  • RFID讀寫器通訊虛擬檢測(cè)系統(tǒng)

    RFID技術(shù)是一種新興的自動(dòng)識(shí)別技術(shù),具有信息量大、讀取距離遠(yuǎn)、可同時(shí)讀取多張卡片等特點(diǎn),被廣泛應(yīng)用于門禁、物流、管理等領(lǐng)域. 虛擬儀器是現(xiàn)代計(jì)算機(jī)技術(shù)和儀器技術(shù)深層次結(jié)合的產(chǎn)物.虛擬儀器充分利用了計(jì)算機(jī)的運(yùn)算、存儲(chǔ)、回放顯示及文件管理等智能化功能,同時(shí)把傳統(tǒng)儀器的專業(yè)化功能和面板控件軟件化,使之與計(jì)算機(jī)結(jié)合構(gòu)成一臺(tái)功能完全與傳統(tǒng)硬件儀器相同,同時(shí)又充分享用了計(jì)算機(jī)軟硬件資源的全新虛擬儀器系統(tǒng). Wiegand協(xié)議和ABA協(xié)議作為一種常用的通訊協(xié)議被廣泛的應(yīng)用于RFID讀卡器與上位機(jī)之間的通訊以及RFID讀卡器與控制器之間的通訊.本設(shè)計(jì)的目的是檢測(cè)Wiegand協(xié)議和ABA協(xié)議的數(shù)據(jù)通信是否符合協(xié)議規(guī)定,主要包括脈沖寬度、脈沖間隔等.本設(shè)計(jì)包含F(xiàn)PGA和上位機(jī)軟件兩部分,FPGA上完成對(duì)信號(hào)的采樣和對(duì)采樣數(shù)據(jù)的儲(chǔ)存和緩沖,上位機(jī)完成對(duì)采樣數(shù)據(jù)的處理,以及波形的顯示.FPGA上的設(shè)計(jì)應(yīng)用Verilog語言在Altera公司的Max+PlusII平臺(tái)上進(jìn)行開發(fā).上位機(jī)軟件設(shè)計(jì)基于NI公司的圖形化編程軟件LabVIEW.

    標(biāo)簽: RFID 讀寫器 虛擬檢測(cè)

    上傳時(shí)間: 2013-05-20

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  • MAX+PlusII 10.230

    Max+plusⅡ是Altera公司提供的FPGA/CPLD開發(fā)集成環(huán)境,Altera是世界上最大可編程邏輯器件的供應(yīng)商之一。Max+plusⅡ界面友好,使用便捷,被譽(yù)為業(yè)界最易用易學(xué)的EDA軟件。在Max+plusⅡ上可以完成設(shè)計(jì)輸入、元件適配、時(shí)序仿真和功能仿真、編程下載整個(gè)流程,它提供了一種與結(jié)構(gòu)無關(guān)的設(shè)計(jì)環(huán)境,是設(shè)計(jì)者能方便地進(jìn)行設(shè)計(jì)輸入、快速處理和器件編程。

    標(biāo)簽: 10.230 PlusII MAX

    上傳時(shí)間: 2013-07-31

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