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QJ003系類<b>低成本</b>語音模塊接線圖

  • At89isp.zip

    自制51ISP下載線,低成本,簡單好用,屢試不爽

    標(biāo)簽: isp zip At 89

    上傳時(shí)間: 2013-06-28

    上傳用戶:cooran

  • 有機(jī)電致發(fā)光顯示器件新型封裝技術(shù)及材料的研究.rar

    有機(jī)發(fā)光顯示器件(OrganicLight-EmittingDiodes,OLEDs)作為下一代顯示器倍受關(guān)注,它具有輕、薄、高亮度、快速響應(yīng)、高清晰度、低電壓、高效率和低成本等優(yōu)點(diǎn),完全可以媲美CRT、LCD、LED等顯示器件。作為全固化顯示器件,OLED的最大優(yōu)越性是能夠與塑料晶體管技術(shù)相結(jié)合實(shí)現(xiàn)柔性顯示,應(yīng)用前景非常誘人。OLED如此眾多的優(yōu)點(diǎn)和廣闊的商業(yè)前景,吸引了全球眾多研究機(jī)構(gòu)和企業(yè)參與其研發(fā)和產(chǎn)業(yè)化。然而,OLED也存在一些問題,特別是在發(fā)光機(jī)理、穩(wěn)定性和壽命等方面還需要進(jìn)一步的研究。要達(dá)到這些目標(biāo),除了器件的材料,結(jié)構(gòu)設(shè)計(jì)外,封裝也十分重要。 本論文的主要工作是利用現(xiàn)有的材料,從綠光OLED器件制作工藝、發(fā)光機(jī)理,結(jié)構(gòu)和封裝入手,首先,探討了作為陽極的ITO玻璃表面處理工藝和ITO玻璃的光刻工藝。ITO表面的清潔程度嚴(yán)重影響著光刻質(zhì)量和器件的最終性能;ITO表面經(jīng)過氧等離子處理后其表面功函數(shù)增大,明顯提高了器件的發(fā)光亮度和發(fā)光效率。 其次,針對光刻、曝光工藝技術(shù)進(jìn)行了一系列相關(guān)實(shí)驗(yàn),在光刻工藝中,光刻膠的厚度是影響光刻質(zhì)量的一個重要因素,其厚度在1.2μm左右時(shí),光刻效果理想。研究了OLED器件陰極隔離柱成像過程中的曝光工藝,摸索出了最佳工藝參數(shù)。 然后采用以C545T作為綠光摻雜材料制作器件結(jié)構(gòu)為ITO/CuPc(20nm)/NPB(100nm)/Alq3(80nm):C545T(2.1%摻雜比例)/Alq3(70nm)/LiF(0.5nm)/Al(1,00nm)的綠光OLED器件。最后基于以上器件采用了兩種封裝工藝,實(shí)驗(yàn)一中,在封裝玻璃的四周涂上UV膠,放入手套箱,在氮?dú)獗Wo(hù)氣氛下用紫外冷光源照射1min進(jìn)行一次封裝,然后取出OLED片,在ITO玻璃和封裝玻璃接口處涂上UV膠,真空下用紫外冷光源照射1min,固化進(jìn)行二次封裝。實(shí)驗(yàn)二中,在各功能層蒸鍍完成后,又在陰極的外面蒸鍍了一層薄膜封裝層,然后再按實(shí)驗(yàn)一的方法進(jìn)行封裝。薄膜封裝層的材料分別為硒(Se)、碲(Te)、銻(Sb)。分別對兩種封裝工藝器件的電流-電壓特性、亮度-電壓特性、發(fā)光光譜及壽命等特性進(jìn)行了測試與討論。通過對比,研究發(fā)現(xiàn)增加薄膜封裝層器件的壽命比未加薄膜封裝層器件壽命都有所延長,其中,Se薄膜封裝層的增加將器件的壽命延長了1.4倍,Te薄膜封裝層的增加將器件的壽命延長了兩倍多,Sb薄膜封裝層的增加將器件的壽命延長了1.3倍,研究還發(fā)現(xiàn)薄膜封裝層基本不影響器件的電流-電壓特性、色坐標(biāo)等光電性能。最后,分別對三種薄膜封裝層材料硒(Se)、碲(Te)、銻(Sb)進(jìn)行了研究。

    標(biāo)簽: 機(jī)電 發(fā)光 顯示器件

    上傳時(shí)間: 2013-07-11

    上傳用戶:liuwei6419

  • 基于ARM的嵌入式linux系統(tǒng)下的MP3設(shè)計(jì).rar

    隨著消費(fèi)類電子產(chǎn)業(yè)的蓬勃發(fā)展,越來越多的嵌入式電子產(chǎn)品走進(jìn)了千家萬戶。電腦的形態(tài)也不再局限于以前的PC機(jī),各式各樣的嵌入式系統(tǒng)出現(xiàn)在了眾多的行業(yè)和應(yīng)用中,其中ARM和Linux結(jié)合的產(chǎn)品在市場上最受青睞。ARM由于其低功耗、高性能、小體積、低成本受到了越來越廣泛的重視,成為眾多公司產(chǎn)品開發(fā)的主流硬件。而Linux則因其開放的源代碼,可裁剪的內(nèi)核,便利的開發(fā)環(huán)境,各硬件平臺的通用性,逐漸成為嵌入式開發(fā)的主流操作系統(tǒng)。本課題的嵌入式MP3設(shè)計(jì)就是基于ARM和linux平臺的。 @@ 本課題實(shí)現(xiàn)了一個完整的嵌入式系統(tǒng),選用zq2410開發(fā)板為目標(biāo)平臺,linux作為目標(biāo)操作系統(tǒng),在這樣的軟硬件環(huán)境下研究實(shí)現(xiàn)MP3播放器。 @@ 文章首先綜述了嵌入式系統(tǒng)開發(fā)方法,介紹了ARM處理器及其特點(diǎn),Linux操作系統(tǒng),嵌入式系統(tǒng)的開發(fā)模式以及如何搭建交叉開發(fā)環(huán)境,然后介紹了所選硬件平臺zq2410目標(biāo)板的各種資源,在系統(tǒng)軟件開發(fā)中,介紹Uboot、Linux的裁剪和移植,根文件系統(tǒng)的制作以及核心驅(qū)動程序的開發(fā),應(yīng)用程序開發(fā)中,介紹了MP3的原理,移植Madplay MP3播放器,最后成功對Madplay播放器實(shí)現(xiàn)了綜合控制。 @@關(guān)鍵詞:嵌入式;ARM; Linux;驅(qū)動程序;MP3;

    標(biāo)簽: linux ARM MP3

    上傳時(shí)間: 2013-05-26

    上傳用戶:lo25643

  • 基于單片機(jī)的嵌入式WEB服務(wù)器設(shè)計(jì).rar

    本文主要研究采用以太網(wǎng)接口芯片RTL8019AS和TCP/IP協(xié)議實(shí)現(xiàn)嵌入式WEB服務(wù)器,此服務(wù)器可以使各種帶串口的工控設(shè)備和數(shù)據(jù)采集設(shè)備很容易地連接到Internet,這樣就能夠利用Internet實(shí)現(xiàn)對各種嵌入式設(shè)備的低成本遠(yuǎn)程訪問和資源共享。 本研究實(shí)現(xiàn)的嵌入式WEB服務(wù)器以STC89C51系列單片機(jī)為核心,用其串口作為與嵌入式設(shè)備的接口,用RTL8019AS芯片和RJ-45作為以太網(wǎng)接口,并通過軟件實(shí)現(xiàn)RS-232與TCP/IP協(xié)議的轉(zhuǎn)換,通過以太網(wǎng)實(shí)現(xiàn)嵌入式設(shè)備與遠(yuǎn)程計(jì)算機(jī)之間的雙向數(shù)據(jù)通信,給出了硬件設(shè)計(jì)和軟件實(shí)現(xiàn)方案。硬件主要研究微控制器和以太網(wǎng)控制芯片之間的接口設(shè)計(jì)和以太網(wǎng)控制芯片RTL8019AS的驅(qū)動。軟件部分研究實(shí)現(xiàn)了TCP/IP的各層協(xié)議,包含了ARP、IP、ICMP、UDP、TCP、HTTP等,在實(shí)際中得以應(yīng)用,如對于蓄電池電壓的遠(yuǎn)程檢測等。 研究結(jié)果表明,利用嵌入式WEB服務(wù)器將嵌入式設(shè)備連入Internet網(wǎng)絡(luò)是切實(shí)可行的。經(jīng)實(shí)驗(yàn)測試整個系統(tǒng)占用資源少,成本較低、移植性較好,能夠完成常用的相關(guān)網(wǎng)絡(luò)通訊功能,網(wǎng)絡(luò)數(shù)據(jù)傳輸可靠性較好。

    標(biāo)簽: WEB 單片機(jī) 嵌入式

    上傳時(shí)間: 2013-04-24

    上傳用戶:liucf

  • 基于FPGA的DDS信號源設(shè)計(jì).rar

    作為電子類專業(yè)學(xué)生,實(shí)驗(yàn)是提高學(xué)生對所學(xué)知識的印象以及發(fā)現(xiàn)問題和解決問題的能力,增加學(xué)生動手能力的必須環(huán)節(jié)。本設(shè)計(jì)的目的就是開發(fā)一套滿足學(xué)生實(shí)驗(yàn)需求的信號源,基于此目的本信號源并不需要突出的性能,但經(jīng)濟(jì)上要求低成本,同時(shí)要求操作簡單,能夠輸出多種波形,并且利于學(xué)生在此平臺上認(rèn)識信號源原理,同時(shí)方便在此平臺上進(jìn)行拓展開發(fā)。 設(shè)計(jì)中運(yùn)用虛擬儀器技術(shù)將計(jì)算機(jī)屏幕作為儀器面板,采用EPP接口,同時(shí)在FPGA上開發(fā)控制電路,為后續(xù)開發(fā)留下了空間,同時(shí)節(jié)省了成本。本設(shè)計(jì)采用地址線16位,數(shù)據(jù)線12位的靜態(tài)RAM作為信號源的波形存儲器,后端采用兩種濾波類型對需要濾波的信號進(jìn)行濾波。啟動信號時(shí)軟件需要先將波形數(shù)據(jù)預(yù)存在存儲器中便于調(diào)用,最后得到的結(jié)果基本滿足教學(xué)實(shí)驗(yàn)的需求。 本文結(jié)構(gòu)上首先介紹了直接采用DDS芯片制作信號源的利弊,及作者采用這種設(shè)計(jì)的初衷,然后介紹了信號源的整體結(jié)構(gòu),總體模塊。以下章節(jié)首先介紹FPGA內(nèi)部設(shè)計(jì),包括總體結(jié)構(gòu)和幾大部分模塊,包括:時(shí)鐘產(chǎn)生電路,相位累加器,數(shù)據(jù)輸入控制電路,濾波器控制電路,信號源啟動控制電路。 然后介紹了其他模塊的設(shè)計(jì),包括存儲器選擇,幅度控制電路的設(shè)計(jì)以及濾波器電路的設(shè)計(jì),本設(shè)計(jì)的幅度控制采用兩級DA級聯(lián),以及后端電阻分壓網(wǎng)絡(luò)調(diào)節(jié)的方式進(jìn)行設(shè)計(jì),提高了幅度調(diào)節(jié)的范圍。對于濾波器的設(shè)計(jì),依據(jù)不同的信號頻率,分成了4個部分,對于500K以下的信號采用的是二階巴特沃斯有源低通濾波,對于500K以上至5M以下信號采用的五階RC低通濾波器。 在軟件設(shè)計(jì)部分,分成兩個部分,對于底層驅(qū)動程序采用以Labwindows/CVI為平臺進(jìn)行開發(fā),利用其編譯和執(zhí)行速度快,并且和LabVIEW能夠很好連接的特性。對于上層控制軟件,采用以LabVIEW為平臺進(jìn)行開發(fā),充分利用其圖化設(shè)計(jì),易于擴(kuò)展。 論文最后對所做工作進(jìn)行了總結(jié),提出了進(jìn)一步改進(jìn)的方向。

    標(biāo)簽: FPGA DDS 信號源

    上傳時(shí)間: 2013-04-24

    上傳用戶:afeiafei309

  • 基于FPGA的多平臺虛擬儀器研究設(shè)計(jì).rar

    虛擬儀器技術(shù)是以傳感器、信號測量與處理、微型計(jì)算機(jī)等技術(shù)為基礎(chǔ)而形成的一門綜合應(yīng)用技術(shù)。目前虛擬儀器大部分是基于PC機(jī),利用PCI等總線技術(shù)傳輸數(shù)據(jù),數(shù)據(jù)卡插拔不便,便攜性差。隨著嵌入式技術(shù)的飛速發(fā)展,嵌入式系統(tǒng)平臺已經(jīng)應(yīng)用到各個領(lǐng)域,而市場上的嵌入式虛擬儀器系統(tǒng)還相當(dāng)少,各種研究工作才剛剛起步,各種高性能的虛擬儀器和處理系統(tǒng)在現(xiàn)代工業(yè)控制和科學(xué)研究中已成為必不可少的部分。因此在我國開發(fā)具有較高性能、接口靈活、功能多樣化、低成本的虛擬儀器裝置勢在必行。 針對目前虛擬儀器系統(tǒng)發(fā)展趨勢和特點(diǎn),采用FPGA技術(shù),進(jìn)行一種支持多種平臺的高速虛擬儀器系統(tǒng)的設(shè)計(jì)與研究,并針對高速虛擬儀器系統(tǒng)中的一些技術(shù)難點(diǎn)提出解決方案。首先進(jìn)行了系統(tǒng)的總體設(shè)計(jì),確定了采用FPGA作為系統(tǒng)的控制核心,并選取了Labview作為PC平臺應(yīng)用程序開發(fā)工具,利用USB2.0接口來進(jìn)行數(shù)據(jù)傳輸;同時(shí)選取嵌入式處理器S3C2410以及WinCE作為嵌入式系統(tǒng)硬軟件平臺。隨后進(jìn)行了各個具體模塊的設(shè)計(jì),在硬件方面,分別設(shè)計(jì)了前端處理電路,ADC電路以及USB接口電路。在軟件方面,進(jìn)行了FPGA控制程序的設(shè)計(jì)工作,實(shí)現(xiàn)了對各個模塊和接口電路的控制功能。在上層應(yīng)用程序的設(shè)計(jì)方面,設(shè)計(jì)了Labview應(yīng)用程序,實(shí)現(xiàn)了波形顯示和頻譜分析等儀器功能,人機(jī)界面良好。在嵌入式平臺上面,進(jìn)行了WinCE下GPIO驅(qū)動程序設(shè)計(jì),并在上層應(yīng)用程序中調(diào)用驅(qū)動來進(jìn)行數(shù)據(jù)的讀取。為了解決高速ADC與數(shù)據(jù)緩存器的速度不匹配的問題,提出利用多體交叉式存儲器結(jié)構(gòu)的設(shè)計(jì)方案,并在FPGA內(nèi)對控制程序進(jìn)行了設(shè)計(jì),對其時(shí)序進(jìn)行了仿真。 最后對系統(tǒng)進(jìn)行了聯(lián)合調(diào)試工作,利用上層軟件對輸入波形進(jìn)行采集。根據(jù)調(diào)試結(jié)果看,該系統(tǒng)對輸入信號進(jìn)行了較好的采樣和存儲,還原了波形,達(dá)到了預(yù)期效果。課題研究并且對設(shè)計(jì)出一種支持多平臺的新型虛擬儀器系統(tǒng),具有性能好、使用靈活,節(jié)省成本等特點(diǎn),具有較高的研究價(jià)值和現(xiàn)實(shí)意義。

    標(biāo)簽: FPGA 虛擬儀器

    上傳時(shí)間: 2013-04-24

    上傳用戶:shwjl

  • 基于DSP和FPGA導(dǎo)航計(jì)算機(jī)硬件電路研究與設(shè)計(jì).rar

    為適應(yīng)組合導(dǎo)航計(jì)算機(jī)系統(tǒng)的微型化、高性能度的要求,拓寬導(dǎo)航計(jì)算機(jī)的應(yīng)用領(lǐng)域,本文設(shè)計(jì)出一種基于浮點(diǎn)型DSP(TMS320C6713)和可編程邏輯陣列器件(FPGA: EP1C12N240C8)協(xié)同合作的導(dǎo)航計(jì)算機(jī)系統(tǒng)。 論文在闡述了組合導(dǎo)航計(jì)算機(jī)的特點(diǎn)和應(yīng)用要求后,提出基于DSP和FPGA的組合導(dǎo)航計(jì)算機(jī)系統(tǒng)方案。該方案以DSP為導(dǎo)航解算處理器,由FPGA完成IMU信號的采集和緩存以及系統(tǒng)控制信號的整合;DSP通過EMIF接口實(shí)現(xiàn)和FPGA通信。在此基礎(chǔ)上研究了各擴(kuò)展通信接口、系統(tǒng)硬件原理圖和PCB的開發(fā),且在FPGA中使用調(diào)用IP核來實(shí)現(xiàn)FIR低通濾波數(shù)據(jù)處理機(jī)抖激光陀螺的機(jī)抖振動的影響。其次,詳細(xì)闡述了利用TI公司的DSP集成開發(fā)環(huán)境和DSP/BIOS準(zhǔn)實(shí)時(shí)操作系統(tǒng)開發(fā)多任務(wù)系統(tǒng)軟件的具體方案。本文引入DSP/BIOS實(shí)時(shí)操作系統(tǒng)提供的多任務(wù)機(jī)制,將采集處理按照功能劃分四個相對獨(dú)立的任務(wù),這些任務(wù)在DSP/BIOS的調(diào)度下,按照用戶指定的優(yōu)先級運(yùn)行,大大提高系統(tǒng)的工作效率。最后給了DSP芯片Bootloader的制作方法。 導(dǎo)航計(jì)算機(jī)系統(tǒng)研制開發(fā)是軟、硬件研究緊密結(jié)合的過程。在微型導(dǎo)航計(jì)算機(jī)系統(tǒng)方案建立的基礎(chǔ)上,本文首先討論了系統(tǒng)硬件整體設(shè)計(jì)和軟件開發(fā)流程;其次針對導(dǎo)航計(jì)算機(jī)系統(tǒng)各個功能模塊以及多項(xiàng)關(guān)鍵技術(shù)進(jìn)行了設(shè)計(jì)與開發(fā)工作,涉及系統(tǒng)數(shù)據(jù)通信模塊、模擬信號采集模塊和數(shù)據(jù)存儲模塊;最后,對導(dǎo)航計(jì)算機(jī)系統(tǒng)進(jìn)行了聯(lián)合調(diào)試工作,并對各個模塊進(jìn)行了詳細(xì)的功能測試與驗(yàn)證,完成了微型導(dǎo)航計(jì)算機(jī)系統(tǒng)的制作。 以DSP/FPGA作為導(dǎo)航計(jì)算機(jī)硬件平臺的捷聯(lián)式慣性導(dǎo)航實(shí)時(shí)數(shù)據(jù)系統(tǒng)能夠滿足系統(tǒng)所要求的高精度、實(shí)時(shí)性、穩(wěn)定性要求,適應(yīng)了其高性能、低成本、低功耗的發(fā)展方向。

    標(biāo)簽: FPGA DSP 導(dǎo)航計(jì)算機(jī)

    上傳時(shí)間: 2013-04-24

    上傳用戶:lishuoshi1996

  • 基于FPGA的PWMD類音頻功率放大器的設(shè)計(jì).rar

    數(shù)字D類音頻放大器,也叫數(shù)字脈沖調(diào)制放大器,具有效率高,低電壓,低失真的特點(diǎn),在低成本,高性能的消費(fèi)類產(chǎn)品特別是便攜式設(shè)備中得到越來越廣泛的應(yīng)用。數(shù)字D類放大器包括數(shù)字脈沖寬度調(diào)制(PWM)和輸出級(含低通濾波器)兩個部分,數(shù)字PWM又包括兩個部分,采樣處理和脈沖產(chǎn)生。傳統(tǒng)的采樣處理算法運(yùn)算復(fù)雜,硬件實(shí)現(xiàn)成本高,面積大,從而導(dǎo)致功耗也大,不適合當(dāng)今向低功耗發(fā)展的趨勢。 本文在傳統(tǒng)算法的基礎(chǔ)上提出了一種新的算法,該算法不包括乘法或者除法這些計(jì)算復(fù)雜和非常消耗硬件資源的單元,只含加法和減法運(yùn)算。在推導(dǎo)出該算法的傅立葉表達(dá)式后,在MATLAB的simulink中建立系統(tǒng)模型進(jìn)行仿真以驗(yàn)證算法的可行性,在輸入信號頻率為1kHZ,采樣頻率為48kHZ,電源電壓為10V,輸出負(fù)載為4Ω的條件下,得到的總諧波失真為0.12%,符合D類放大器的性能要求。本文還在基于Xilinx公司的Spartan-3系列FPGA的基礎(chǔ)上實(shí)現(xiàn)了該算法的電路結(jié)構(gòu),綜合結(jié)果表明,實(shí)現(xiàn)基于本文算法的數(shù)字D類音頻系統(tǒng)所需要的硬件資源大大減少,從而減少了功耗。 關(guān)鍵詞:D類放大器;脈沖寬度調(diào)制;采樣算法;數(shù)字音頻放大器;FPGA

    標(biāo)簽: FPGA PWMD 音頻功率放大器

    上傳時(shí)間: 2013-07-19

    上傳用戶:zhuoying119

  • 基于FPGA的快速路由查找算法研究及實(shí)現(xiàn).rar

    現(xiàn)代通信朝著全網(wǎng)IP化的進(jìn)程逐步發(fā)展,越來越多的通信需要IP路由查找;同時(shí)光纖技術(shù)的發(fā)展,使得比特速率達(dá)到了20Gbps,路由技術(shù)成了整個通信系統(tǒng)的瓶頸,迫切需要一種具有高查找性能,低成本的路由算法,能夠適應(yīng)大規(guī)模應(yīng)用。 本文研究了一種高性能、低成本的路由算法。在四分支并行路由查找算法的基礎(chǔ)上,實(shí)現(xiàn)了雙分支并行,每個分支流水查找的16-8-8路由算法。該算法由三級表構(gòu)成,長度小于16的前綴通過擴(kuò)展成為長度16的前綴存儲在第一級表中;長度小于24位的前綴通過擴(kuò)展成為長度24的前綴存儲在前兩級表中;長度大于24的前綴則通過專門的存儲空間進(jìn)行存儲。將IP路由的二維查找轉(zhuǎn)化為一維精確查找,每次查找最多訪問存儲器3次,就可以查得下一跳的路由信息。使用Verilog語言實(shí)現(xiàn)了本文提出的算法,并對算法進(jìn)行了功能仿真。為了實(shí)現(xiàn)低成本,該算法采用了FPGA和SSRAM的硬件結(jié)構(gòu)實(shí)現(xiàn)。 功能仿真表明本文設(shè)計(jì)的算法查找速度能適應(yīng)20Gbps的接口轉(zhuǎn)發(fā)速率。

    標(biāo)簽: FPGA 路由 查找算法

    上傳時(shí)間: 2013-04-24

    上傳用戶:金宜

  • 基于FPGA的高速串行接口模塊仿真設(shè)計(jì).rar

    現(xiàn)代社會信息量爆炸式增長,由于網(wǎng)絡(luò)、多媒體等新技術(shù)的發(fā)展,用戶對帶寬和速度的需求快速增加。并行傳輸技術(shù)由于時(shí)鐘抖動和偏移,以及PCB布線的困難,使得傳輸速率的進(jìn)一步提升面臨設(shè)計(jì)的極限;而高速串行通信技術(shù)憑借其帶寬大、抗干擾性強(qiáng)和接口簡單等優(yōu)勢,正迅速取代傳統(tǒng)的并行技術(shù),成為業(yè)界的主流。 本論文針對目前比較流行并且有很大發(fā)展?jié)摿Φ膬煞N高速串行接口電路——高速鏈路口和Rocket I/O進(jìn)行研究,并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進(jìn)行仿真設(shè)計(jì)。本論文的主要工作是以某低成本相控陣?yán)走_(dá)信號處理機(jī)為設(shè)計(jì)平臺,在其中的一塊信號處理板上,進(jìn)行了基于LVDS(Low VoltageDifferential Signal)技術(shù)的高速LinkPort(鏈路口)設(shè)計(jì)和基于CML(Current ModeLogic)技術(shù)的Rocket I/O高速串行接口設(shè)計(jì)。首先在FPGA的軟件中進(jìn)行程序設(shè)計(jì)和功能、時(shí)序的仿真,當(dāng)仿真驗(yàn)證通過之后,重點(diǎn)是在硬件平臺上進(jìn)行調(diào)試。硬件調(diào)試驗(yàn)證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接,進(jìn)行數(shù)據(jù)的互相傳送,接收和發(fā)送的數(shù)據(jù)相同,證明了高速鏈路口設(shè)計(jì)的正確性。并且在硬件調(diào)試時(shí)對Rocket IO GTP收發(fā)器進(jìn)行回環(huán)設(shè)計(jì),經(jīng)過回環(huán)之后接收到的數(shù)據(jù)與發(fā)送的數(shù)據(jù)相同,證明了Rocket I/O高速串行接口設(shè)計(jì)的正確性。

    標(biāo)簽: FPGA 高速串行 接口模塊

    上傳時(shí)間: 2013-04-24

    上傳用戶:戀天使569

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