這是使用有限差分法計算QuaSI TE模的程序,需要先定義波導(dǎo)的參數(shù)
標(biāo)簽： QuaSI 有限差分 定義 參數(shù)
上傳時間： 2013-12-02
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source codes for "Orthant-Wise Limited-memory QuaSI-Newton Optimizer for L1-regularized Objectives"
標(biāo)簽： Limited-memory Orthant-Wise QuaSI-Newton regularized
上傳時間： 2013-12-27
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MOSFET in Zero-Current-QuaSI-Resonant Converter 在simulink中仿真mosfet的模型程序。
標(biāo)簽： Zero-Current-QuaSI-Resonant Converter simulink MOSFET
上傳時間： 2016-01-18
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QuaSI-Newton算法的demo程序，主要用于最優(yōu)化算法的設(shè)計與最優(yōu)化問題的求解
標(biāo)簽： QuaSI-Newton demo 算法 程序
上傳時間： 2014-01-23
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an QuaSI-newton method used in non-linear programming and especially in optimization
標(biāo)簽： QuaSI-newton optimization programming especially
上傳時間： 2013-12-27
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the text file QMLE contains the QuaSI maximum likelyhood estimating procedure and performing Information Matrix test for a univariate GARCH(1,1) model
標(biāo)簽： estimating likelyhood performing the
上傳時間： 2014-11-22
上傳用戶：zhenyushaw
Hot Carriers in QuaSI-2-D Polar Semiconductors
標(biāo)簽： Semiconductors Carriers QuaSI Polar
上傳時間： 2017-06-21
上傳用戶：chenlong
Designand Analysisof Fast Text Compression Basedon QuaSI-Arithmetic Coding.
標(biāo)簽： QuaSI-Arithmetic Compression Analysisof Designand
上傳時間： 2013-12-11
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本文以感應(yīng)加熱電源為研究對象，闡述了感應(yīng)加熱電源的基本原理及其發(fā)展趨勢。對感應(yīng)加熱電源常用的兩種拓?fù)浣Y(jié)構(gòu)--電流型逆變器和電壓型逆變器做了比較分析，并分析了感應(yīng)加熱電源的各種調(diào)功方式。在對比幾種功率調(diào)節(jié)方式的基礎(chǔ)上，得出在整流側(cè)調(diào)功有利于高頻感應(yīng)加熱電源頻率和功率的提高的結(jié)論，選擇了不控整流加軟斬波器調(diào)功的感應(yīng)加熱電源作為研究對象。針對傳統(tǒng)硬斬波調(diào)功式感應(yīng)加熱電源功率損耗大的缺點(diǎn)，采用軟斬波調(diào)功方式，設(shè)計了一種零電流開關(guān)準(zhǔn)諧振變換器ZCS-QRCs(Zero-current-switching-QuaSI-resonant)倍頻式串聯(lián)諧振高頻感應(yīng)加熱電源。介紹了該軟斬波調(diào)功器的組成結(jié)構(gòu)及其工作原理，通過仿真和實(shí)驗(yàn)的方法研究了該軟斬波器的性能，從而得出該軟斬波器非常適合大功率高頻感應(yīng)加熱電源應(yīng)用場合的結(jié)論。同時設(shè)計了功率閉環(huán)控制系統(tǒng)和PI功率調(diào)節(jié)器，將感應(yīng)加熱電源的功率控制問題轉(zhuǎn)化為Buck斬波器的電壓控制問題。 針對目前IGBT器件頻率較低的實(shí)際情況，本文提出了一種新的逆變拓?fù)?通過IGBT的并聯(lián)來實(shí)現(xiàn)倍頻，從而在保證感應(yīng)加熱電源大功率的前提下提高了其工作頻率，并在分析其工作原理的基礎(chǔ)上進(jìn)行了仿真，驗(yàn)證了理論分析的正確性，達(dá)到了預(yù)期的效果。另外，本文還設(shè)計了數(shù)字鎖相環(huán)(DPLL)，使逆變器始終保持在功率因數(shù)近似為1的狀態(tài)下工作，實(shí)現(xiàn)電源的高效運(yùn)行。最后，分析并設(shè)計了IGBT的緩沖吸收電路。 本文第五章設(shè)計了一臺150kHz、10KW的倍頻式感應(yīng)加熱電源實(shí)驗(yàn)樣機(jī)，其中斬波器頻率為20kHz，逆變器工作頻率為150kHz(每個IGBT工作頻率為75kHz)，控制核心采用TI公司的TMS320F2812DSP控制芯片，簡化了系統(tǒng)結(jié)構(gòu)。實(shí)驗(yàn)結(jié)果表明，該倍頻式感應(yīng)加熱電源實(shí)現(xiàn)了斬波器和逆變器功率器件的軟開關(guān)，有效的減小了開關(guān)損耗，并實(shí)現(xiàn)了數(shù)字化，提高了整機(jī)效率。文章給出了整機(jī)的結(jié)構(gòu)設(shè)計，直流斬波部分控制框圖，逆變控制框圖，驅(qū)動電路的設(shè)計和保護(hù)電路的設(shè)計。同時，給出了關(guān)鍵電路的仿真和實(shí)驗(yàn)波形。 實(shí)驗(yàn)證明，以上分析和電路設(shè)計都是行之有效的，在實(shí)驗(yàn)中取得很好的效果。
上傳時間： 2013-05-20
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低密度校驗(yàn)碼（LDPC，Low Density Parity Check Code）是一種性能接近香農(nóng)極限的信道編碼，已被廣泛地采用到各種無線通信領(lǐng)域標(biāo)準(zhǔn)中，包括我國的數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)、歐洲第二代衛(wèi)星數(shù)字視頻廣播標(biāo)準(zhǔn)（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統(tǒng)中的核心技術(shù)之一。 當(dāng)今LDPC碼構(gòu)造的主流方向有兩個，分別是結(jié)合準(zhǔn)循環(huán)（QC，QuaSI Cyclic）移位結(jié)構(gòu)的單次擴(kuò)展構(gòu)造和類似重復(fù)累積（RA，Repeat Accumulate）碼構(gòu)造。相應(yīng)地，主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高，但是需要較多的寄存器和ROM資源；基于迭代譯碼的編碼算法實(shí)現(xiàn)簡單，但是吞吐量不高，且不容易構(gòu)造高性能的好碼。 本文在研究了上述幾種碼構(gòu)造和編碼算法之后，結(jié)合編譯碼器綜合實(shí)現(xiàn)的復(fù)雜度考慮，提出了一種切實(shí)可行的基于二次擴(kuò)展（Dex，Duplex Expansion）的QC-LDPC碼構(gòu)造方法，以實(shí)現(xiàn)高吞吐量的LDPC碼收發(fā)端；并且充分利用該類碼校驗(yàn)矩陣準(zhǔn)循環(huán)移位結(jié)構(gòu)的特點(diǎn)，結(jié)合RU算法，提出了一種新編碼器的設(shè)計方案。 基于二次擴(kuò)展的QC-LDPC碼構(gòu)造方法，是通過對母矩陣先后進(jìn)行亂序擴(kuò)展（Pex，Permutation Expansion）和循環(huán)移位擴(kuò)展（CSEx，Cyclic Shift Expansion）實(shí)現(xiàn)的。在此基礎(chǔ)上，為了實(shí)現(xiàn)可變碼長、可變碼率，一般編譯碼器需同時支持多個亂序擴(kuò)展和循環(huán)移位擴(kuò)展的擴(kuò)展因子。本文所述二次擴(kuò)展構(gòu)造方法的特點(diǎn)在于，固定循環(huán)移位擴(kuò)展的擴(kuò)展因子大小不變，支持多個亂序擴(kuò)展的擴(kuò)展因子，使得譯碼器結(jié)構(gòu)得以精簡；構(gòu)造得到的碼字具有近似規(guī)則碼的結(jié)構(gòu)，便于硬件實(shí)現(xiàn)；（偽）隨機(jī)生成的循環(huán)移位系數(shù)能夠提高碼字的誤碼性能，是對硬件實(shí)現(xiàn)和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復(fù)用，使得實(shí)現(xiàn)復(fù)雜度近似與碼長成正比。考慮到吞吐量的要求，新編碼器結(jié)構(gòu)完全拋棄了RU算法中串行的前向替換（FS，F(xiàn)orward Substitution）模塊，同時簡化了流水線結(jié)構(gòu)，由原先RU算法的6級降低為4級；為了縮短編碼延時，設(shè)計時安排每一級流水線計算所需的時鐘數(shù)大致相同。 這種碼字構(gòu)造和編碼聯(lián)合設(shè)計方案具有以下優(yōu)勢：相比RU算法，新方案對可變碼長、可變碼率的支持更靈活，吞吐量也更大；相比基于生成矩陣的編碼算法，新方案節(jié)省了50％以上的寄存器和ROM資源，單位資源下的吞吐量更大；相比類似重復(fù)累積碼結(jié)構(gòu)的基于迭代譯碼的編碼算法，新方案使高性能LDPC碼的構(gòu)造更為方便。以上結(jié)果都在Xilinx Virtex II pro 70 FPGA上得到驗(yàn)證。 通過在實(shí)驗(yàn)板上實(shí)測表明，上述基于二次擴(kuò)展的QC-LDPC碼構(gòu)造和相應(yīng)的編碼方案能夠?qū)崿F(xiàn)高吞吐量LDPC碼收發(fā)端，在實(shí)際應(yīng)用中具有很高的價值。 目前，LDPC碼正向著非規(guī)則、自適應(yīng)、信源信道及調(diào)制聯(lián)合編碼方向發(fā)展。跨層聯(lián)合編碼的構(gòu)造方法，及其對應(yīng)的編碼算法，也必將成為信道編碼理論未來的研究重點(diǎn)。
上傳時間： 2013-07-26
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