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SIGM<b>A-D</b>ELTA

  • 基于DSPFPGA的捷聯(lián)慣性導(dǎo)航系統(tǒng)設(shè)計(jì)

    在慣性導(dǎo)航系統(tǒng)中,捷聯(lián)式慣性導(dǎo)航系統(tǒng)以其體積小、成本低和可靠性高等優(yōu)點(diǎn)正逐步取代平臺(tái)式慣性導(dǎo)航系統(tǒng),成為慣性導(dǎo)航系統(tǒng)的發(fā)展趨勢。    為了適應(yīng)捷聯(lián)慣性導(dǎo)航系統(tǒng)小型化、低成本和高性能的發(fā)展方向,本文設(shè)計(jì)了DSP與FPGA相結(jié)合的系統(tǒng)方案:系統(tǒng)采用MEMS器件和高性能A/D轉(zhuǎn)換器構(gòu)成慣性信號(hào)檢測單元,F(xiàn)PGA進(jìn)行I/O控制,DSP完成導(dǎo)航計(jì)算。方案綜合考慮了系統(tǒng)成本、計(jì)算速度、精度、體積等各方面的因素,并通過GPS、磁航向計(jì)等信息融合進(jìn)一步提高導(dǎo)航精度。    數(shù)據(jù)采集是捷聯(lián)慣導(dǎo)系統(tǒng)設(shè)計(jì)的關(guān)鍵,本文數(shù)據(jù)采集由信號(hào)調(diào)理、A/D轉(zhuǎn)換和。FPGA等幾部分組成。其中,F(xiàn)PGA是整個(gè)數(shù)據(jù)采集部分的核心,其主要功能包括:實(shí)現(xiàn)了ADC控制邏輯和時(shí)序生成;配置了FIFO寄存器,緩沖了ADC與DSP之間的轉(zhuǎn)換數(shù)據(jù);擴(kuò)展了UART串口,以實(shí)現(xiàn)系統(tǒng)的外部信息接口。在完成電路設(shè)計(jì)的基礎(chǔ)上,對各功能模塊進(jìn)行了全面的半實(shí)物仿真,驗(yàn)證了系統(tǒng)方案及各主要功能模塊的可行性。    論文簡述了慣性導(dǎo)航系統(tǒng)的應(yīng)用背景及發(fā)展?fàn)顩r,介紹了捷聯(lián)慣導(dǎo)系統(tǒng)的基本原理,設(shè)計(jì)了基于DSP/FPGA的捷聯(lián)慣導(dǎo)系統(tǒng)方案,實(shí)現(xiàn)了系統(tǒng)各部分硬件電路以及FPGA功能模塊,并通過搭建硬件驗(yàn)證平臺(tái)和利用第三方仿真軟件,對傳感器的性能以及FPGA各功能模塊進(jìn)行了較全面的驗(yàn)證和仿真。結(jié)果表明:基于DSP/FPGA的捷聯(lián)慣導(dǎo)系統(tǒng)能夠滿足應(yīng)用的要求,并在小型化、低成本和高性能等方面有一定的優(yōu)勢。

    標(biāo)簽: DSPFPGA 捷聯(lián) 慣性導(dǎo)航 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:1966640071

  • 基于FPGA的面陣CCD驅(qū)動(dòng)傳輸電路設(shè)計(jì)

    圖像處理技術(shù)應(yīng)用越來越廣泛,特別是工業(yè)檢測領(lǐng)域。然而,圖像處理技術(shù)應(yīng)用的基礎(chǔ)是圖像的獲取,為了更加靈活地設(shè)計(jì)各種應(yīng)用產(chǎn)品,本課題研究基于FPGA的面陣 CCD驅(qū)動(dòng)傳輸電路設(shè)計(jì),利用該電路能夠獲取高質(zhì)量、高分辨率的圖像,為后續(xù)的圖像處理技術(shù)應(yīng)用打下基礎(chǔ)。本文首先介紹了研究意義、CCD圖像傳感器的發(fā)展以及FPGA的產(chǎn)生與發(fā)展,接著提出了面陣CCD成像系統(tǒng)總體設(shè)計(jì)方案,然后針對關(guān)鍵電路的設(shè)計(jì)進(jìn)行詳盡的分析和說明,這些電路包括時(shí)序發(fā)生電路、存儲(chǔ)器控制電路、USB接口電路以及電源調(diào)理電路。其中時(shí)序發(fā)生電路主要用于產(chǎn)生CCD正常工作所需的各種時(shí)序信號(hào)以及A/D變換芯片AD9824 所需的工作時(shí)序,這些時(shí)序都是由FPGA產(chǎn)生的,文中給出了FPGA邏輯設(shè)計(jì)的基本過程以及仿真波形。本系統(tǒng)采用SDRAM緩存圖像信號(hào),為了完成SDRAM的寫入、讀出以及定時(shí)刷新,利用FPGA生成存儲(chǔ)器控制電路。系統(tǒng)采用USB接口與計(jì)算機(jī)通信,因此FPGA 中設(shè)計(jì)了相應(yīng)邏輯電路與CY7C68013A USB接口芯片實(shí)現(xiàn)信號(hào)握手及數(shù)據(jù)通信,進(jìn)而與 PC機(jī)通信。為了保證各個(gè)芯片正常工作,設(shè)計(jì)電源調(diào)理電路實(shí)現(xiàn)將輸入5V電源轉(zhuǎn)換成多種電壓向各個(gè)芯片供電。經(jīng)過初步調(diào)試,并根據(jù)仿真結(jié)果判斷驅(qū)動(dòng)傳輸電路基本達(dá)到設(shè)計(jì)要求。關(guān)鍵詞:FPGA,CCD,A/D變換,SDRAM,USB,驅(qū)動(dòng)時(shí)序

    標(biāo)簽: FPGA CCD 面陣 傳輸

    上傳時(shí)間: 2013-04-24

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  • 基于磁阻傳感器的電子羅盤設(shè)計(jì)

    · 摘要:  社會(huì)生產(chǎn)、生活的許多方面需要用到地磁定向,本文以磁阻傳感器為基礎(chǔ),組合加速度計(jì)、溫度傳感器、A/D轉(zhuǎn)換芯片(ADS8364)以及DSP微控制器(MC56F8366)等器件構(gòu)建了一個(gè)具有傾角補(bǔ)償?shù)碾娮恿_盤,試驗(yàn)表明該系統(tǒng)具有良好的指向能力.  

    標(biāo)簽: 磁阻傳感器 電子羅盤

    上傳時(shí)間: 2013-07-09

    上傳用戶:lw4463301

  • STC12C5608AD

    STC12C5608單片機(jī)指令代碼完全兼容傳統(tǒng)8051,速度快8至12倍,內(nèi)部集成MAX810專用復(fù)位電路,4路PWM,8路高速10位A/D轉(zhuǎn)換,針對電機(jī)控制,強(qiáng)干擾場合。

    標(biāo)簽: C5608 5608 STC 12C

    上傳時(shí)間: 2013-04-24

    上傳用戶:VRMMO

  • FPGA進(jìn)行脈沖控制的多個(gè)源代碼實(shí)例

    pulse_sequence.vhd 并行脈沖控制器\r\nlight.vhd.vhd 交通脈沖控制器\r\ndivision1.vhd 電壓脈沖控制器中的分頻\r\nad.vhd 電壓脈沖控制器中的A/D控制\r\ncode.vhd 電壓脈沖控制器中的脈沖運(yùn)算模塊\r\nvoltage2.bdf 電壓脈沖控制系統(tǒng)

    標(biāo)簽: FPGA 脈沖控制 源代碼

    上傳時(shí)間: 2013-08-15

    上傳用戶:Zxcvbnm

  • 制作CPLD電路實(shí)驗(yàn)板的方法及步驟

    本文詳細(xì)介紹了制作電路板的方法及步驟.\r\n實(shí)驗(yàn)板的功能\r\n這個(gè)實(shí)驗(yàn)板可以做如下實(shí)驗(yàn):\r\n1.可以進(jìn)行運(yùn)算器(加、減、乘和除法)、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實(shí)驗(yàn)\r\n2.可以進(jìn)行觸發(fā)器、寄存器、計(jì)數(shù)器和一般時(shí)序電路的實(shí)驗(yàn)\r\n3.可以進(jìn)行頻率計(jì)電路、時(shí)鐘電路、計(jì)時(shí)電路、交通燈等復(fù)雜數(shù)字系統(tǒng)的實(shí)驗(yàn)\r\n4.加擴(kuò)展板可以進(jìn)行A/D、D/A、串行E2ROM和8031單片機(jī)等方面的實(shí)驗(yàn)\r\n

    標(biāo)簽: CPLD 電路 實(shí)驗(yàn)板

    上傳時(shí)間: 2013-09-01

    上傳用戶:吾學(xué)吾舞

  • PROTEUS仿真用單片機(jī)系統(tǒng)板

    PROTEUS仿真用單片機(jī)系統(tǒng)板\r\n系統(tǒng)資源豐富:\r\n★ 內(nèi)置RAM 32KB模塊\r\n★ 內(nèi)置8位動(dòng)態(tài)數(shù)碼顯示模塊\r\n★ 內(nèi)置8X8點(diǎn)陣顯示模塊\r\n★ 4位靜態(tài)數(shù)碼顯示模塊\r\n★ 4位級(jí)聯(lián)的74LS164串并轉(zhuǎn)換模塊\r\n★ 內(nèi)置8通道8位A/D轉(zhuǎn)換\r\n★ 內(nèi)置8位D/A轉(zhuǎn)換\r\n★ 內(nèi)置2路SPI和I2C總線接口\r\n★ 內(nèi)置4路1-Wire總線接口\r\n★ 內(nèi)置4X4矩陣式鍵盤\r\n★ 內(nèi)置4路獨(dú)立式鍵盤\r\n★ 內(nèi)置4路撥動(dòng)開關(guān)\r\n★ 內(nèi)置8位LED發(fā)光二

    標(biāo)簽: PROTEUS 仿真 用單片機(jī) 系統(tǒng)板

    上傳時(shí)間: 2013-09-30

    上傳用戶:sssl

  • Σ-Δ模數(shù)轉(zhuǎn)換器工作原理及簡單分析

    ∑-ΔA/D轉(zhuǎn)換器是一種高精度的模數(shù)轉(zhuǎn)換器,它和傳統(tǒng)的A/D轉(zhuǎn)換器不同,具有高分辨率、高集成度、造價(jià)低和使用方便的特點(diǎn), 并且越來越廣泛地使用在一些高精度儀器儀表和測量設(shè)備中。文章從信號(hào)的過采樣、噪聲整形、數(shù)字抽取濾波等方面分析了∑-ΔA/D轉(zhuǎn)換器的工作原理,對人們?nèi)媪私?sum;-ΔA/D轉(zhuǎn)換器有一定的幫助。

    標(biāo)簽: 模數(shù)轉(zhuǎn)換器 工作原理

    上傳時(shí)間: 2013-11-25

    上傳用戶:Vici

  • 典型的集成ADC芯片

    A/D轉(zhuǎn)換

    標(biāo)簽: ADC 典型 集成 芯片

    上傳時(shí)間: 2013-10-11

    上傳用戶:我干你啊

  • 單端10-bit SAR ADC IP核的設(shè)計(jì)

    本設(shè)計(jì)通過采用分割電容陣列對DAC進(jìn)行優(yōu)化,在減小了D/A轉(zhuǎn)換開關(guān)消耗的能量、提高速度的基礎(chǔ)上,實(shí)現(xiàn)了一款采樣速度為1 MS/s的10-bit單端逐次逼近型模數(shù)轉(zhuǎn)換器。使用cadence spectre 工具進(jìn)行仿真,仿真結(jié)果表明,設(shè)計(jì)的D/A轉(zhuǎn)換器和比較器等電路滿足10-bit A/D 轉(zhuǎn)換的要求,逐次逼近A/D轉(zhuǎn)換器可以正常工作。

    標(biāo)簽: bit SAR ADC 10

    上傳時(shí)間: 2013-11-21

    上傳用戶:chukeey

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