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SIGMA-Delta

VHDL 基礎程序百例 FPGA 邏輯設計源碼

VHDL 基礎程序百例 FPGA 邏輯設計源碼VHDL語言100例第1例帶控制端口的加法器第2例無控制端口的加法器第3例乘法器第4例比較器第5例二路選擇器第6例寄存器第7例移位寄存器第8例綜合單元庫第9例七值邏輯與基本數(shù)據(jù)類型第10例函數(shù)第11例七值邏輯線或分辨函數(shù)第12例轉換函數(shù)第13例左移函數(shù)第14例七值邏輯程序包第15例四輸入多路器第16例目標選擇器第17例奇偶校驗器第18例映射單元庫及其使用舉第19例循環(huán)邊界常數(shù)化測試第20例保護保留字第21例進程死鎖第22例振蕩與死鎖第23例振蕩電路第24例分辨信號與分辨函數(shù)第25例信號驅動源第26例屬性TRANSACTION和分辨信號第27例塊保護及屬性EVENT,第28例形式參數(shù)屬性的測試第29例進程和并發(fā)語句第30例信號發(fā)送與接收第31例中斷處理優(yōu)先機制建模第32例過程限定第33例整數(shù)比較器及其測試第34例數(shù)據(jù)總線的讀寫第35例基于總線的數(shù)據(jù)通道第36例基于多路器的數(shù)據(jù)通道第37例四值邏輯函數(shù)第38例四值邏輯向量按位或運算第39例生成語句描述規(guī)則結構第40例帶類屬的譯碼器描述第41例帶類屬的測試平臺第42例行為與結構的混合描述第43例四位移位寄存器第44例寄存／計數(shù)器第45例順序過程調用第46例 VHDL中generic缺省值的使用第47例無輸入元件的模擬第48例測試激勵向量的編寫第49例 delta延遲例釋第50例慣性延遲分析第51例傳輸延遲驅動優(yōu)先第52例多倍（次）分頻器第53例三位計數(shù)器與測試平臺第54例分秒計數(shù)顯示器的行為描述6第55例地址計數(shù)器第56例指令預讀計數(shù)器第57例加.c減.c乘指令的譯碼和操作第58例 2－4譯碼器結構描述第59例 2－4譯碼器行為描述第60例轉換函數(shù)在元件例示中的應用第61例基于同一基類型的兩分辨類型的賦值相容問題第62例最大公約數(shù)的計算第63例最大公約數(shù)七段顯示器編碼第64例交通燈控制器第65例空調系統(tǒng)有限狀態(tài)自動機第66例 FIR濾波器第67例五階橢圓濾波器第68例鬧鐘系統(tǒng)的控制第69例鬧鐘系統(tǒng)的譯碼第70例鬧鐘系統(tǒng)的移位寄存器第71例鬧鐘系統(tǒng)的鬧鐘寄存器和時間計數(shù)器第72例鬧鐘系統(tǒng)的顯示驅動器第73例鬧鐘系統(tǒng)的分頻器第74例鬧鐘系統(tǒng)的整體組裝第75例存儲器第76例電機轉速控制器第77例神經(jīng)元計算機第78例ccAm2901四位微處理器的ALU輸入第79例ccAm2901四位微處理器的ALU第80例ccAm2901四位微處理器的RAM第81例ccAm2901四位微處理器的寄存器第82例ccAm2901四位微處理器的輸出與移位第83例ccAm2910四位微程序控制器中的多路選擇器第84例ccAm2910四位微程序控制器中的計數(shù)器／寄存器第85例ccAm2910四位微程序控制器的指令計數(shù)器第86例ccAm2910四位微程序控制器的堆棧第87例 Am2910四位微程序控制器的指令譯碼器第88例可控制計數(shù)器第89例四位超前進位加法器第90例實現(xiàn)窗口搜索算法的并行系統(tǒng)（1）——協(xié)同處理器第91例實現(xiàn)窗口搜索算法的并行系統(tǒng)（2）——序列存儲器第92例實現(xiàn)窗口搜索算法的并行系統(tǒng)（3）——字符串存儲器第93例實現(xiàn)窗口搜索算法的并行系統(tǒng)（4）——頂層控制器第94例 MB86901流水線行為描述組成框架第95例 MB86901寄存器文件管理的描述第96例 MB86901內ALU的行為描述第97例移位指令的行為描述第98例單周期指令的描述第99例多周期指令的描述第100例 MB86901流水線行為模型

標簽： vhdl fpga

上傳時間： 2022-05-14

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24位ADC驅動代碼

ADS1256 是TI（Texas I nstruments ）公司推出的一款低噪聲高分辨率的24 位Si gma - Delta（"- #）模數(shù)轉換器（ADC）。"- #ADC 與傳統(tǒng)的逐次逼近型和積分型ADC 相比有轉換誤差小而價格低廉的優(yōu)點，但由于受帶寬和有效采樣率的限制，"- #ADC 不適用于高頻數(shù)據(jù)采集的場合。該款ADS1256 可適合于采集最高頻率只有幾千赫茲的模擬數(shù)據(jù)的系統(tǒng)中，數(shù)據(jù)輸出速率最高可為30K 采樣點／秒（SPS），有完善的自校正和系統(tǒng)校正系統(tǒng)， SPI 串行數(shù)據(jù)傳輸接口。本文結合筆者自己的應用經(jīng)驗，對該ADC 的基本原理以及應用做簡要介紹。ADs1256 的總體電氣特性下面介紹在使用ADs1256 的過程中要注意的一些電氣方面的具體參數(shù)：模擬電源（AVDD ）輸入范圍+ 4 . 75V !+ 5 .25V，使用的典型值為+ 5 .00V；數(shù)字電源（DVDD ）輸入范圍+ 1 . 8V !+ 3 .6V，使用的典型值+ 3 .3V；參考電壓值（VREF= VREFP- VREFN）的范圍+ 0 .5V!+ 2 .6V，使用的典型值為+ 2 .5V；耗散功率最大為57mW；每個模擬輸入端（AI N0 !7 和AI NC M）相對于模擬地（AGND）的絕對電壓值范圍在輸入緩沖器（BUFFER）關閉的時候為AGND-0 .1 !AVDD+ 0 . 1 ，在輸入緩沖器打開的時候為AGND !AVDD-2 .0 ；滿刻度差分模擬輸入電壓值（VI N = AI NP -AI NN）為+ ／-（2VREF／PGA）；數(shù)字輸入邏輯高電平范圍0 .8DVDD!5 .25V（除D0 !D3 的輸入點平不可超過DVDD 外），邏輯低點平范圍DGND!0 .2DVDD；數(shù)字輸出邏輯高電平下限為0 .8DVDD，邏輯低電平上限為0 .2DVDD，輸出電流典型值為5mA；主時鐘頻率由外部晶體振蕩器提供給XTAL1和XTAL2 時，要求范圍為2 M!10 MHz ，僅由CLKI N 輸入提供時，范圍為0 .1 M!10 MHz 。

標簽： ADC ADS1256

上傳時間： 2022-06-10

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基于python的分子動力學模擬程序編寫及應用

本文利用python編寫了分子動力學模擬程序,并利用該程序對He分子體系進行了詳細研究。分別研究了不同初始條件,不同邊界條件,截斷點位置等的研究。在分子數(shù)為500,分子初速度為500的初始條件下,體系最終經(jīng)過2.25e-11s發(fā)展成為麥克斯韋平衡體系。分別研究周期性邊界條件與剛性邊界對系統(tǒng)發(fā)展的影響,研究發(fā)現(xiàn)周期性邊界條件與剛性邊界條件最終對系統(tǒng)的發(fā)展沒有明顯影響。對截斷點進行研究后發(fā)現(xiàn),必須選取大于1.1*sigma(sigma為L-J勢能中的常數(shù),由實驗可測定)作為截斷,如果小于該值,體系由于數(shù)值誤差將偏離物理實際。同時研究發(fā)現(xiàn)勢函數(shù)對于體系的發(fā)展也具有重要影響。

標簽： python

上傳時間： 2022-06-19

上傳用戶：shjgzh
MODBUS RS-485 通訊設置

DELTA 產(chǎn)品MODBUS RS-485通訊設置

標簽： RS-485

上傳時間： 2022-07-25

上傳用戶：zhaiyawei