臺灣人梁奕智寫的VHDL編程學習的PPT講義，里面包括內容有D觸發器、寄存器、累加器、計數器、有限狀態機等非常有用的內容。
標簽： VHDL 編程 講義
上傳時間： 2016-05-04
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全數字QAM解調器研究 較為詳細的qam同步、均衡計算方法，研究生論文。希望對研究QAM的人又用
標簽： QAM qam 全數字 解調器
上傳時間： 2016-05-22
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分頻器是FPGA設計中使用頻率非常高的基本單元之一。盡管目前在大部分設計中還廣泛使用集成鎖相環(如altera的PLL，Xilinx的DLL)來進行時鐘的分頻、倍頻以及相移設計，但是，對于時鐘要求不太嚴格的設計，通過自主設計進行時鐘分頻的實現方法仍然非常流行。首先這種方法可以節省鎖相環資源，再者，這種方式只消耗不多的邏輯單元就可以達到對時鐘操作的目的。 偶數倍分頻：偶數倍分頻應該是大家都比較熟悉的分頻，通過計數器計數是完全可以實現的。如進行N倍偶數分頻，那么可以通過由待分頻的時鐘觸發計數器計數，當計數器從0計數到N/2-1時，輸出時鐘進行翻轉，并給計數器一個復位信號，使得下一個時鐘從零開始計數。以此循環下去。這種方法可以實現任意的偶數分頻。
標簽： altera FPGA PLL 分頻器
上傳時間： 2016-06-14
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8位移位寄存器，當高電平來時移入下一位！
標簽： 8位移位寄存器
上傳時間： 2013-12-01
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批量郵件發送器v01 - 2008-03-15 功能：對于某一路徑下的文件，以附件的形式發送到某一個或多個郵箱里。 可配置參數（properties.txt）包括： -smtp服務器（目前僅支持gmail） -用戶名、密碼 -發件人地址 -收件人地址（可多個） -郵件主題，文本內容 -一個本地目錄（目錄下符合條件的文件將被發送） -文件名過濾規則（自定義正則表達式） -是否遞歸處理子文件夾 -所用郵箱附件最大值（gmail為10M） -發送郵件的休息間隔 -是否日志記錄 系統要求： jre6 或者理論上 早期版本jdk+JAF+javamail（需重新編譯源代碼，未測試） 已知問題： 1. gmail和hotmail郵箱能夠正常收取 126郵箱不能正常收取附件 其他郵箱未測試 2. 中文支持應該沒問題 運行： java -jar BulkEmailSender.jar
標簽： 2008 v01 03 15
上傳時間： 2014-08-23
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J T AG 接口插座與DSP芯片的距離:為了保證JTAG信號不受干擾，需 要注意兩者之間的距離不超過六英寸(15甲24厘米)，超過這個距離，就需要在中 間加緩沖芯片。本設計中使用了244作為緩沖芯片，但其原因不是由于器件之間 距離過長，而是考慮到仿真器工作在5V電壓，DSP引腳為3.3V，為了電平兼容 性而進行的電壓轉換功能。
標簽： JTAG DSP AG 接口
上傳時間： 2013-12-18
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使用verilog作為CPU設計語言實現單數據通路五級流水線的CPU。具有32個通用寄存器、一個程序計數器PC、一個標志寄存器FLAG，一個堆棧寄存器STACK。存儲器尋址粒度為字節。數據存儲以32位字對準。采用32位定長指令格式，采用Load/Store結構，ALU指令采用三地址格式。支持有符號和無符號整數加、減、乘、除運算，并支持浮點數加、減、乘、除四種運算，支持與、或、異或、非4種邏輯運算，支持邏輯左移、邏輯右移、算術右移、循環右移4種移位運算，支持Load/Store操作，支持地址/立即數加載操作，支持無條件轉移和為0轉移、非0轉移、無符號>轉移、無符號<轉移、有符號>轉移、有符號<轉移等條件轉移。
標簽： CPU verilog FLAG 語言
上傳時間： 2013-12-11
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多種模式留言系統 本留言系統 支持多種模式 一 簽寫留言模式 二 留言本模式 三 論壇模式 應用了第三的文本編輯器 支持動態更改網站標題 動態添加廣告 支持留言頭像選擇，頭像分男性、女性 加密留言,只有管理員以及知道密碼的人可見 后臺管理有一下內容： 留言管理(包括審核留言和刪除留言) 系統設置（包括網站標題默認顯示模式首頁廣告面積等） 帳號管理（包括添加刪除修改和設置權限等功能） 廣告設置（包括添加修改和刪除廣告（寫人XML文檔））
標簽： 模式 動態 文本編輯器
上傳時間： 2016-07-18
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單片機C語言編程與實例，比assembly language容易掌握，幫助建立較複雜的自動化系統
標簽：
上傳時間： 2016-07-26
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七號信令解碼器，N多人多年心血，奉獻給需要的人，有問題請email:leafboyman@tom.com
標簽： 七號信令 解碼器
上傳時間： 2016-08-02
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