系統(tǒng)采用ATME189S52 為微控制器(MCE)核心，實(shí)現(xiàn)了可控的恒定直流電流源設(shè)計(jì)。核心恒流模塊采用自反饋電路連接大功率場(chǎng)效應(yīng)管IRFZ44NL，使得電流輸出范圍達(dá)到20~2000
標(biāo)簽： FET 大功率 數(shù)控直流 電流源設(shè)計(jì)
上傳時(shí)間： 2013-07-05
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經(jīng)典 的 硬件 工程師 培訓(xùn)資料
上傳時(shí)間： 2013-07-18
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常規(guī)的壓控電源采用的是并聯(lián)電流負(fù)反饋電路，這種電路輸出電壓柔性較差，電壓輸出效率低，因?yàn)槿与娮枰嫉艉艽笠徊糠值碾妷海⑶页Ｒ?guī)的壓控電流源不能實(shí)現(xiàn)一端接地，這也是并聯(lián)電流負(fù)反饋本身的
標(biāo)簽： Howland 電流泵 電流源設(shè)計(jì)
上傳時(shí)間： 2013-07-02
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現(xiàn)代雷達(dá)系統(tǒng)廣泛采用脈沖壓縮技術(shù)，用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達(dá)通過(guò)發(fā)射寬脈沖，保證足夠的最大作用距離，而接收時(shí)，采用相應(yīng)的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過(guò)程。同時(shí)，數(shù)字信號(hào)處理技術(shù)的迅猛發(fā)展和廣泛應(yīng)用，為雷達(dá)脈沖壓縮處理的數(shù)字化實(shí)現(xiàn)提供了可能。 本文主要研究雷達(dá)多波形頻域數(shù)字脈沖壓縮系統(tǒng)的硬件系統(tǒng)實(shí)現(xiàn)。在匹配濾波理論的指導(dǎo)下，成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數(shù)字脈沖壓縮系統(tǒng)。該系統(tǒng)可處理時(shí)寬在42μs以內(nèi)、帶寬在5MHz以下的線性調(diào)頻信號(hào)(LFM)，非線性調(diào)頻信號(hào)(NLFM)和Taylor四相碼信號(hào)，且技術(shù)指標(biāo)完全滿足實(shí)用系統(tǒng)的設(shè)計(jì)要求。 本文完成的主要工作和創(chuàng)新之處有：(1)基于雙通道模數(shù)轉(zhuǎn)換器AD10242設(shè)計(jì)高精度數(shù)據(jù)采集電路，為整個(gè)脈壓系統(tǒng)的工作提供必要的條件。完成了前端模擬信號(hào)輸入電路的優(yōu)化和差分輸入時(shí)鐘的產(chǎn)生，以實(shí)現(xiàn)高精度采樣。 (2)根據(jù)協(xié)議和脈壓系統(tǒng)的工作要求，以基于FPGAEP1K100QC208完成系統(tǒng)控制，使整個(gè)脈壓系統(tǒng)正確穩(wěn)定地工作。同時(shí)以該FPGA生成雙口RAM，實(shí)現(xiàn)數(shù)據(jù)暫存，以匹配采樣速率和脈壓系統(tǒng)頻率。 (3)設(shè)計(jì)基于4片高性能ADSP21160M的緊耦合并行處理系統(tǒng)，以完成多波形頻域數(shù)字脈沖壓縮的全部運(yùn)算工作。4片DSP共享外部總線，且各DSP以鏈路口互連，進(jìn)行數(shù)據(jù)通信。各DSP還使用一個(gè)鏈路口連接到接口板DSP，將脈壓結(jié)果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心，設(shè)計(jì)輸出板電路，完成數(shù)據(jù)對(duì)齊、求模和數(shù)據(jù)向下一級(jí)的輸出，并產(chǎn)生模擬輸出。 (5)調(diào)試并改進(jìn)處理板和輸出板。
標(biāo)簽： FPGA DSP 多波形 壓縮系統(tǒng)
上傳時(shí)間： 2013-06-11
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相位激光測(cè)距是一種高精度的距離測(cè)量技術(shù)，隨著電子器件和信號(hào)處理技術(shù)的發(fā)展，這種測(cè)距技術(shù)在軍用和民用領(lǐng)域必將得到更為廣泛的研究和應(yīng)用。本文介紹了一種基于FPGA嵌入式技術(shù)的相位激光測(cè)距系統(tǒng)，該系統(tǒng)采用先進(jìn)的FPGA技術(shù)，實(shí)現(xiàn)了調(diào)制信號(hào)產(chǎn)生、信息控制與處理三個(gè)模塊的整合，解決了傳統(tǒng)相位激光測(cè)距所難以克服的弱點(diǎn)。 文中闡述了激光測(cè)距和調(diào)制信號(hào)源的基本原理，分析了影響測(cè)距精度的因素，指出應(yīng)用DDS技術(shù)可以實(shí)現(xiàn)寬帶、高精度的調(diào)制信號(hào)輸出，說(shuō)明了引起DDS輸出信號(hào)雜散的原因和解決的辦法。分析了應(yīng)用FFT運(yùn)算實(shí)現(xiàn)信號(hào)相位提取的基本原理及設(shè)計(jì)方法，采用這種檢相技術(shù)，可以極大地提高測(cè)相精度與靈敏度。提出了基于FPGA嵌入式系統(tǒng)的相位式激光測(cè)距機(jī)的整體設(shè)計(jì)，并就各部分進(jìn)行了詳細(xì)的分析與設(shè)計(jì)。介紹了激光測(cè)距系統(tǒng)的外圍電路和基于QuartusⅡ集成軟件平臺(tái)的部分硬件電路的設(shè)計(jì)，并對(duì)其中的設(shè)計(jì)進(jìn)行了仿真和驗(yàn)證，總結(jié)提出了對(duì)系統(tǒng)今后的進(jìn)一步改進(jìn)和完善的思路。
標(biāo)簽： FPGA 嵌入式系統(tǒng) 激光測(cè)距機(jī)
上傳時(shí)間： 2013-06-28
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頻率特性測(cè)試儀(簡(jiǎn)稱掃頻儀)是一種測(cè)試電路頻率特性的儀器，它廣泛應(yīng)用于無(wú)線電、電視、雷達(dá)及通信等領(lǐng)域，為分析和改善電路的性能提供了便利的手段。而傳統(tǒng)的掃頻儀由多個(gè)模塊構(gòu)成，電路復(fù)雜，體積龐大，而且在高頻測(cè)量中，大量的分立元件易受溫度變化和電磁干擾的影響。為此，本文提出了集成化設(shè)計(jì)的方法，針對(duì)可編程邏輯器件的特點(diǎn)，對(duì)硬件實(shí)現(xiàn)方法進(jìn)行了探索。 本文對(duì)三大關(guān)鍵技術(shù)進(jìn)行了深入研究： 第一，由掃頻信號(hào)發(fā)生器的設(shè)計(jì)出發(fā)，對(duì)直接數(shù)字頻率合成技術(shù)(DDS)進(jìn)行了系統(tǒng)的理論研究，并改進(jìn)了ROM壓縮方法，在提高壓縮比的同時(shí)，改進(jìn)了DDS系統(tǒng)的雜散度，并且利用該方法實(shí)現(xiàn)了幅度和相位可調(diào)制的DDS系統(tǒng)-掃頻信號(hào)發(fā)生器。 第二，為了提高系統(tǒng)時(shí)鐘的工作頻率，對(duì)流水線算法進(jìn)行了深入的研究，并針對(duì)累加器的特點(diǎn)，進(jìn)行了一系列的改進(jìn)，使系統(tǒng)能在100MHz的頻率下正常工作。 第三，從系統(tǒng)頻率特性測(cè)試的理論出發(fā)，研究如何在FPGA中提高多位數(shù)學(xué)運(yùn)算的速度，從而提出了一種實(shí)現(xiàn)多位BCD碼除法運(yùn)算的方法—高速串行BCD碼除法；隨后，又將流水線技術(shù)應(yīng)用于該算法，對(duì)該方法進(jìn)行改進(jìn)，完成了基于流水線技術(shù)的BCD碼除法運(yùn)算的設(shè)計(jì)，并用此方法實(shí)現(xiàn)了頻率特性的測(cè)試。 在研究以上理論方法的基礎(chǔ)上，以大規(guī)模可編程邏輯器件EP1K100QC208和微處理器89C52為實(shí)現(xiàn)載體，提出了基于單片機(jī)和FPGA體系結(jié)構(gòu)的集成化設(shè)計(jì)方案；以VerilogHDL為設(shè)計(jì)語(yǔ)言，實(shí)現(xiàn)了頻率特性測(cè)試儀主要部分的設(shè)計(jì)。該頻率特性測(cè)試儀完成掃頻信號(hào)的輸出和頻率特性的測(cè)試兩大主要任務(wù)，而掃頻信號(hào)源和頻率特性測(cè)試這兩大主要模塊可集成在一片可編程邏輯器件中，充分體現(xiàn)了可編程邏輯器件的優(yōu)勢(shì)。 本文首先對(duì)相關(guān)的概念理論進(jìn)行了介紹，包括DDS原理、流水線技術(shù)等，進(jìn)而提出了系統(tǒng)的總體設(shè)計(jì)方案，包括設(shè)計(jì)工具、語(yǔ)言和實(shí)現(xiàn)載體的選擇，而后，簡(jiǎn)要介紹了微處理器電路和外圍電路，最后，較為詳細(xì)地闡述了兩個(gè)主要模塊的設(shè)計(jì)，并給出了實(shí)現(xiàn)方式。
標(biāo)簽： FPGA 頻率特性 測(cè)試 儀的研制
上傳時(shí)間： 2013-06-08
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本文提出一種基于PC104嵌入式工業(yè)控制計(jì)算機(jī)與現(xiàn)場(chǎng)可編程門陣列(FPGA)的PCB測(cè)試機(jī)的硬件控制系統(tǒng)設(shè)計(jì)方案。方案中設(shè)計(jì)高效高壓控制電路，實(shí)現(xiàn)測(cè)試電壓與測(cè)試電流的精確數(shù)字控制。選用雙高壓電子開(kāi)關(guān)形式代替高壓模擬電子開(kāi)關(guān)，大幅度提高測(cè)試電壓。采用多電源方式在低控制電壓下實(shí)現(xiàn)對(duì)高壓電子開(kāi)關(guān)的控制。設(shè)計(jì)高速信號(hào)處理電路對(duì)測(cè)試信號(hào)進(jìn)行處理，從硬件上提高系統(tǒng)測(cè)試速度。 本設(shè)計(jì)中選用Altera公司的現(xiàn)場(chǎng)可編程器(FPGA)EP1K50，利用EDA設(shè)計(jì)工具Synplify、Modelsim、QuartusⅡ以及Verilog硬件描述語(yǔ)言完成了控制系統(tǒng)的硬件設(shè)計(jì)及調(diào)試，解決了由常規(guī)電路難以實(shí)現(xiàn)的問(wèn)題。
標(biāo)簽： FPGA 電路板 測(cè)試機(jī) 硬件設(shè)計(jì)
上傳時(shí)間： 2013-06-04
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本文結(jié)合中國(guó)科技大學(xué)大規(guī)模集成電路實(shí)驗(yàn)室和中國(guó)科學(xué)院上海技術(shù)物理研究所合作的星載紅外相機(jī)項(xiàng)目，為了解決紅外相機(jī)上的不同波段的紅外探測(cè)元陣列存在的非均勻性問(wèn)題，對(duì)紅外焦平面探測(cè)元陣列存在的非均勻性問(wèn)題展開(kāi)了深入的分析和研究。 主要研究和分析了兩類算法的基本原理，重點(diǎn)研究和實(shí)現(xiàn)了定標(biāo)校正算法，通過(guò)對(duì)積分球定標(biāo)數(shù)據(jù)進(jìn)行深入的分析，將探測(cè)元分成線性探測(cè)元和非線性探測(cè)元，對(duì)線性探測(cè)元采用兩點(diǎn)校正法，對(duì)非線性探測(cè)元采用多點(diǎn)分段校正算法，在利用FPGA硬件實(shí)現(xiàn)非均勻校正時(shí)，分析設(shè)計(jì)了基于乘法運(yùn)算和加法運(yùn)算的FPGA實(shí)現(xiàn)，在基于乘加器運(yùn)算的FPGA實(shí)現(xiàn)中。設(shè)計(jì)出了乘法和加法整體運(yùn)算的乘加器，內(nèi)部采用流水線wallace樹(shù)壓縮結(jié)構(gòu)，大大加快乘法和加法的速度。
上傳時(shí)間： 2013-04-24
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隨著圖像處理和模式識(shí)別技術(shù)的進(jìn)步，基于生物特征的識(shí)別技術(shù)成為蓬勃發(fā)展的高技術(shù)之一，根據(jù)IBG(InternationalBiometricGroup)組織對(duì)生物特征市場(chǎng)的統(tǒng)計(jì)和預(yù)測(cè)，該領(lǐng)域的收入的年增長(zhǎng)率30-50％，到2008年，全球總收入將達(dá)到46.39億美元。而基于指紋特征的識(shí)別技術(shù)由于其獨(dú)特的可靠性，穩(wěn)定性，方便快捷的特點(diǎn)，恰好符合了市場(chǎng)的需求。目前指紋識(shí)別技術(shù)是生物識(shí)別領(lǐng)域中應(yīng)用最廣泛的識(shí)別技術(shù)，也是研究與應(yīng)用的一個(gè)熱點(diǎn)。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計(jì)領(lǐng)域中最熱門的概念。NiosⅡ是Altera公司開(kāi)發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核，可以將它嵌入FPGA內(nèi)部，與用戶自定義邏輯結(jié)合構(gòu)成一個(gè)基于FPGA的片上系統(tǒng)。與嵌入式硬核相比較，嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識(shí)別系統(tǒng)對(duì)速度的要求。 本文對(duì)指紋識(shí)別技術(shù)中各個(gè)環(huán)節(jié)的算法進(jìn)行了較為深入的研究，結(jié)合NiosⅡ嵌入式處理器的特點(diǎn)，對(duì)算法進(jìn)行了合理的選擇與優(yōu)化，形成了一套完整的指紋識(shí)別算法，并提出了一種基于FPGA的指紋識(shí)別系統(tǒng)硬件設(shè)計(jì)方案。 論文的內(nèi)容主要包括以下幾個(gè)方面： 1、對(duì)指紋圖像預(yù)處理、后處理和匹配算法進(jìn)行了改進(jìn)，提高了算法的性能；設(shè)計(jì)了一種適用于快速匹配的指紋特征數(shù)據(jù)結(jié)構(gòu)；提出了一套基于特征點(diǎn)匹配的指紋識(shí)別算法。實(shí)驗(yàn)結(jié)果表明該算法速度快、誤識(shí)率較低、可靠性較高，可以滿足實(shí)用的要求。 2、本著增加系統(tǒng)集成度、減小系統(tǒng)體積、提高便攜性、降低功耗和成本，同時(shí)提升系統(tǒng)的性能的原則，使用Altera公司提供的外圍設(shè)備IP核配合NiosⅡ處理器軟核搭建了一個(gè)單片嵌入式系統(tǒng)，然后以內(nèi)嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片，外配片外RAM和Flash存儲(chǔ)器以及小鍵盤(pán)和LCD顯示屏等器件，設(shè)計(jì)了一個(gè)便攜式指紋識(shí)別系統(tǒng)，提出了一套基于FPGA的硬件設(shè)計(jì)方案。 3、利用NiosⅡ開(kāi)發(fā)板對(duì)硬件設(shè)計(jì)方案進(jìn)行了初步的驗(yàn)證，實(shí)現(xiàn)了指紋采集芯片F(xiàn)PS200與FPGA的接口，并進(jìn)行了算法的移植。 實(shí)驗(yàn)結(jié)果表明本文所提出的系統(tǒng)設(shè)計(jì)方案是可行的。基于FPGA的自動(dòng)指紋識(shí)別系統(tǒng)在速度、功耗、體積、擴(kuò)展性方面有著獨(dú)特的優(yōu)勢(shì)，具有廣闊的發(fā)展空間。最后提出了對(duì)這一設(shè)計(jì)繼續(xù)改進(jìn)的思路和下一步研究的內(nèi)容。
標(biāo)簽： FPGA 指紋識(shí)別 法的研究 硬件實(shí)現(xiàn)
上傳時(shí)間： 2013-06-07
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全面介紹硬件電子工程師所需技能的教程 常用測(cè)量?jī)x器的應(yīng)用
上傳時(shí)間： 2013-06-27
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