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VHDL-Code

CPLD VHDL CODE非常好的參考資料

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標簽： CPLD CODE VHDL 參考資料

上傳時間： 2013-08-14

上傳用戶：songkun
VHDL 關于2DFFT設計程序 u scinode1 ∼ scinode9.vhd: Every SCI node RTL vhdl code. The details can be

VHDL 關于2DFFT設計程序 u scinode1 ∼ scinode9.vhd: Every SCI node RTL vhdl code. The details can be seen in the following section. u 2dfft.vhd: The top module includes these scinodes and form a 3x3 SCI Torus network, and it support these sub-modules scinode1∼ scinode9 reset and clk and global_cnt signals to synchronous the sub-modules to simplify the overall design. u proj2.wfc: VSS simulation result that is the same as the ModelSim simulation result. u Pro2_2.wfc: VSS simulation result of another test pattern can’t cause overflow situation.

標簽： scinode1 scinode details 2DFFT

上傳時間： 2014-12-02

上傳用戶：15071087253
NAND Flash Controller & ECC VHDL Code

NAND Flash Controller & ECC VHDL Code

標簽： Controller Flash NAND Code

上傳時間： 2014-01-18

上傳用戶：sz_hjbf
xinlinx s vhdl code model and user guider

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標簽： xinlinx guider model vhdl

上傳時間： 2015-10-19

上傳用戶：l254587896
filter-VHDL-Code.rar為濾波器的完整VHDL程序

filter-VHDL-Code.rar為濾波器的完整VHDL程序，可用于IIR與FIR濾波器的仿真與驗證實現，包括代碼綜合。使用版本為ISE6.3.

標簽： filter-VHDL-Code VHDL 濾波器

上傳時間： 2015-11-28

上傳用戶：wmwai1314
使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)

使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)

標簽： WiMax FPGA OFDM VHDL

上傳時間： 2016-01-22

上傳用戶：zhuyibin
cic 4 stages vhdl code

cic 4 stages vhdl code

標簽： stages code vhdl cic

上傳時間： 2013-12-28

上傳用戶：363186
VHDL code for a clock divider by 27 circuit with a resulting waveform with 50％ duty cycle..

VHDL code for a clock divider by 27 circuit with a resulting waveform with 50％ duty cycle..

標簽： with resulting waveform circuit

上傳時間： 2014-01-05

上傳用戶：woshini123456
Very good info. for RS-232 transmitter VHDL code .

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標簽： transmitter Very VHDL good

上傳時間： 2016-07-14

上傳用戶：極客
Very good info. for RS-232 receive VHDL code .

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標簽： receive Very VHDL good

上傳時間： 2016-07-14

上傳用戶：米卡

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NAND Flash Controller & ECC VHDL Code

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使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)

cic 4 stages vhdl code

VHDL code for a clock divider by 27 circuit with a resulting waveform with 50％ duty cycle..

Very good info. for RS-232 transmitter VHDL code .

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