一種基于FPGA的VITERBI譯碼器一種基于FPGA的VITERBI譯碼器
上傳時(shí)間： 2013-11-25
上傳用戶：xg262122
it is a matlab program that describes DVB-S channel and simulation of VITERBI decoding
標(biāo)簽： simulation describes decoding channel
上傳時(shí)間： 2014-01-23
上傳用戶：maizezhen
The VITERBI algorithm
標(biāo)簽： algorithm VITERBI The
上傳時(shí)間： 2014-01-01
上傳用戶：luopoguixiong
VITERBI algorithm_code_verilog
標(biāo)簽： algorithm_code_verilog VITERBI
上傳時(shí)間： 2017-08-19
上傳用戶：han_zh
Hard VITERBI QPSK in AWGN, Rayleight soft VITERBI QAM in AWGN, Rayleight VITERBI QAM in AWGN, Rayleight VITERBI QPSK in AWGN, Rayleight
標(biāo)簽： Rayleight AWGN VITERBI QAM
上傳時(shí)間： 2017-08-30
上傳用戶：lxm
VITERBI in java. VITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBIVITERBI
標(biāo)簽： VITERBIVITERBIVITERBIVITERBIViter biVITERBIVITERBIVITERBIVITERBIVit erbiVITERBIV
上傳時(shí)間： 2014-12-03
上傳用戶：xz85592677
FPGA-based VITERBI convolutional coding and decoding of the Research and Implementation
標(biāo)簽： Implementation convolutional FPGA-based and
上傳時(shí)間： 2014-01-20
上傳用戶：sunjet
It is turbo encoder and decoder qritten for communication module has VITERBI
標(biāo)簽： communication encoder decoder qritten
上傳時(shí)間： 2013-12-11
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VITERBI譯碼算法是一種卷積碼的解碼算法。優(yōu)點(diǎn)不說了。缺點(diǎn)就是隨著約束長(zhǎng)度的增加算法的復(fù)雜度增加很快。約束長(zhǎng)度N為7時(shí)要比較的路徑就有64條，為8時(shí)路徑變?yōu)?28條。 (2<<(N-1))。所以VITERBI譯碼一般應(yīng)用在約束長(zhǎng)度小于10的場(chǎng)合中。 先說編碼（舉例約束長(zhǎng)度為7）：編碼器7個(gè)延遲器的狀態(tài)（0，1）組成了整個(gè)編碼器的64個(gè)狀態(tài)。每個(gè)狀態(tài)在編碼器輸入0或1時(shí)，會(huì)跳轉(zhuǎn)到另一個(gè)之中。比如110100輸入1時(shí)，變成101001（其實(shí)就是移位寄存器）。并且輸出也是隨之而改變的。 這樣解碼的過程就是逆過程。算法規(guī)定t時(shí)刻收到的數(shù)據(jù)都要進(jìn)行64次比較，就是64個(gè)狀態(tài)每條路有兩條分支（因?yàn)檩斎?或1），同時(shí)，跳傳到不同的兩個(gè)狀態(tài)中去，將兩條相應(yīng)的輸出和實(shí)際接收到的輸出比較，量度值大的拋棄（也就是比較結(jié)果相差大的），留下來的就叫做幸存路徑，將幸存路徑加上上一時(shí)刻幸存路徑的量度然后保存，這樣64條幸存路徑就增加了一步。在譯碼結(jié)束的時(shí)候，從64條幸存路徑中選出一條量度最小的，反推出這條幸存路徑（叫做回溯），得出相應(yīng)的譯碼輸出。
標(biāo)簽： VITERBI Verilog FPGA 代碼
上傳時(shí)間： 2016-08-08
上傳用戶：June
(n, k, N)卷積碼的狀態(tài)數(shù)為2k (N?1) ，對(duì)每一時(shí)刻要 做2k (N?1) 次“加－比－存”操作，每一操作包括2k 次加法和2k ?1 次比較，同時(shí)要保留2k (N?1) 條幸存路徑。由此可見，VITERBI 算法的復(fù)雜度與信道質(zhì)量無關(guān)，其計(jì)算量和存儲(chǔ)量都隨約束 長(zhǎng)度N 和信息元分組k 呈指數(shù)增長(zhǎng)。因此，在約束長(zhǎng)度和信息元分組較大時(shí)并不適用。 為了充分利用信道信息，提高卷積碼譯碼的可靠性，可以采用軟判決VITERBI 譯碼算法。 此時(shí)解調(diào)器不進(jìn)行判決而是直接輸出模擬量，或是將解調(diào)器輸出波形進(jìn)行多電平量化，而不 是簡(jiǎn)單的 0、1 兩電平量化，然后送往譯碼器。即編碼信道的輸出是沒有經(jīng)過判決的“軟信 息”。
上傳時(shí)間： 2016-08-08
上傳用戶：June
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