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Ver-fir-coefficient

  • vhdl source,Ver-fir-coefficient,simulink of fir with soft ware input

    vhdl source,Ver-fir-coefficient,simulink of fir with soft ware input

    標簽: Ver-fir-coefficient simulink source input

    上傳時間: 2013-12-23

    上傳用戶:jackgao

  • FIR Filter Coefficient Design Examples For the AFEDRI8201 in Digital Radio

    FIR Filter Coefficient Design Examples For the AFEDRI8201 in Digital Radio

    標簽: Coefficient Examples Digital AFEDRI

    上傳時間: 2013-12-19

    上傳用戶:franktu

  • FIR數(shù)字濾波器的DSP實現(xiàn).rar

    針對電力質(zhì)量分析儀中的信號數(shù)字濾波處理部分,基于TMS320VC5402芯片的數(shù)字信號處理功能,采用窗函數(shù)法,借助MATLAB程序設(shè)計語言,設(shè)計了FIR數(shù)字濾波器,應(yīng)用DSP匯編語言編程實現(xiàn)了該濾波器。實踐證明,該濾波器準確度高、穩(wěn)定性好,易于移植使用,具有較強的實用性與靈活性

    標簽: FIR DSP 數(shù)字濾波器

    上傳時間: 2013-08-05

    上傳用戶:jiahao131

  • FIR數(shù)字濾波器的FPGA最佳實現(xiàn)方法研究.rar

    在圖像處理、數(shù)據(jù)傳輸、雷達接收等現(xiàn)代信號處理領(lǐng)域,對信號處理的穩(wěn)定性、實時性和靈活性都有很高的要求。FIR數(shù)字濾波器因其線性相位特性滿足了現(xiàn)代信號處理領(lǐng)域?qū)V波器的高性能要求,成為應(yīng)用最廣泛的數(shù)字濾波器之一。高密度的FPGA兼顧實時性和靈活性,為FIR數(shù)字濾波器的實現(xiàn)提供了強大的硬件支持。 現(xiàn)今FIR數(shù)字濾波器的FPGA實現(xiàn)方法中最常用的是基于DA的實現(xiàn)方法和基于CSD編碼的實現(xiàn)方法,本文對這兩種實現(xiàn)方法進行了深入的探討,并進行了一定的改進。本論文所做的主要工作和創(chuàng)新如下: 1、對FIR數(shù)字濾波器的硬件實現(xiàn)方法進行了理論研究,其中著重對并行FIR數(shù)字濾波器的實現(xiàn)方法進行了深入探討并提出了一個改進的實現(xiàn)方法:基于CSD-DA的改進實現(xiàn)方法。這個實現(xiàn)方法在一定情況下比單純的基于CSD編碼的實現(xiàn)方法和基于DA的實現(xiàn)方法都要節(jié)約芯片面積。 2、經(jīng)過電路建模和數(shù)學推導提出了“CSD-DA擇優(yōu)比較法”。該比較法可以從基于CSD編碼的實現(xiàn)方法、基于DA的實現(xiàn)方法以及基于CSD-DA的改進實現(xiàn)方法中較精確的選擇出最佳實現(xiàn)方法。 3、用Cyclone EPEC6Q240C8芯片和音頻編解碼芯片TLV320AIC23B實現(xiàn)了一個可以濾除音頻信號中高頻噪聲的音頻FIR數(shù)字低通濾波器。

    標簽: FPGA FIR 數(shù)字濾波器

    上傳時間: 2013-06-07

    上傳用戶:zhangyi99104144

  • 基于FPGA的可調(diào)參數(shù)FIR濾波系統(tǒng).rar

    現(xiàn)代電子系統(tǒng)中,F(xiàn)IR數(shù)字濾波器作為數(shù)字信號處理技術(shù)的重要組成部分,以其良好的線性特性在許多領(lǐng)域內(nèi)被廣泛的應(yīng)用。在工程實踐中,往往要求信號處理具有實時性和靈活性,而已有的一些軟件和硬件實現(xiàn)方式則難以同時達到這兩方面的要求。 隨著可編程邏輯器件和EDA技術(shù)的發(fā)展,越來越多的人開始應(yīng)用FPGA實現(xiàn)FIR濾波器,既保證了信號處理的實時性,又可兼顧靈活性的要求。但是普遍存在的問題是不能根據(jù)被濾波信號特點動態(tài)調(diào)整濾波器的濾波系數(shù),只能完成單一特性的濾波工作。 本文將FPGA的快速性和計算機的靈活性通過USB2.0總線有機地結(jié)合起來,設(shè)計了一個基于FPGA的可調(diào)參數(shù)FIR濾波系統(tǒng)。此系統(tǒng)由計算機根據(jù)各種濾波器指標計算出濾波參數(shù),通過USB2.0對FPGA芯片內(nèi)部的FIR多階濾波器進行參數(shù)配置,實現(xiàn)數(shù)字濾波器參數(shù)可調(diào);配置后的FPGA濾波單元完成對A/D采集的信號進行濾波運算,濾波后的數(shù)據(jù)經(jīng)過緩存后通過USB2.0總線傳輸至計算機進行顯示、分析和儲存等進一步處理。在系統(tǒng)中采用有限狀態(tài)機對FPGA參數(shù)配置模式和濾波模式進行切換,保證了系統(tǒng)的有序運行。 本文通過性能測試和應(yīng)用實例對系統(tǒng)進行驗證。實驗證明:該基于FPGA的可調(diào)參數(shù)FIR濾波系統(tǒng)參數(shù)配置方便,可以根據(jù)實際需要動態(tài)調(diào)整濾波參數(shù),并且濾波效果良好,可有效濾除噪聲信號。

    標簽: FPGA FIR 參數(shù)

    上傳時間: 2013-07-26

    上傳用戶:KSLYZ

  • 基于FPGA的高速FIR數(shù)字濾波器設(shè)計.rar

    本論文設(shè)計了一種基于FPGA的高速FIR數(shù)字濾波器,濾波器實現(xiàn)低通濾波,截止頻率為1MHz,通帶波紋小于1 dB,阻帶最大衰減為-40 dB,輸入輸出數(shù)據(jù)為8位二進制,采樣頻率為10MHz。 論文首先簡要介紹了數(shù)字濾波器的基本原理和線性FIR數(shù)字濾波器的性質(zhì)、結(jié)構(gòu),根據(jù)濾波器的性能要求選擇窗函數(shù)、確定系數(shù),在算法上為了滿足數(shù)字濾波器的要求,對系數(shù)放大512倍并取整,并用Matlab對數(shù)字濾波器原理進行了證明。同時簡述了EDA技術(shù)和FPGA設(shè)計流程。 其次,論文說明了FIR數(shù)字濾波器模塊的劃分,并用Verilog語言在Modelsim環(huán)境下進行了功能測試。對于數(shù)字濾波器系數(shù)中的-1,-2,4這些簡單的系數(shù)乘法直接進行移位和取反,可以極大的節(jié)省資源和優(yōu)化設(shè)計。而對普通系數(shù)乘法采用4-BANT(4bits-at-a-time)的并行算法,用加法累加快速實現(xiàn)了乘積的運算;另外,在本設(shè)計進行部分積累加時,采用舍取冗余位,主要是根據(jù)設(shè)計時已對系數(shù)進行了放大,而輸出時又要將結(jié)果相應(yīng)的縮小,所以在累加時,提前對部分積縮小,從而減少了運算量,從時間和資源上都得到了優(yōu)化。 論文的最后分別用Modelsim和Quartus II進行了FIR數(shù)字濾波器的前仿真和后仿真,將仿真的結(jié)果和Matlab中原理驗證時得到的理想值進行了比較,并對所產(chǎn)生的誤差進行了分析。仿真結(jié)果表明:本16階FIR數(shù)字濾波器設(shè)計能夠?qū)崿F(xiàn)截止頻率為1MHz的低通濾波,并且工作頻率可達150MHz以上。

    標簽: FPGA FIR 數(shù)字

    上傳時間: 2013-05-24

    上傳用戶:qiaoyue

  • 軟件無線電中FIR濾波器的Matlab設(shè)計及FPGA實現(xiàn).rar

    軟件無線電作為一種新的無線通信概念和體制,近年來隨著3G標準的提出,日益受到國內(nèi)外相關(guān)通信廠商的重視。尤其是基于軟件無線電和智能天線技術(shù)的TD-SCDMA作為通信史上第一個“中國標準”,有望扭轉(zhuǎn)多年來我國移動通信制造業(yè)的被動局面,是實現(xiàn)信息產(chǎn)業(yè)騰飛的一個絕好機會。軟件無線電使得通信體制具有很好的通用性、靈活性和可配置性,并使系統(tǒng)互聯(lián)和升級變得容易。本文以軟件無線電中的FIR濾波器為線索,貫穿了信號重構(gòu)、多抽樣率信號處理、積分梳狀濾波器等理論分析,重點闡釋了FIR濾波器的設(shè)計方法及濾波器的FPGA實現(xiàn)等技術(shù)問題。 本文首先針對軟件無線電中的多抽樣率信號處理理論進行了討論和分析。討論了軟件無線電中如何實現(xiàn)整數(shù)倍抽取、整數(shù)倍內(nèi)插、分數(shù)倍抽樣率變換,并分析了網(wǎng)絡(luò)結(jié)構(gòu)的等效變換、多相濾波及積分梳狀濾波器的設(shè)計理論。 緊接著重點闡述了軟件無線電中FIR濾波器的設(shè)計理論,包括窗函數(shù)法、頻率抽樣法及等紋波法。分析了各種設(shè)計方法所能達到的性能指標及優(yōu)缺點,并結(jié)合工程實例給出了相關(guān)的Matlab程序。并對FIR濾波器結(jié)構(gòu)的選擇及系數(shù)字長的確定等問題進行了分析。此外,也介紹了在Matlab進行輔助設(shè)計時一些常用函數(shù)和命令的用法。 本文選用FPGA來實現(xiàn)中頻軟件無線電,F(xiàn)PGA與參數(shù)化ASIC、DSP比較有很多優(yōu)勢,它不但在功耗、體積、成本方面優(yōu)于參數(shù)化ASIC、DSP,而且處理效率高、現(xiàn)場可編程性能良好。不同于DSP的單流處理方式,F(xiàn)PGA是多流并行處理,這種處理方式使FPGA能完成DSP難以實現(xiàn)的許多功能。在簡單介紹了FPGA的一般原理,以及FPGA設(shè)計中的關(guān)鍵技術(shù)和在信號處理中的設(shè)計原則以后,重點介紹了FIR濾波器的FPGA實現(xiàn)方法。提出了分布式算法、加法器網(wǎng)絡(luò)法以及分段FIFO等實現(xiàn)方法。最后,提出了一種QuartusII與MATLAB聯(lián)合仿真的方法。此方法能夠直觀的檢驗濾波器的濾波效果,提高設(shè)計效率。并結(jié)合工程實例詳盡的介紹了FIR濾波器的設(shè)計開發(fā)流程。

    標簽: Matlab FPGA FIR

    上傳時間: 2013-04-24

    上傳用戶:gengxiaochao

  • 應(yīng)用VHDL基于FPGA設(shè)計FIR濾波器

    伴隨高速DSP技術(shù)的廣泛應(yīng)用,實時快速可靠地進行數(shù)字信號處理成為用戶追求的目標。同時,由于可編程器件在速度和集成度方面的飛速提高,使得利用硬件實現(xiàn)數(shù)字信號實時快速可靠處理有了新的途徑。 FIR濾波器是數(shù)字信號處理中常用部件,它的最大優(yōu)點在于:設(shè)計任何幅頻特性時,可以具有嚴格的線性相位,這一點對數(shù)字信號的實時處理非常關(guān)鍵。 FPGA是常用的可編程器件,它所具有的查找表結(jié)構(gòu)非常適用于實現(xiàn)實時快速可靠的FIR濾波器,在加上VHDL語言靈活的描述方法以及與硬件無關(guān)的特點,使得使用VHDL語言基于FPGA芯片實現(xiàn)FIR濾波器成為研究的方向。 本文對基于FPGA的FIR數(shù)字濾波器實現(xiàn)進行了研究,并設(shè)計了一個16階的FIR低通濾波器。所做的主要工作為: 1.以FIR數(shù)字濾波器的基本理論為依據(jù),使用分布式算法作為濾波器的硬件實現(xiàn)算法,并對其進行了詳細的討論。針對分布式算法中查找表規(guī)模過大的缺點,采用多塊查找表的方式減小硬件規(guī)模。 2.在設(shè)計中采用了自頂向下的層次化、模塊化的設(shè)計思想,將整個濾波器劃分為多個模塊,利用VHDL語言的描述方法進行了各個功能模塊的設(shè)計,最終完成了FIR數(shù)字濾波器的系統(tǒng)設(shè)計。 3.采用FLEX10K系列器件實現(xiàn)一個16階的FIR低通濾波器的設(shè)計實例,用MAX+PLUSII軟件進行了仿真,并用MATLAB對仿真結(jié)果進行了分析,證明所設(shè)計的FIR數(shù)字濾波器功能正確。 仿真結(jié)果表明,本論文所設(shè)計的FIR濾波器硬件規(guī)模較小,采樣率達到了17.73MHz。同時只要將查找表進行相應(yīng)的改動,就能分別實現(xiàn)低通、高通、帶通FIR濾波器,體現(xiàn)了設(shè)計的靈活性。

    標簽: VHDL FPGA FIR 濾波器

    上傳時間: 2013-04-24

    上傳用戶:zdluffy

  • 基于FPGA的高速高階FIR濾波器設(shè)計

      隨著雷達、圖像、通信等領(lǐng)域?qū)π盘柛咚偬幚淼囊螅芯咳藛T正尋求高速的數(shù)字信號處理算法,以滿足這種高速地處理數(shù)據(jù)的需要。常用的高速實時數(shù)字信號處理的器件有ASIC、可編程的數(shù)字信號處理芯片、FPGA,等等。  本文研究了時域FPGA上實現(xiàn)高速高階FIR數(shù)字濾波器結(jié)構(gòu),并實現(xiàn)了高壓縮比的LFM脈沖信號的匹配濾波。文章根據(jù)FIR數(shù)字濾波器理論,分析比較實現(xiàn)了FIR濾波器的方法;使用并行分布式算法,在Xilinx的VirtexⅡFPGA系列芯片上設(shè)計了高速高階FIR濾波器。并詳細進行了分析;設(shè)計出了一個256階的線性調(diào)頻脈沖壓縮信號的匹配濾波器設(shè)計實例,并用ModelSim軟件進行了仿真。

    標簽: FPGA FIR 濾波器設(shè)計

    上傳時間: 2013-07-18

    上傳用戶:yt1993410

  • 基于DSP的FIR濾波器的設(shè)計和實現(xiàn)

    本文深入研究基于美國德州儀器公司(TI)TMS320C5410DSP芯片的濾波器系統(tǒng)軟件實現(xiàn)方法,用窗冂設(shè)計法實現(xiàn)FIR濾波器,給出了MATLAB仿真結(jié)果,并在以TI TMS320C5410為微處理器的DSK上實現(xiàn),實驗結(jié)果表明濾波結(jié)果效果良好,達到了預(yù)期的性能指標,用時間抽取法實現(xiàn)的FFT/IFFT算法,介紹了自適應(yīng)濾波器的基本原理及應(yīng)用,并對LMS算法進行了深入的研究。

    標簽: DSP FIR 濾波器

    上傳時間: 2013-06-29

    上傳用戶:anng

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