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VeriLog-HDL

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標(biāo)簽： verilog HDL 顯示模塊

上傳時(shí)間： 2014-09-04

上傳用戶：myworkpost
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標(biāo)簽： frectrlverilog hdl verilog frectrl

上傳時(shí)間： 2014-01-13

上傳用戶：heart520beat
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標(biāo)簽： verilog count hdl 24

上傳時(shí)間： 2017-06-24

上傳用戶：wpwpwlxwlx
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標(biāo)簽： verilog count hdl 24

上傳時(shí)間： 2014-01-06

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北航Verilog教程. Verilog HDL基本結(jié)構(gòu) 數(shù)據(jù)類型及常量、變量運(yùn)算符及表達(dá)式語(yǔ)句賦值語(yǔ)句和塊語(yǔ)句條件語(yǔ)句 ...

北航Verilog教程. Verilog HDL基本結(jié)構(gòu) 數(shù)據(jù)類型及常量、變量運(yùn)算符及表達(dá)式語(yǔ)句賦值語(yǔ)句和塊語(yǔ)句條件語(yǔ)句 ...

標(biāo)簽： Verilog HDL 教程基本結(jié)構(gòu)

上傳時(shí)間： 2017-07-02

上傳用戶：曹云鵬
用verilog HDL編寫的基于fpga的動(dòng)態(tài)數(shù)碼管顯示程序。

用verilog HDL編寫的基于fpga的動(dòng)態(tài)數(shù)碼管顯示程序。

標(biāo)簽： verilog fpga HDL 編寫

上傳時(shí)間： 2017-07-09

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用Verilog HDL編寫的秒表設(shè)計(jì)

用Verilog HDL編寫的秒表設(shè)計(jì)，可以實(shí)現(xiàn)百分之一秒，十分之一秒，秒，十秒等功能。

標(biāo)簽： Verilog HDL 編寫秒表設(shè)計(jì)

上傳時(shí)間： 2017-07-09

上傳用戶：離殤
用verilog HDL 寫的時(shí)鐘程序

用verilog HDL 寫的時(shí)鐘程序，在DE2上實(shí)現(xiàn)了。

標(biāo)簽： verilog HDL 時(shí)鐘程序

上傳時(shí)間： 2017-07-11

上傳用戶：tyler
包中包括, DW8051完整的Verilog HDL代碼兩本手冊(cè): DesignWare Library DW8051 MacroCell, Datasheet DesignWare DW8

包中包括, DW8051完整的Verilog HDL代碼兩本手冊(cè): DesignWare Library DW8051 MacroCell, Datasheet DesignWare DW8051 MacroCell Databook 三篇51論文: 基于IP 核的PSTN 短消息終端SoC 軟硬件協(xié)同設(shè)計(jì) Embedded TCP/ IP Chip Based on DW8051 Core 以8051為核的SOC中的萬(wàn)年歷的設(shè)計(jì)

標(biāo)簽： DesignWare 8051 Datasheet MacroCell

上傳時(shí)間： 2013-12-21

上傳用戶：yyq123456789
海爾布倫訪問(wèn)狀態(tài)機(jī) 設(shè)計(jì) 用FSM方式 verilog HDL 語(yǔ)言描述

海爾布倫訪問(wèn)狀態(tài)機(jī) 設(shè)計(jì) 用FSM方式 verilog HDL 語(yǔ)言描述

標(biāo)簽： verilog FSM HDL 海爾

上傳時(shí)間： 2017-07-13

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