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Verilog基本電路設(shè)計(jì)指導(dǎo)書

  • 這次把真正的把源程序公開了

    這次把真正的把源程序公開了,而且還有詳細的原理教程,希望大家?guī)兔Π阉龅母茫С值钠骷唷? 這個下載線電路是我做過的中最穩(wěn)定的,成功率很高。你也可以直接使用現有的下載線或者Atmel的原版下 載線。Easy 51Pro串行編程器也支持AT89C2051了。《Easy 51Pro的製作及使用說明》中有詳細介紹。 有何問題或者發(fā)現了BUG請在這裡給我留言: http://enkj.com/gbook/guestbook.asp?user=digiboy

    標簽: 源程序

    上傳時間: 2013-12-12

    上傳用戶:xieguodong1234

  • 在 Java EE 的藍圖中

    在 Java EE 的藍圖中,JSP Servlet是屬於Web層技術,JSP與Servlet是一體的兩面,您可以使用單獨一項技術來解決動態(tài)網頁呈現的需求,但最好的方式是取兩者的長處,JSP是網頁設計人員導向的,而Servlet是程式設計人員導向的,釐清它們之間的職責可以讓兩個不同專長的團隊彼此合作,並降低相互間的牽制作用。

    標簽: Java EE

    上傳時間: 2016-11-15

    上傳用戶:sxdtlqqjl

  • 在通訊系統中常見到的cordic

    在通訊系統中常見到的cordic,是個用很少複雜度就能實現三角函數的電路,檔案中有C語言的CORDIC程式

    標簽: cordic 系統

    上傳時間: 2017-03-07

    上傳用戶:lepoke

  • 運算放大器

    理想的放大器 目前,廠商在線性IC研發(fā)上都有重大的突破。使IC型運算放大器的特性和理想相當接近。尤其在低頻操作下,OP Amp電路的工作情形實在太像一個理想放大器,幾乎與理論的推測完全相符。→理想的放大器該具備什麼特性?

    標簽: 算放大器原理

    上傳時間: 2016-07-16

    上傳用戶:WALTER

  • 6502電器集中

    針對教學典型站場,以選X→ⅢG經由5/7道岔反位的接車為基本進路為例,根據選岔電路原理和道岔點及信號點的選出順序規(guī)律,要求完成以下工作: (1)完成進路選擇組時序邏輯設計; (2)完成進路執(zhí)行組時序邏輯設計; (3)完成進路解鎖時序邏輯設計;

    標簽: 6502 電器

    上傳時間: 2017-04-17

    上傳用戶:weilianjin

  • ESD_Technology

    在互補式金氧半(CMOS)積體電路中,隨著量產製程 的演進,元件的尺寸已縮減到深次微米(deep-submicron)階 段,以增進積體電路(IC)的性能及運算速度,以及降低每 顆晶片的製造成本。但隨著元件尺寸的縮減,卻出現一些 可靠度的問題。

    標簽: ESD_Technology

    上傳時間: 2020-06-05

    上傳用戶:shancjb

  • 電子電路零件應用手冊

    電子電路零件應用手冊

    標簽: 電子電路

    上傳時間: 2021-12-14

    上傳用戶:slq1234567890

  • VIP專區(qū)-華為FPGA設計全套資料合集19份

    資源包含以下內容:1.一種將異步時鐘域轉換成同步時鐘域的方法.pdf2.華為 FPGA設計高級技巧Xilinx篇.pdf3.華為 Verilog基本電路設計指導書.pdf4.華為 大規(guī)模邏輯設計指導書.pdf5.華為FPGA設計流程指南.doc6.華為FPGA設計規(guī)范.doc7.華為_大規(guī)模邏輯設計指導書.pdf8.華為同步電路設計規(guī)范(密碼:openfree).pdf9.華為面經.doc10.時鐘透傳技術白皮書.pdf11.硬件工程師手冊_全.pdf12.靜態(tài)時序分析與邏輯...pdf13.華為FPGA設計全套資料合集19份

    標簽: 光電 檢測原理

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 信號的模數轉換電路

    [學習要求]掌握A/D轉換的基本概念和工作原理,掌握集成A/D轉換器ADC0809的基本應用、設計方法與調試技術。[重點與難點]重點:集成A/D轉換器的應用及主要性能指標。

    標簽: 信號 模數轉換電路

    上傳時間: 2013-07-12

    上傳用戶:ninal

  • 采用高速串行收發(fā)器Rocket I/O實現數據率為2.5 G

    摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業(yè)界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協議數據幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實現數據率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協議 為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協議———Aurora 協議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數據傳輸。Aurora 協議是為專有上層協議或行業(yè)標準的上層協議提供透明接口的第一款串行互連協議, 可用于高速線性通路之間的點到點串行數據傳輸, 同時其可擴展的帶寬, 為系統設計人員提供了所需要的靈活性[4]。但該協議幀格式的定義存在弊端,會導致系統資源的浪費。本文提出的設計方案可以改進Aurora 協議的固有缺陷,提高系統性能, 實現數據率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

    標簽: Rocket 2.5 高速串行 收發(fā)器

    上傳時間: 2013-11-06

    上傳用戶:smallfish

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