verilog hdl 綜合實(shí)用教程，一本非常實(shí)用易學(xué)易懂的書
標(biāo)簽： verilog hdl 實(shí)用教程
上傳時(shí)間： 2013-12-15
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王金明：《Verilog HDL 程序設(shè)計(jì)教程》程序
標(biāo)簽： Verilog HDL 程序設(shè)計(jì) 教程
上傳時(shí)間： 2013-12-09
上傳用戶：wxhwjf
中文名稱為：硬件描述語言 Verilog（第四版）。講解verilog HDL的經(jīng)典圖書。Thomas和Moorby編著，內(nèi)容涵蓋了:行為建模、并發(fā)進(jìn)程、邏輯級(jí)建模、高級(jí)時(shí)序、邏輯綜合、行為綜合等方面的內(nèi)容。通讀此書后，不需要再讀其他的verilog書籍。
標(biāo)簽： Verilog verilog Thomas Moorby
上傳時(shí)間： 2014-01-07
上傳用戶：pompey
FPGA與PC串口通信的Verilog HDL 程序
標(biāo)簽： Verilog FPGA HDL PC串口
上傳時(shí)間： 2016-11-16
上傳用戶：whenfly
有實(shí)驗(yàn)結(jié)果,用MOSIN6編寫的,是Verilog HDL語言實(shí)現(xiàn)的. 練習(xí)三 利用條件語句實(shí)現(xiàn)計(jì)數(shù)分頻時(shí)序電路 實(shí)驗(yàn)?zāi)康模? 1. 掌握條件語句在簡(jiǎn)單時(shí)序模塊設(shè)計(jì)中的使用； 2. 學(xué)習(xí)在Verilog模塊中應(yīng)用計(jì)數(shù)器； 3. 學(xué)習(xí)測(cè)試模塊的編寫、綜合和不同層次的仿真。 練習(xí)四 阻塞賦值與非阻塞賦值的區(qū)別 實(shí)驗(yàn)?zāi)康模? 1． 通過實(shí)驗(yàn)，掌握阻塞賦值與非阻塞賦值的概念和區(qū)別； 2． 了解阻塞賦值與非阻塞賦值的不同使用場(chǎng)合； 3． 學(xué)習(xí)測(cè)試模塊的編寫、綜合和不同層次的仿真。
標(biāo)簽： Verilog MOSIN6 HDL Ver
上傳時(shí)間： 2016-11-19
上傳用戶：mhp0114
用Verilog HDL編寫的VGA顯示驅(qū)動(dòng)程序
標(biāo)簽： Verilog HDL VGA 編寫
上傳用戶：banyou
精通verilog HDL語言編程源碼之1--常用加法器設(shè)計(jì)
標(biāo)簽： verilog HDL 語言編程 源碼
上傳時(shí)間： 2014-12-03
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精通verilog HDL語言編程源碼之2--常用乘法器設(shè)計(jì)
上傳時(shí)間： 2014-11-28
上傳用戶：趙云興
精通verilog HDL語言編程源碼之3--伽羅華域乘法器設(shè)計(jì)
上傳時(shí)間： 2013-12-18
上傳用戶：youke111
精通verilog HDL語言編程源碼之4--常用除法器設(shè)計(jì)
上傳時(shí)間： 2013-12-24
上傳用戶：hanli8870
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