《三江學院師資管理系統》 核心模塊功能簡介 《三江學院師資管理系統》是基于B/S架構的Web應用程序，校園網上任何合法用戶可以直接訪問。一期工程實現了該系統的核心功能模塊，包括安全認證、教師信息維護、學科信息維護、部分報表打印等功能，該系統已投入試運行。目前該系統安裝在計算機系應用軟件開發組服務器上，內網IP地址為192.168.xxx.xxx。需要訪問師資系統的用戶請在瀏覽器地址欄輸入
上傳時間： 2014-01-09
上傳用戶：獨孤求源
基于B樣條小波邊緣檢測算子的應用研究，摘自圖形圖像學報
上傳時間： 2014-11-28
上傳用戶：來茴
Verilog HDL硬件描述語言 01簡介.PDF 02HDL指南.PDF 03語言要素.PDF 04表達式.PDF 05門電平模型化.PDF 06用戶定義原語.PDF 07數據流模型化.PDF 08行為建模.PDF 09結構建模.PDF 10其它論題.PDF 11驗證.PDF 12建模實例.PDF 13語法參考.PDF
上傳時間： 2013-12-28
上傳用戶：Andy123456
四種加密解密算法的源代碼/*輾轉相除法求a,b的最大公因數*/
上傳時間： 2015-09-11
上傳用戶：GavinNeko
Ma tla b 是當今使用最為廣泛的數學軟件，它具有相當強大的數值計算、數據處理、系統 分析、圖形顯示、甚至符號運算功能，是一個完整的數學平臺，但是它不能實現端口操作和 實時控制Borland C + +Builder是一種新穎的可視化編程語言，可方便實現交互界面、數據 采集和端口操作等，但是它在數值處理分析和算法工具等方面，效率遠遠低于Matlab語言
上傳時間： 2014-01-24
上傳用戶：牛津鞋
王金明的Verilog HDL程序集合，包含各個常用的程序
上傳時間： 2013-11-26
上傳用戶：星仔
Bing is a point-to-point bandwidth measurement tool (hence the b ), based on ping. Bing determines the real (raw, as opposed to available or average) throughput on a link by measuring ICMP echo requests roundtrip times for different packet sizes for each end of the link
標簽： Bing point-to-point measurement determines
上傳時間： 2015-09-15
上傳用戶：lgnf
基于Verilog-HDL的硬件電路的實現 9.1 簡單的可編程單脈沖發生器 9.1.1 由系統功能描述時序關系 9.1.2 流程圖的設計 9.1.3 系統功能描述 9.1.4 邏輯框圖 9.1.5 延時模塊的詳細描述及仿真 9.1.6 功能模塊Verilog-HDL描述的模塊化方法 9.1.7 輸入檢測模塊的詳細描述及仿真 9.1.8 計數模塊的詳細描述 9.1.9 可編程單脈沖發生器的系統仿真 9.1.10 可編程單脈沖發生器的硬件實現 9.1.11 關于電路設計中常用的幾個有關名詞
標簽： Verilog-HDL 9.1 功能描述
上傳時間： 2015-09-16
上傳用戶：chfanjiang
基于Verilog-HDL的硬件電路的實現 9.2 具有LCD顯示單元的可編程單脈沖發生器 9.2.1 LCD顯示單元的工作原理 9.2.2 顯示邏輯設計的思路與流程 9.2.3 LCD顯示單元的硬件實現 9.2.4 可編程單脈沖數據的BCD碼化 9.2.5 task的使用方法 9.2.6 for循環語句的使用方法 9.2.7 二進制數轉換BCD碼的硬件實現 9.2.8 可編程單脈沖發生器與顯示單元的接口 9.2.9 具有LCD顯示單元的可編程單脈沖發生器的硬件實現 9.2.10 編譯指令-"文件包含"處理的使用方法
標簽： Verilog-HDL LCD 9.2 顯示單元
上傳時間： 2014-06-23
上傳用戶：xc216
基于Verilog-HDL的硬件電路的實現 9.3 脈沖計數與顯示 9.3.1 脈沖計數器的工作原理 9.3.2 計數模塊的設計與實現 9.3.3 parameter的使用方法 9.3.4 repeat循環語句的使用方法 9.3.5 系統函數$random的使用方法 9.3.6 脈沖計數器的Verilog-HDL描述 9.3.7 特定脈沖序列的發生 9.3.8 脈沖計數器的硬件實現
標簽： Verilog-HDL parameter 9.3 硬件電路
上傳時間： 2013-12-14
上傳用戶：jeffery
