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Verilog-<b>hdl</b>

verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，7-8章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-09

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verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，9-10章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-26

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verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，11-12章

標簽： verilog hdl 135 C語言

上傳時間： 2015-03-24

上傳用戶：zhaoq123
java ejb開發程序4、語句alter table people add(phone_number varchar2(10)) 的作用是 A 修改表結構 B 為people表添加約束

java ejb開發程序4、語句alter table people add(phone_number varchar2(10)) 的作用是 A 修改表結構 B 為people表添加約束，約束名稱是phone_number C 向people表中添加一列，名稱是phone_number，數據類型是varchar2，長度是10 D 上述答案均不正確 5、（）BLOB和CLOB的區別在于 A CLOB只能存放字符類型的數據，而BLOB沒有任何限制 B BLOB只能存放字符類型的數據，而CLOB沒有任何限制 C CLOB只能存放小于4000字節的數據，而BLOB可以存放大于4000字節的數據 D BLOB只能存放小于4000字節的數據，而CLOB可以存放大于4000字節的數據 6、存儲過程從本質上來講就是 A 匿名的PL/SQL程序塊，它可以被賦予參數 B 命名的PL/SQL程序塊，它可以被賦予參數 C 命名的PL/SQL程序塊，不能被賦予參數 D 匿名的PL/SQL程序塊，不能被賦予參數 7、（）下列關于日期數據類型，哪一個語句是正確的寫法 A insert into test values( 9999-12-03 ) B insert into test values( 1999-03-02 ) C insert into test values(to_char(1999-06-03, yyyy/dd/mm )) D insert into test

標簽： people phone_number varchar2 alter

上傳時間： 2013-12-26

上傳用戶：wendy15
計算矩陣連乘積問題描述在科學計算中經常要計算矩陣的乘積。矩陣A和B可乘的條件是矩陣A的列數等于矩陣B的行數。若A是一個p×q的矩陣

計算矩陣連乘積問題描述在科學計算中經常要計算矩陣的乘積。矩陣A和B可乘的條件是矩陣A的列數等于矩陣B的行數。若A是一個p×q的矩陣，B是一個q×r的矩陣，則其乘積C=AB是一個p×r的矩陣。

標簽： 矩陣計算

上傳時間： 2015-03-25

上傳用戶：yulg
一個學生管理系統,B/S架夠.非常好用,里面包括了原碼.可以學習修改

一個學生管理系統,B/S架夠.非常好用,里面包括了原碼.可以學習修改

標簽： 管理系統修改

上傳時間： 2014-01-03

上傳用戶：維子哥哥
是一款強勁的B2C的網上購物軟件,利用它我們能建立起強勁的、自由的、安全的購物平臺.系統由C#及SqlServer開發, 是B/S(瀏覽器/服務器)結構的asp.net程序. 此版本對常用功能進行了更

是一款強勁的B2C的網上購物軟件,利用它我們能建立起強勁的、自由的、安全的購物平臺.系統由C#及SqlServer開發, 是B/S(瀏覽器/服務器)結構的asp.net程序. 此版本對常用功能進行了更多整合: 投票功能評論功能快速注冊或不注冊即可購買查看此商品的用戶又查看了哪些商品的統計購買此商品的用戶又購買了哪些商品的統計單件商品的快速收藏可按商品編號搜索商品新增積分換贈品的優惠方式在有新定單、用戶留言及用戶對其訂單聲明"我己付款"時發郵件通知管理員增加8848在線支付接口增加網銀在線支付接口增加中文網服OIPS在線支付接口增加西部在線支付接口增加PayEX在線支付接口增加PayPal在線支付接口。

標簽： SqlServer B2C asp net

上傳時間： 2015-03-26

上傳用戶：exxxds
這是一個Verilog HDL編寫的RISC cpu的程序

這是一個Verilog HDL編寫的RISC cpu的程序，該程序共10個子程序，實現了簡單的RISC cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。

標簽： Verilog RISC HDL cpu

上傳時間： 2015-03-26

上傳用戶：qiao8960
減1計數器一、設計要求用Verilog HDL語言設計一個計數器。要求計數器具有異步置位/復位功能

減1計數器一、設計要求用Verilog HDL語言設計一個計數器。要求計數器具有異步置位/復位功能，可以進行自增和自減計數，其計數周期為2^N（N為二進制位數）。二、設計原理輸入/輸出說明： d：異步置數數據輸入； q：當前計數器數據輸出； clock：時鐘脈沖； count_en：計數器計數使能控制（1：計數/0：停止計數）； updown：計數器進行自加/自減運算控制（1：自加/0：自減）； load_d

標簽： Verilog 計數器 HDL 減

上傳時間： 2015-03-28

上傳用戶：zycidjl
數據結構和算法Flash動畫演示 B樹的刪除,B樹的生長過程,串的順序存儲,單鏈表結點的插入,單鏈表結點的刪除,堆排序,二叉排序樹的刪除等

數據結構和算法Flash動畫演示 B樹的刪除,B樹的生長過程,串的順序存儲,單鏈表結點的插入,單鏈表結點的刪除,堆排序,二叉排序樹的刪除等

標簽： Flash 刪除樹單鏈表

上傳時間： 2015-03-29

上傳用戶：kristycreasy