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Verilog

VerilogHDL是一種硬件描述語言，以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。VerilogHDL和VHDL是世界上最流行的兩種硬件描述語言，都是在20世紀80年代中期開發出來的。前者由GatewayDesignAutomation公司（該公司于1989年被Cadence公司收購）開發。兩種HDL均為IEEE標準。[1]

設計FIFO,使用Verilog的一篇文章

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標簽： Verilog FIFO

上傳時間： 2016-01-11

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iic slave Verilog hdl code

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標簽： Verilog slave code iic

上傳時間： 2016-01-12

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Verilog源碼

Verilog源碼，完成數據轉換，供學習使用！

標簽： Verilog 源碼

上傳時間： 2014-01-21

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Verilog代碼

Verilog代碼，基礎的寄存器配置模式，怎樣生成寄存器，以及如何在合適的時候用寄存器

標簽： Verilog 代碼

上傳時間： 2016-01-13

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div的Verilog開發程序

div的Verilog開發程序，做稍微修改就可以應用到具體的工程當中

標簽： Verilog div 程序

上傳時間： 2014-01-24

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Verilog Verilog_HDL_入門教程

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標簽： Verilog_HDL Verilog 入門教程

上傳時間： 2016-01-14

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用Verilog做的VGA 480X640彩色驅動

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標簽： Verilog 480X640 VGA 彩色

上傳時間： 2016-01-14

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用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序

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標簽： Verilog HDL GF C程序

上傳時間： 2016-01-15

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用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序

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標簽： Verilog HDL GF C程序

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用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序

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標簽： Verilog HDL GF C程序

上傳時間： 2014-01-13

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Verilog

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Verilog源碼

Verilog代碼

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用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序

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