verilog aDPLL file with testbench.v
標(biāo)簽： testbench verilog aDPLL file
上傳時(shí)間： 2015-07-09
上傳用戶：cx111111
verilog aDPLL file with testbench
上傳時(shí)間： 2013-12-01
上傳用戶：yulg
上傳時(shí)間： 2016-11-05
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aDPLL of high level phase locked loop
標(biāo)簽： locked aDPLL level phase
上傳時(shí)間： 2016-12-04
上傳用戶：wpwpwlxwlx
A high-speed variable phase accumulator for an aDPLL architecture
標(biāo)簽： architecture accumulator high-speed variable
上傳時(shí)間： 2013-11-26
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全數(shù)字鎖相環(huán)（aDPLL)的部分源程序代碼，是其中最重要的部分。
標(biāo)簽： aDPLL 全數(shù)字 代碼 鎖相環(huán)
上傳時(shí)間： 2017-09-03
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