-
JPEG2000是由ISO/ITU-T組織下的IEC JTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標準.與JPEG(Joint Photographic Experts Group)相比,JPEG2000能夠提供更好的數據壓縮比,并且提供了一些JPEG所不具有的功能[1].JPEG2000具有的多種特性使得它具有廣泛的應用前景.但是,JPEG2000是一個復雜編碼系統,目前為止的軟件實現方案的執行時間和所需的存儲量較大,若想將JPEG2000應用于實際中,有著較大的困難,而用硬件電路實現JPEG2000或者其中的某些模塊,必然能夠減少JPEG200的執行時間,因而具有重要的意義.本文首先簡單介紹了JPEG2000這一新的靜止圖像壓縮標準,然后對算術編碼的原理及實現算法進行了深入的研究,并重點探討了JPEG2000中算術編碼的硬件實現問題,給出了一種硬件最優化的算術編碼實現方案.最后使用硬件描述語言(Very High Speed Integrated Circuit Hardware Description Language,VHDL)在寄存器傳輸級(Register Transfer Level,RTL描述了該硬件最優化的算術編碼實現方案,并以Altera 20K200E FPGA為基礎,在active-HDL環境中進行了功能仿真,在Quartus Ⅱ集成開發環境下完成了綜合以及后仿真,綜合得到的最高工作時鐘頻率達45.81MHz.在相同的輸入條件下,輸出結果表明,本文設計的硬件算術編碼器與實現JPEG2000的軟件:Jasper[2]中的算術編碼模塊相比,處理時間縮短了30﹪左右.因而本文的研究對于JPEG2000應用于數字監控系統等實際應用有著重要的意義.
標簽：
JPEG
2000
FPGA
算術編碼
上傳時間：
2013-05-16
上傳用戶：671145514
-
傅里葉變換是信號處理領域中較完善、應用較廣泛的一種分析手段.但傅里葉變換只是一種時域或頻域的分析方法,它要求信號具有統計平穩,即時不變的特性.但是實際應用中存在很多非平穩信號,它們并不能很好的用傅立葉變換來處理.小波變換的出現解決了這個問題,它在處理非平穩信號方面具有傅立葉變換無法比擬的優越性.小波變換在通信技術、信號處理、地球物理、水利電力、醫療等領域中獲得了日益廣泛的應用.小波變換的研究成為了當今學術界的一個熱點.隨著現代數字信號處理朝著高速實時的方向發展,純軟件的程序式信號處理方法越來越不能滿足實際應用的需求,因此人們希望用硬件電路來實現高速信號處理問題.基于以上原因,該文在研究了小波變換的基本理論和特點的基礎上,重點研究了小波變換的VLSI電路構架,并用FPGA實現了它的功能.毫無疑問,該文所做的具體工作在理論和實踐上都有參考價值.論文中,在簡單介紹了小波變換的基本理論、特點和應用;對信號小波變換分解,重構的MATLAB算法進行了分析,為硬件實現奠定了理論基礎.論文在研究了小波核心算法MALLAT算法的基礎上,以直觀的圖形方式描述了算法的流程圖;并由此提出了基于VLSI的電路模塊架構.根據上述模塊結構,對相關模塊進行了硬件描述語言(VERILOG-HDL)的建模,并且在仿真平臺上(active-HDL)進行了仿真.在仿真正確的前提下,該文選用了EP20K100BC356-1V芯片作為目標器件進行了綜合和后仿真,并且將仿真結果通過MATLAB與理論參數進行了比較,結果表明設計是正確的.對設計中存在的誤差和部分模塊的進一步優化,該文也作了分析和說明,為下一步實現通用IP核設計奠定了基礎.
標簽：
FPGA
小波變換
上傳時間：
2013-06-27
上傳用戶：zhaoq123
-
FPGA 技術是圖像處理領域的一個重要的研究課題，近年來倍受人們的關注。本文研究了視頻信號的采集、顯示以及通過網絡進行傳輸的方法。并提出了一套基于FPGA 的實現方案。 系統可以分為采集控制模塊、顯示控制模塊和網絡傳輸控制模塊3 部分。視頻信號的采集用到了視頻處理芯片SAA7113，通過FPGA 對其初始化，可以得到經過A/D 轉換的YUV 格式視頻信號，利用采集控制模塊可以將這些視頻信號保存到SRAM 中去。顯示控制模塊讀出SRAM 中的視頻信號，進行YUV 格式到RGB 格式的轉換以及幀頻變換等操作，再利用VGA 顯示芯片THS8134 就可以將采集到的視頻信號在LCD 上顯示出來。基于IEEE802.3 協議的網絡傳輸控制模塊將YUV 格式的視頻信號進行添加報頭、CRC 校驗碼等操作后，將其變成一個MAC 幀，可以在以太網絡中傳輸。 設計選用硬件描述語言Verilog HDL，在開發工具QuartusII 中完成軟核的綜合、布局布線、匯編，并最終在QuartusII 和active-HDL 中進行時序仿真驗證。 對設計的驗證采取的是由里及外的方式，先對系統主模塊的功能進行驗證，再模擬外部器件對設計的接口進行驗證。驗證流程是功能仿真、時序仿真、板級調試，最終通過了系統測試，驗證了該設計的功能。
標簽：
FPGA
視頻采集
傳輸
實現技術
上傳時間：
2013-07-21
上傳用戶：baobao9437
-
Abstract: Class D amplifiers are typically very efficient, making them ideal candidates for portable applications that require longbattery life and low thermal dissipation. However, electromagnetic interference (EMI) is an issue that commonly accompanies theClass D switching topology. active-emissions limiting reduces radiated emissions and enables "filterless" operation, allowingdesigners to create small, efficient portable applications with low EMI.
標簽：
EMI
D類放大器
保持
便攜式產品
上傳時間：
2013-11-23
上傳用戶：哈哈hah
-
Power conversion by virtue of its basic role produces harmonics due to theslicing of either voltages or currents. To a large extent the pollution in theutility supply and the deterioration of the power quality has been generatedor created by non-linear converters. It is therefore ironic that power convertersshould now be used to clean up the pollution that they helped to create inthe first place.In a utility system, it is desirable to prevent harmonic currents (which resultin EMI and resonance problems) and limit reactive power flows (whichresult in transmission losses).Traditionally, shunt passive filters, comprised of tuned LC elements andcapacitor banks, were used to filter the harmonics and to compensate forreactive current due to non-linear loads. However, in practical applicationsthese methods have many disadvantages.
標簽：
Filters
active
上傳時間：
2013-11-05
上傳用戶：AISINI005
-
模擬集成電路的設計與其說是一門技術，還不如說是一門藝術。它比數字集成電路設計需要更嚴格的分析和更豐富的直覺。嚴謹堅實的理論無疑是嚴格分析能力的基石，而設計者的實踐經驗無疑是誕生豐富直覺的源泉。這也正足初學者對學習模擬集成電路設計感到困惑并難以駕馭的根本原因。.美國加州大學洛杉機分校(UCLA)Razavi教授憑借著他在美國多所著名大學執教多年的豐富教學經驗和在世界知名頂級公司(AT&T，Bell Lab，HP)卓著的研究經歷為我們提供了這本優秀的教材。本書自2000午出版以來得到了國內外讀者的好評和青睞，被許多國際知名大學選為教科書。同時，由于原著者在世界知名頂級公司的豐富研究經歷，使本書也非常適合作為CMOS模擬集成電路設計或相關領域的研究人員和工程技術人員的參考書。... 本書介紹模擬CMOS集成電路的分析與設計。從直觀和嚴密的角度闡述了各種模擬電路的基本原理和概念，同時還闡述了在SOC中模擬電路設計遇到的新問題及電路技術的新發展。本書由淺入深，理論與實際結合，提供了大量現代工業中的設計實例。全書共18章。前10章介紹各種基本模塊和運放及其頻率響應和噪聲。第11章至第13章介紹帶隙基準、開關電容電路以及電路的非線性和失配的影響，第14、15章介紹振蕩器和鎖相環。第16章至18章介紹MOS器件的高階效應及其模型、CMOS制造工藝和混合信號電路的版圖與封裝。
1 Introduction to Analog Design 2 Basic MOS Device Physics 3 Single-Stage Amplifiers 4 Differential Amplifiers 5 Passive and active Current Mirrors 6 Frequency Response of Amplifiers 7 Noise 8 Feedback 9 Operational Amplifiers 10 Stability and Frequency Compensation 11 Bandgap References 12 Introduction to Switched-Capacitor Circuits 13 Nonlinearity and Mismatch 14 Oscillators 15 Phase-Locked Loops 16 Short-Channel Effects and Device Models 17 CMOS Processing Technology 18 Layout and Packaging
標簽：
analog
design
cmos
of
上傳時間：
2014-12-23
上傳用戶：杜瑩12345
-
有源功率因數校正可減少用電設備對電網的諧波污染，提高電器設備輸入端的功率因數。詳細分析了有源功率因數校正APFC（active power factor corrector）原理，采用平均電流控制模式控制原理，設計了基于UC3854BN芯片的一種有源功率因數校正電路方案，著重分析了電路主要參數的選擇和設計。實踐證明，采用APFC后，大大減小了輸入電流的諧波分量，實現了功率因數校正。
標簽：
開關電源
有源功率因數
校正電路
設計方案
上傳時間：
2013-10-21
上傳用戶：immanuel2006
-
active Power提供各種系統可見性和管理工具，使您能更好了解有關電源的各種事件并最終提高電源系統的可靠性。從將基本數據集成 active Power獨有的CleanSource View(CSView)監控軟件，到全托管式遠程監控服務 – 我們都可為您提供相應管理關鍵電源基礎架構所需的系統可見性和服務。
標簽：
關鍵電源
上傳時間：
2013-11-24
上傳用戶：685
-
The CAT823, CAT824, and CAT825 provide basic reset and monitoring functions for the electronic systems. Each device monitors the system voltage and maintains a reset output until that voltage reaches the device’s specified trip value and then maintains the reset output active condition until the device’s internal timer, after a minimum timer of 140ms; toallow the systems power supply to stabilize.
標簽：
CAT
823
824
825
上傳時間：
2014-11-18
上傳用戶：BOBOniu
-
The PCA9544A provides 4 interrupt inputs, one for each channeland one open drain interrupt output. When an interrupt is generated byany device, it will be detected by the PCA9544A and the interruptoutput will be driven LOW. The channel need not be active fordetection of the interrupt. A bit is also set in the control byte.Bits 4 – 7 of the control byte correspond to channels 0 – 3 of thePCA9544A, respectively. Therefore, if an interrupt is generated byany device connected to channel 2, the state of the interrupt inputs isloaded into the control register when a read is accomplished.Likewise, an interrupt on any device connected to channel 0 wouldcause bit 4 of the control register to be set on the read. The mastercan then address the PCA9544A and read the contents of thecontrol byte to determine which channel contains the devicegenerating the interrupt. The master can then reconfigure thePCA9544A to select this channel, and locate the device generatingthe interrupt and clear it. The interrupt clears when the deviceoriginating the interrupt clears.
標簽：
4channel
multiple
9544A
9544
上傳時間：
2014-12-28
上傳用戶：潛水的三貢
