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adc模塊

  • 常模算法的FPGA實(shí)現(xiàn)

    常模信號(hào)是一類非常重要的信號(hào),而專門應(yīng)用于常模信號(hào)的常模算法[1]具有復(fù)雜度較低、實(shí)現(xiàn)起來比較簡(jiǎn)單、對(duì)陣列模型的偏差不敏感等顯著的優(yōu)點(diǎn)。因此,常模算法引起了眾多學(xué)者的廣泛關(guān)注。近年來,常模算法在多用戶檢測(cè)領(lǐng)域[2]的研究越來越受到諸多學(xué)者的關(guān)注。不僅如此,常模算法在其他領(lǐng)域也是備受矚目,如常模算法在盲均衡以及波束形成等領(lǐng)域的應(yīng)用也是目前研究的熱點(diǎn)。除此之外,常模算法已經(jīng)不僅僅局限在應(yīng)用于常模信號(hào),也可應(yīng)用于多模信號(hào)[3]等。 本文對(duì)常模算法在多用戶檢測(cè)領(lǐng)域的應(yīng)用以及FPGA[4]實(shí)現(xiàn)作了較多的研究工作,共分六章進(jìn)行闡述。第一章為緒論,介紹了論文相關(guān)背景和本文的結(jié)構(gòu);第二章首先對(duì)常模算法作了理論分析,并改進(jìn)了傳統(tǒng)的2-2型常模算法,我們稱之為M2-2CMA,它在誤碼率性能上有一些改善;之后在MATLAB平臺(tái)上搭建了仿真平臺(tái),分析了常模算法在多用戶檢測(cè)中的應(yīng)用;第三章研究了相關(guān)文獻(xiàn),簡(jiǎn)單介紹了FPGA概念及其設(shè)計(jì)流程和設(shè)計(jì)方法,并對(duì)VerilogHDL以及Quartus軟件做了簡(jiǎn)要介紹;第四章則詳細(xì)介紹了常模算法的FPGA實(shí)現(xiàn),用一種基于統(tǒng)計(jì)數(shù)據(jù)的方法確定了數(shù)據(jù)位長(zhǎng)及精度,提出了其實(shí)現(xiàn)的系統(tǒng)框圖,并詳細(xì)闡述了各主要模塊的設(shè)計(jì)與實(shí)現(xiàn),同時(shí)給出了最后的報(bào)告文件以及最高數(shù)據(jù)處理速度;第五章則在MATLAB平臺(tái)和QuartuslI的基礎(chǔ)上搭建了一個(gè)仿真平臺(tái),借助于平臺(tái)分析了2-2型常模算法移植到FPGA平臺(tái)后的性能,對(duì)不同的精度對(duì)系統(tǒng)性能的影響做了討論,也統(tǒng)計(jì)了不同信噪比、多址干擾下的誤碼率性能。最后一章是對(duì)全文的總結(jié)和對(duì)未來的展望。

    標(biāo)簽: FPGA 算法

    上傳時(shí)間: 2013-06-23

    上傳用戶:hzy5825468

  • 高精度地震勘探數(shù)據(jù)采集系統(tǒng)

    本文分析了當(dāng)代高精度地震勘探數(shù)據(jù)采集系統(tǒng)的發(fā)展現(xiàn)狀,研究了數(shù)據(jù)采集的A/D方法及理論、現(xiàn)場(chǎng)可編程門陣列(Field Programmable GateArray,F(xiàn)PGA)技術(shù)的發(fā)展及原理,串口通信的原理及實(shí)現(xiàn)。在此基礎(chǔ)上,探討了采用FPGA控制24位△∑模數(shù)轉(zhuǎn)換器來實(shí)現(xiàn)高精度地震勘探數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)思路,對(duì)探測(cè)傳感器或檢波器后端數(shù)據(jù)采集系統(tǒng)的信號(hào)A/D轉(zhuǎn)換、FPGA與外部接口設(shè)計(jì)、串口數(shù)據(jù)通信做了詳細(xì)的研究,尤其是在用FPGA來完成與外部ADC的接口控制上做了深入的開發(fā)和設(shè)計(jì),整個(gè)接口控制模塊采用VHDL語(yǔ)言編寫,并同時(shí)將ROM、FIFO等數(shù)字邏輯模塊一起集成到一片F(xiàn)PGA芯片當(dāng)中,并在Quartus Ⅱ6.0的開發(fā)平臺(tái)上通過了軟件仿真,時(shí)序仿真結(jié)果達(dá)到了系統(tǒng)要求。

    標(biāo)簽: 高精度 地震勘探 數(shù)據(jù)采集系統(tǒng)

    上傳時(shí)間: 2013-05-21

    上傳用戶:yuele0123

  • 串行10位數(shù)模轉(zhuǎn)換器TLC5615及其在單片機(jī)中的應(yīng)用

    本文分析了 T EXAS 儀器公司新推出的串行10 位數(shù)/ 模轉(zhuǎn)換器(DAC) TL C5615 的功能、特點(diǎn)、工作原理及其與A T89C52 單片機(jī)的硬件接口和軟件編程, 提供了一個(gè)新穎實(shí)用的數(shù)/

    標(biāo)簽: 5615 TLC 串行 中的應(yīng)用

    上傳時(shí)間: 2013-05-20

    上傳用戶:redmoons

  • 共模干擾和差模干擾及其抑制技術(shù)

    共模干擾和差模干擾及其抑制技術(shù),是擴(kuò)干擾技術(shù)的基礎(chǔ)。

    標(biāo)簽: 共模干擾 差模 干擾 抑制技術(shù)

    上傳時(shí)間: 2013-04-24

    上傳用戶:003030

  • 模電基礎(chǔ)之波形發(fā)生電路

    模電基礎(chǔ)之波形發(fā)生電路 本教程網(wǎng)上收集的,供大家學(xué)習(xí)參考. 在學(xué)習(xí)過程中建議大家邊學(xué)邊用仿真軟件對(duì)電路進(jìn)行驗(yàn)證

    標(biāo)簽: 模電 波形發(fā)生 電路

    上傳時(shí)間: 2013-04-24

    上傳用戶:Jason1990

  • RSA密碼算法的模冪模乘的快速實(shí)現(xiàn)

    基于FPGA的RSA密碼算法的模冪模乘的快速實(shí)現(xiàn)

    標(biāo)簽: RSA 密碼算法 快速實(shí)現(xiàn)

    上傳時(shí)間: 2013-04-24

    上傳用戶:xuanjie

  • 基于FPGA的ADC并行測(cè)試方法研究

    高性能ADC產(chǎn)品的出現(xiàn),給混合信號(hào)測(cè)試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測(cè)試方案實(shí)現(xiàn)了多個(gè)ADC測(cè)試過程的并行化和實(shí)時(shí)化,減少了單個(gè)ADC的平均測(cè)試時(shí)間,從而降低ADC測(cè)試成本。本文實(shí)現(xiàn)了基于FPGA的ADC并行測(cè)試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上,總結(jié)了常用ADC參數(shù)測(cè)試方法和測(cè)試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評(píng)估算法和頻域參數(shù)評(píng)估算法,并對(duì)2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測(cè)試。    本研究通過在FPGA內(nèi)部實(shí)現(xiàn)ADC測(cè)試時(shí)域算法和頻域算法相結(jié)合的方法來搭建測(cè)試系統(tǒng),完成了音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測(cè)試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測(cè)試系統(tǒng)使用Angilent33220A任意信號(hào)發(fā)生器提供模擬激勵(lì)信號(hào),共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測(cè)試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道,并對(duì)其進(jìn)行串并轉(zhuǎn)換。然后對(duì)左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊,并行地實(shí)現(xiàn)了ADC參數(shù)的評(píng)估算法。在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下,對(duì)WM8731L片內(nèi)2個(gè)被測(cè).ADC并行地進(jìn)行參數(shù)評(píng)估,被測(cè)參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號(hào)與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明,通過在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊,可并行地實(shí)現(xiàn)對(duì)2個(gè)相同ADC的參數(shù)評(píng)估,減小單個(gè)ADC的平均測(cè)試時(shí)間。FPGA片內(nèi)實(shí)時(shí)評(píng)估算法的實(shí)現(xiàn)節(jié)省了測(cè)試樣本傳輸至自動(dòng)測(cè)試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制,就可實(shí)現(xiàn)多個(gè)被測(cè)ADC在同一時(shí)刻并行地被評(píng)估,配置靈活。基于FPGA的ADC并行測(cè)試方法易于實(shí)現(xiàn),具有可行性,但由于噪聲的影響,測(cè)試精度有待進(jìn)一步提高。該方法可用于自動(dòng)測(cè)試機(jī)的混合信號(hào)選項(xiàng)卡或測(cè)試子系統(tǒng)。

    標(biāo)簽: FPGA ADC 并行測(cè)試 方法研究

    上傳時(shí)間: 2013-06-07

    上傳用戶:gps6888

  • 中國(guó)模具設(shè)計(jì)大典 第4卷 鍛模與粉末冶金模設(shè)計(jì) 1262頁(yè) 40.6M.pdf

    資料->【F】機(jī)械結(jié)構(gòu)->【F1】機(jī)械叢書->中國(guó)模具設(shè)計(jì)大典 (共5卷)->中國(guó)模具設(shè)計(jì)大典 第4卷 鍛模與粉末冶金模設(shè)計(jì) 1262頁(yè) 40.6M.pdf

    標(biāo)簽: 1262 40.6

    上傳時(shí)間: 2013-06-22

    上傳用戶:yanming8525826

  • LM3S ADC例程多種采樣觸發(fā)方式

    LM3S系列ADC例程:多種采樣觸發(fā)方式

    標(biāo)簽: LM3S ADC 采樣 觸發(fā)

    上傳時(shí)間: 2013-05-29

    上傳用戶:6546544

  • LM3S系列ADC例程內(nèi)置的溫度傳感器

    LM3S系列ADC例程:內(nèi)置的溫度傳感器

    標(biāo)簽: LM3S ADC 內(nèi)置 溫度傳感器

    上傳時(shí)間: 2013-04-24

    上傳用戶:qunquan

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